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简介：这份PPT面向电子工程、通信类课程学习者及需要复习高频电路基础的读者，围绕选频网络中的串联谐振回路展开，适合课堂讲授、考前梳理与知识点查漏。内容从单振荡回路的谐振特性切入，依次讲解谐振频率、阻抗与电流相位关系、品质因数Q的定义及电压谐振带来的耐压问题，并延伸到谐振曲线、通频带、相频特性以及信号源内阻和负载对回路Q值的影响，配有公式推导与曲线示意，便于对照理解选频网络的关键参数，也可为后续并联谐振回路与部分接入内容学习打下基础。压缩包共1个PPT文件，大小约755KB，篇幅集中，适合按章节快速浏览和专题复习。已有169人学习，可作为高频电路入门与选频网络知识查漏的轻量资料。

1. 选频网络：为什么两个无源器件就能把频率“挑”出来

一块板子上只焊了一个电感、一个电容、一个电阻，没有放大器，也没有数字处理，输入 1 V 的扫频信号，某个频率上却能量出几十伏的电压；频率偏一点点，电压又几乎归零。第一次在高频实验里见到这个现象的人，多半会怀疑仪器坏了，或者觉得是玄学。这其实是选频网络最朴素的样子：它不放大任何东西，只是让整个回路对不同频率呈现出完全不同的阻抗，需要的频率分量几乎无阻碍地通过，不需要的被大幅衰减。串联谐振回路、并联谐振回路只是这种阻抗频率选择性的两种接法。高层调制度、Q 值、通频带、部分接入，全是从这个机制上长出来的枝节，理解主干比背公式有用得多。

2. 串联谐振的阻抗塌陷：ω0 处 |Z| 为什么只剩 R

2.1 从虚部 X = ωL − 1/ωC 说起：阻抗是怎么随频率拐弯的

把电感 L、电容 C 和回路自身的损耗电阻 R 串起来，接上一个信号源，这个结构就是单振荡回路。它的阻抗写成复数形式只有三项：

Z(jω) = R + j(ωL − 1/(ωC))

实部 R 全程不变，随频率变化的全部戏份都在虚部 X = ωL − 1/ωC 上。低频时 1/ωC 很大，虚部被容抗主导，整体呈容性；频率升高，ωL 线性增长，1/ωC 按倒数下降，两者在某一点恰好相等，虚部归零；继续升频，感抗反超，回路转为感性。

这个“感抗线性涨、容抗双曲降”的组合，是理解后面所有结论的地基。它们不是此消彼长地打平，而是在一个确定的频率上发生精确的交叉，这个交叉点就是谐振频率。之所以强调“精确”，是因为一旦失配，回路的行为会迅速从一个极端滑向另一个极端，而不是缓慢过渡。

2.2 谐振频率 ω0 的来历：感抗与容抗相互抵消的那个点

令 ω0L = 1/(ω0C)，解出：

ω0 = 1/√(LC) f0 = 1/(2π√(LC))

推导一步就完，但这个式子透露的信息量很大：谐振频率只跟 L 和 C 的乘积有关，跟 R 完全无关。R 决定的是谐振点“多尖”，而不是“在哪”。工程上这个性质非常关键，它意味着可以先把频率定下来（选 L、C），再单独调节回路的损耗（选 R 或换更高 Q 的线圈）去控制选择性，两个维度互不干扰。

顺手再定义一个量，特性阻抗 ρ = √(L/C)，它等于谐振时的感抗值 ω0L，也等于容抗值 1/(ω0C)。这个量把 L、C 的比例和回路的“阻抗档位”联系了起来：同样的谐振频率，L/C 比值越大，ρ 越大，回路就越“高阻”。

用具体数值感受一下量级。L = 10 μH、C = 100 pF，算出来的 f0 约为 5.03 MHz，ρ = √(10 μH / 100 pF) = 10 Ω。如果回路电阻只有 0.5 Ω，那这个回路的 Q 就是 20。注意 ρ 只有 10 Ω 这个事实——串联谐振回路在谐振点的阻抗低到几乎可以忽略，它不是高阻结构，这直接决定了它适合接什么样的信号源，后面会专门讲。

2.3 感性与容性：失谐时电流相位为什么会翻转

偏离谐振点后，回路电流相对源电压的相位由阻抗角决定。设电流相角为 φi，则 φi = −arctan(X/R)。三种状态很清晰：

这张表经常被背下来，但更该记住的是它的连续性：相位不是突变，而是随失谐量平滑地从接近 −90° 扫到 +90°，在 ω0 处以最陡的斜率穿过零点。相位过零这件事本身就是谐振的判据之一——很多测试场景里，幅值峰值不好读，但相位过零点非常好找，用矢量网络分析仪看相位曲线穿零，比看幅值顶点更稳。

顺带说一个常见误解：感性、容性并不是指“电路里只有电感”或“只有电容”，回路里两个元件始终同时存在，只是哪个的电抗占了上风。失谐到很深的时候，回路的表现几乎就像一个单一元件，这才是“呈感性”的真实含义。

2.4 谐振时的“虚短”：为什么 L 和 C 上的电压互相抵消

谐振点上，电流达到最大值 I0 = Vs/R，且与源电压同相。此时两个元件上的电压分别是：

VL = jω0L · I0 VC = −j/(ω0C) · I0

因为 ω0L = 1/(ω0C)，两者模值完全相等；因为一个是 j、一个是 −j，相位恰好相差 180°。叠加之后总和为零，源电压全部落在电阻 R 上。这就是教材里说的“L 与 C 好像虚短”的由来。

这里是最容易翻车的地方：虚短说的是“两者之和为零”，不是“两者各自为零”。恰恰相反，谐振时 L 和 C 各自两端的电压是整个回路里最大的，而且放大了 Q 倍。把“虚短”理解成“电压很低”，是初学阶段最容易埋下的坑，等到大功率调试时炸掉电容才回头补课，代价不小。

换个角度看这个过程：能量在电感的磁场和电容的电场之间来回倒腾，每个周期倒腾两次，源只需要补充电阻上消耗掉的那一小部分。所以源看到的阻抗很小，回路内部的电压却很高。谐振的本质是能量在两个储能元件之间振荡，而不是源直接推着电流走。

3. 品质因数 Q：为什么谐振时电容上的电压能到输入电压的几十倍

3.1 Q 的定义与物理含义：一次储能与一次耗能的比值

教材给的定义是：谐振时回路感抗值（或容抗值）与回路电阻 R 的比值。

Q = ω0L / R = 1/(ω0CR) = ρ / R

三种写法等价，用哪个取决于已知量。已知 L、R 用第一个，已知 C、R 用第二个，已知特性阻抗用第三个。注意 Q 是量纲为一的纯数，它衡量的是回路损耗的大小，R 越小 Q 越高。

更本质的理解来自能量：Q = 2π ×（回路储存的总能量 / 每周期消耗的能量）。这个定义不依赖具体电路拓扑，串联、并联、腔体谐振器、介质谐振器全都适用。一个 Q = 100 的回路，意味着每周期只损耗掉储能的两千分之一左右，能量在 LC 之间来回倒腾几十上百次才衰减掉。这也解释了为什么高 Q 回路的振荡能够持续很久——它不是被源持续推动，而是自身损耗极慢。

常见的实现思路里，Q 值可以达到几十到几百。但要注意，PCB 上的电感实际 Q 可能只有 30～50，片式电容的 ESR 也会把 Q 拉下来，实验室里算出来的理论 Q 和板子上量到的实际 Q 差一个数量级，是常有的事。

3.2 电压谐振：Q 倍压是怎么推出来的

谐振时回路电流 I0 = Vs/R，那么电感上的电压模值：

VL = I0 · ω0L = (Vs/R) · ω0L = Vs · (ω0L/R) = Q · Vs

一行推完。电容上的电压模值相同，方向相反。所以串联谐振被称为电压谐振：不是源输出了高电压，而是回路自己把电压“顶”上去了。

举个具体的数：Vs = 1 V，Q = 100，那么 L 和 C 两端各有 100 V。如果 Q 是 200，就是 200 V。这个倍压关系不是理想情况下的理论值，而是实打实会出现在板子上的电压，用示波器探头点上去就能看到。很多人在小信号阶段测得很顺，一加功率就出问题，根源就在这里——小信号下 Q·Vs 也不过几伏，大信号下同样的 Q 值会把电压抬到元件耐压之上。

反过来，这也提供了一种测量 Q 的实用手段：如果知道源电压、又能准确测出谐振时电容上的电压，两者相除就是 Q。这比测 3 dB 带宽再反算要快，前提是探头本身的负载效应可以忽略，这一点在后面的排查章节会专门说。

3.3 有载 Q 与空载 Q：Rs 和 RL 是怎么把 Q 偷走的

前面所有推导都假设回路里只有自己的损耗电阻 R。真实电路一定挂着信号源内阻 Rs 和负载电阻 RL，它们与 R 串联，直接参与限流。于是有：

Q0 = ω0L / R （空载 Q，回路本身的品质因数） QL = ω0L / (R + Rs + RL) （有载 Q，接入源和负载后的品质因数）

因为分母变大了，QL 永远小于 Q0。这不是一个可以修正的小误差，而是数量级的塌陷。取一组实际数字看：f0 = 10 MHz、L = 10 μH，则 ω0L = 628 Ω；设 R = 6.28 Ω，空载 Q0 = 100。

只要串进 10 Ω 的源内阻，Q 就从 100 掉到 39，带宽翻了 2.6 倍。这就是串联谐振回路最要命的地方：它对源内阻极度敏感。由此得出它的适用边界——信号源内阻 Rs 很小（接近恒压源）、负载电阻 RL 也不大的场合。一旦源是高阻的，串联结构基本没法用，必须换成并联结构，这一条在第 6 章会接着讲。

3.4 耐压、选型与适用场景：串联回路的边界在哪

把上面几条串起来，串联谐振回路的设计约束就清楚了。

第一是耐压。谐振时元件承受 Q 倍源电压，选型时耐压至少留两倍余量，还要考虑暂态过冲和失谐瞬间可能出现的更高电压。绕线电感的匝间绝缘、电容的额定直流电压和交流电压是两回事，高频下还要额外考虑介质损耗引起的温升。

第二是阻抗匹配。串联回路在谐振点阻抗只有 R，量级在几欧到几十欧。如果前后级都是 50 Ω 系统，这个低阻点反而成了好事——它天然接近系统阻抗，插损可以做得很小。所以射频频段做窄带预选、做陷波，串联结构很常见。

第三是 Q 的可控性。因为 Rs 直接串在回路里，串联结构的 Q 很难做高，也很难做稳。源内阻稍有变化（比如前级放大器的工作点漂移），Q 和带宽就跟着变。要求 Q 稳定、选择性可预测的场合，一般会避开串联结构。

常见的一个误区是把 Q 当成越高越好的指标。实际上高 Q 意味着窄带，窄带意味着对元件容差、温度漂移、源阻抗变化全都更敏感。Q 值的选择本质上是“选择性”和“稳定性”之间的折中，不是一个单调优化的目标函数。

4. 谐振曲线与通频带：Q 值怎样同时决定选择性和带宽

4.1 归一化谐振曲线 N(f)：把频率变量压缩成一个失谐量

串联回路的电流幅值随频率变化的曲线称为谐振曲线。把它归一化，即用任意频率下的电流除以谐振电流：

N(f) = I/I0 = R / (R + jX) = 1 / (1 + jξ)

这里引入的 ξ 叫广义失谐，是整章最值得记住的一个量：

ξ = X/R = (ω0L/R)·(ω/ω0 − ω0/ω) = Q·(ω/ω0 − ω0/ω)

它把三个变量（频率偏移、Q 值、元件参数）压缩成了一个无量纲的数。幅频特性就是 |N| = 1/√(1 + ξ²)，相频特性是 φ = −arctan ξ。曲线长什么样，只取决于 ξ，跟具体的 L、C、R 数值无关——这就是归一化的威力，一张图可以套用到所有串联回路。

在谐振点附近，ω/ω0 − ω0/ω ≈ 2Δf/f0，于是 ξ ≈ 2Q·Δf/f0，其中 Δf = f − f0 称为绝对失谐，Δf/f0 称为相对失谐。这个近似在窄带条件下非常好用，误差在千赫兹量级，做工程估算完全够。

4.2 通频带 B = f0/Q 的推导与量级

通频带的定义是：外加电压幅值不变时，回路电流下降到谐振电流的 1/√2（约 0.707）所对应的频率范围，记作 B。

令 |N| = 1/√(1 + ξ²) = 1/√2，直接得到 ξ = ±1。代入 ξ ≈ 2Q·Δf/f0：

2Q·Δf/f0 = 1 → Δf = f0/(2Q) B = 2Δf = f0/Q

这个式子值得反复咂摸。它说明带宽和 Q 是严格的倒数关系，乘积恒等于 f0。给定中心频率，Q 和带宽只能二选一，没有第三种可能。想要既窄带又高 Q，唯一的办法是把中心频率抬上去——这就是为什么高频频段的窄带滤波器反而更容易实现。

看一组量级（f0 = 10 MHz）：

Q 从 20 提到 200，带宽压缩了 10 倍，选择性大幅改善。但注意最后一列的绝对频率范围：Q = 200 时，允许的频率偏差只有 ±25 kHz。任何一点温漂、元件容差、寄生电容，都可能把中心频率推出这个窗口。高 Q 的代价不是理论上的，而是直接体现在可制造性上。

衡量选择性的另一个指标是矩形系数，即 60 dB 带宽与 3 dB 带宽之比。单个 LC 回路的矩形系数在 10 左右，无论 Q 取多少都不会改善——因为归一化曲线的形状是固定的，Q 只改变横轴的缩放，不改变形状。要做出更“方”的曲线，只能靠多级级联或者换滤波器拓扑，指望单回路调 Q 是调不出来的。这一点在实际选型时经常被忽略。

4.3 相频特性：Q 值顺带决定了相位变化的陡峭程度

幅频特性决定谁能通过，相频特性决定通过的信号被延迟了多少。由 φ = −arctan ξ，在谐振点附近 ξ 与 Δf 成正比，所以：

φ ≈ −arctan(2Q·Δf/f0)

在 ξ = ±1（也就是两个 3 dB 点）处，相位恰好是 ∓45°，整个通带内的相位变化范围是 90°。Q 越大，这 90° 被压缩在越窄的频率范围内，相位曲线的斜率就越陡。

对纯正弦载波来说，相位怎么变无所谓。但对调制信号，相位非线性会直接转化为群时延失真，宽带信号通过高 Q 回路后会出现波形展宽、码间干扰。这也是高 Q 窄带回路只适合做连续波或者窄带调制的预选，不适合直接放在宽带数据通道上的原因。

一个实用的观察方法：用矢量网络分析仪同时看 S21 的幅值和相位，如果幅值曲线很漂亮但相位在通带边缘急剧翻转，说明 Q 偏高，实际通过宽带信号时会有问题。这个现象在只看幅频曲线的时候完全看不出来。

4.4 用数值计算验证曲线形状与带宽

把上面的推导用几行代码跑一遍，可以直观看到 Q 对曲线和带宽的影响，也方便验证自己的手工估算：

import math def norm_response(f, f0, Q): """返回归一化幅值和相位（度），基于广义失谐 xi""" xi = Q * (f / f0 - f0 / f) # 精确式，不用近似 mag = 1.0 / math.sqrt(1.0 + xi * xi) phase = -math.degrees(math.atan(xi)) return mag, phase def find_lower_3db(f0, Q): """二分法找下 3 dB 点，验证 B ≈ f0/Q 的精度""" lo, hi = f0 * (1 - 1.0 / Q), f0 for _ in range(80): mid = (lo + hi) / 2 if norm_response(mid, f0, Q)[0] < 1 / math.sqrt(2): lo = mid else: hi = mid return (lo + hi) / 2 f0 = 10e6 for Q in (20, 50, 100, 200): f_lo = find_lower_3db(f0, Q) b_actual = 2 * (f0 - f_lo) # 上下对称近似 print(f"Q={Q:4d} B(精确)={b_actual/1e3:7.2f} kHz " f"B(f0/Q)={f0/Q/1e3:7.2f} kHz " f"相位@3dB={norm_response(f_lo, f0, Q)[1]:6.2f} deg")

代码里的 key 有两处。norm_response用的是精确的 ξ 定义，没有用 2Q·Δf/f0 的近似，所以能顺便量出近似的误差。find_lower_3db用二分法在 [f0(1−1/Q), f0] 区间内搜索幅值等于 1/√2 的点，而不是直接套 f0 − B/2，这样得到的带宽是真实的 -3 dB 宽度。运行结果会发现，实际带宽与 f0/Q 的偏差在千分之一量级，工程上完全可以忽略——这也反过来验证了窄带近似的合理性。最后打印的相位在 -45° 附近，验证了前面相频特性的结论。

如果把 Q 改成 5 甚至 2，会看到偏差开始变大，因为此时已经不满足窄带条件，2Q·Δf/f0 的近似失效了。所以低 Q 回路做估算时要么用精确式，要么老老实实扫频。

5. 避坑与排查：选频回路调试里最容易翻车的五处

5.1 谐振点测不准：探头电容和分布参数在捣鬼

现象：仿真给出的 f0 是 10.00 MHz，板子上扫出来却是 9.72 MHz，怎么调都差一截；换个探头再测，数值又变了。

原因基本跑不出两条。一是探头本身的输入电容。普通无源探头在 1× 档的输入电容有几十皮法，10× 档也有十几皮法，而高频回路的谐振电容本身可能只有几十皮法——探头一并上去，等于给回路并了个电容，f0 = 1/(2π√(LC)) 里的 C 直接变了，频率必然下移。二是分布参数，包括 PCB 走线的寄生电容、电感的匝间电容、接地过孔的电感。这些量在低频时可以忽略，在几十兆赫兹以上就成了主导因素。

解决办法：测量时优先用高阻低电容探头，或者用 10× 档并补偿好；能用非接触方式（比如环形天线耦合）就别直接点上去；实在要接触测量，先把探头接上去再调回路，让探头电容成为回路的一部分，这样测到的才是真实工作状态。另外，仿真里一定要把封装的寄生参数代进去，理想元件模型和实际元件在高频下的差别可能比想象中大得多。

5.2 小信号正常、加功率就击穿：Q 倍压的经验教训

现象：小信号源下测得好好的，波形干净、Q 值也符合预期；换成大功率源一上电，电容冒烟或者电感打火。

原因是第 3 章推过的 Q 倍压。假设 Q = 80，源电压 5 V，谐振时电容两端就是 400 V。一颗额定 50 V 的陶瓷电容在这个位置必然击穿。更麻烦的是，小信号阶段根本看不出异常，所有指标都正常，问题只在大信号时暴露，如果没有提前算过，这几乎是必然踩的坑。

解决办法很朴素：设计阶段就把 Q·Vs 算出来写进选型表，耐压按两倍以上留余量，同时考虑失谐瞬间、开机冲击、源阻抗突变这些暂态工况可能出现的更高电压。另外注意电感的匝间绝缘和电容的交流耐压，额定直流电压和交流电压在介质损耗的作用下不是一回事。调试时的顺序也要讲究——先用小信号把频率和 Q 调好，再用功率计逐步加功率，每一步都测一下元件温升，别一上来就满功率。

5.3 仿真与实测 Q 值对不上：被忽略的寄生损耗

现象：仿真里 Q = 90，实测只有 25，反复检查拓扑和参数都没错。

原因在于仿真用的往往是理想元件，而实际的损耗来源远比一个 R 多：电感的绕线电阻、磁芯损耗、集肤效应带来的等效串联电阻随频率上升、电容的介质损耗和 ESR、PCB 走线的铜阻、焊点的接触电阻。这些损耗在谐振回路里全部折算成串联电阻，直接进 R 的分母。高通滤波器里一个 Q = 90 的回路，算上这些可能就剩 25。

解决办法是建立“有效 Q”的概念，把所有可量化的损耗都折算进 R 再算 QL。测量上可以用两种方法交叉验证：一是测 3 dB 带宽反算 Q，二是测谐振时电容电压与源电压之比直接得 Q。两法结果如果差很多，说明测量本身有问题，比如源内阻没有校准、探头负载过重。另外，换用高 Q 的绕线电感、加粗走线、缩短回路面积，都能实打实地把 Q 拉回来。

5.4 并入负载后通带变宽、增益下跌：有载 Q 没算

现象：单独测回路时带宽 100 kHz，接到系统里之后变成 300 kHz，插损也大了好几个 dB。

这是典型的忽略了负载效应。第 3.3 节的表已经算过，只要串进 10 Ω 的源内阻，Q 就从 100 掉到 39，带宽随之变为 2.6 倍。真实系统里前级的输出阻抗、后级的输入阻抗都不是理想的，它们会直接参与回路的限流。更隐蔽的是，这些阻抗往往还带容性或感性分量，除了降低 Q，还会把中心频率拉偏。

解决办法：设计阶段就把 Rs 和 RL 代进 QL 公式算一遍，不要只算空载 Q。如果算出来的 QL 达不到要求，有两条路：一是降低源内阻（加缓冲级、射极跟随器），二是改用并联结构或者部分接入做阻抗变换。调试时也要养成习惯，在真实负载接入的状态下测带宽和 Q，而不是用信号源直驱空载回路。空载数据好看，但没用。

5.5 抽头位置越调越差：接入系数和阻抗变换是耦合的

现象：为了让后级更好匹配，把抽头往下移，结果通带反而变宽了、选择性变差，继续移又出现增益骤降。

原因在于部分接入里，接入系数 p 同时影响两件事：等效阻抗变换比 R_eq = R0/p²，以及折算到回路里的负载电导。p 减小确实能减轻负载对回路的加载，让 QL 上升；但同时也会降低从回路取出的信号幅度，增益随之下降。两个效应方向相反，存在一个最优点，凭感觉调很容易调过头。

解决办法是先定目标再定参数：根据需要的 QL 反推出允许的负载电导，再据此选 p；确定 p 之后再算增益预算，看这个损失能不能接受。调的时候一次只改一个变量，改完立刻复测带宽和中心频率——部分接入改变的不只是幅度，还会轻微影响谐振频率。有条件的话做一组 p 的扫描，把带宽和增益都记下来画成曲线，最优点一目了然。

6. 并联谐振与部分接入：高频电路最终为什么更常用并联结构

串联回路的死穴在第 3.3 节已经暴露得很清楚：它的 Q 与源内阻强耦合，源阻抗一高，Q 就塌。而高频放大器的输出端恰恰是高阻的——共射、共源、共阴结构的集电极或漏极输出，本质上接近一个恒流源。把串联回路挂在这种源上，Q 会被源内阻吃得干干净净。

并联结构换了个思路。电感、电容、回路损耗电阻 R0 三者并联，导纳写成：

Y = G + j(ωC − 1/ωL)

谐振条件依然是 ω0 = 1/√(LC)，但此时是导纳虚部归零，等效阻抗取最大值 Z = R0，而不是最小值。Q 的定义也跟着反过来：Q = R0/(ω0L) = ω0CR0。谐振时两个支路里的电流幅值都是源电流的 Q 倍，相位相反、互相抵消，源只提供很小的励磁电流——所以并联谐振叫电流谐振，与串联的电压谐振正好对偶。

对恒流源来说，谐振点阻抗最大意味着源“看到”的负载最重、电压摆幅最大，这正是放大器需要的。源内阻越高，并联结构的 Q 越保得住，这和串联结构恰好互补。选串还是选并，本质上是看源是恒压还是恒流，不是看哪个公式好记。

麻烦出在负载上。直接把下一级并到回路两端，等于给 R0 并了一个电阻，等效并联电阻下降，Q 立刻掉下来，中心频率也会被负载电容带偏。这就是部分接入要解决的问题：不是把负载直接并上去，而是在回路上抽一个头，或者用电容分压，让负载只“看到”回路的一部分。设接入系数为 p（小于 1），折算到回路两端的等效电阻变成 R0/p²，负载对回路的加载按 p² 缩小，Q 得以保住。

代价是取出的信号幅度也按 p 缩小，而且 p 越小，回路等效阻抗越高，后级匹配越难做。p 的选择就是隔离度与增益的折中，跟 Q 值的选择逻辑如出一辙——没有最优值，只有和系统指标匹配的值。我一般会在设计初期就把 p 和 QL 绑在一起算，先定允许的加载量，再反推 p，最后核增益预算；调板的时候从不单独动抽头，每改一次都连着复测带宽、中心频率和插损三项，否则很容易在“改好了这个、弄坏了那个”之间反复横跳。

从那以后我每次碰谐振回路，都会先把源和负载的阻抗代进 QL 的式子算一遍，再决定拓扑和接入系数。这个习惯帮我省掉了很多次推倒重来。希望帮到你。

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