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PCIe XDMA IP核实战：基于Xilinx-FPGA-PCIe-XDMA-Tutorial的BRAM读写工程搭建

【免费下载链接】Xilinx-FPGA-PCIe-XDMA-TutorialXilinx FPGA PCIe 保姆级教程 ——基于 PCIe XDMA IP核项目地址: https://gitcode.com/gh_mirrors/xil/Xilinx-FPGA-PCIe-XDMA-Tutorial

Xilinx-FPGA-PCIe-XDMA-Tutorial是一套完整的Xilinx FPGA PCIe开发解决方案，通过XDMA IP核实现高效的主机与FPGA之间的数据传输。本文将带你快速掌握基于该教程的BRAM读写工程搭建方法，从IP配置到硬件连接，全程可视化操作，让PCIe开发不再复杂。

准备工作：了解项目结构与核心文件

在开始搭建工程前，建议先熟悉项目的基本结构。核心资源包括：

• FPGA工程文件：netfpga_pcie_x1_xdma_bram.zip和netfpga_pcie_x1_xdma_bram_blockdesign.zip提供了预配置的工程模板
• 驱动程序：host_software/driver/xdma/目录包含XDMA驱动源码及Makefile
• 测试程序：host_software/app_xdma_rw/xdma_rw.c提供了BRAM读写测试代码
• 文档资料：doc/目录下的markdown文件详细介绍了从引脚分配到驱动加载的全过程

第一步：XDMA IP核配置详解

XDMA IP核是实现PCIe数据传输的核心，正确配置参数是工程成功的关键。以下是关键配置步骤：

基础参数设置（Basic标签）

在Basic标签中，需要重点配置：

• Lane Width：设置为x1（根据硬件实际PCIe通道数选择）
• Maximum Link Speed：推荐选择5.0GT/s以获得较好性能
• AXI Data Width：设置为64bit，与后续BRAM控制器保持一致
• AXI Clock Frequency：选择62.5MHz作为基础时钟

标识符与地址空间配置（PCIe ID和BARS标签）

在PCIe ID标签中，保持默认的Vendor ID（10EE）和Device ID（7021）即可。

在PCIe BARS标签中，需启用PCIe to DMA Bypass Interface，并设置Size为1MB，为BRAM分配足够的地址空间。

中断与DMA通道配置（MISC和DMA标签）

在PCIe MISC标签中，建议启用MSI-X Capability Structure，设置16个User Interrupts以支持多种中断场景。

在PCIe DMA标签中，配置：

• Number of DMA Read Channel：1
• Number of DMA Write Channel：1
• 保持其他参数默认值

第二步：BRAM控制器配置与连接

BRAM作为FPGA端的高速缓存，需要与XDMA核正确连接以实现数据交互。

BRAM控制器参数设置

关键配置项：

• Data Width：64bit（与XDMA的AXI Data Width保持一致）
• Memory Depth：65536（对应512KB存储空间）
• 其余参数保持默认

XDMA与BRAM的AXI接口连接

连接要点：

• 将XDMA的M_AXI接口连接到BRAM控制器的S_AXI接口
• 确保axi_clk和axi_aresetn信号正确连接
• 无需额外逻辑，通过自动连接工具即可完成基础连线

第三步：地址分配与HDL封装

完成IP配置和连接后，需要为BRAM分配地址空间并生成顶层HDL文件。

地址空间分配

在Vivado的Address Editor中：

1. 选择axi_bram_ctrl_0的S_AXI接口
2. 点击"Assign Address"
3. 系统会自动分配一个1MB的地址空间（0x0000_0000至0x000F_FFFF）

创建HDL Wrapper

右键点击block design文件，选择"Create HDL Wrapper"，生成可综合的顶层Verilog文件。这一步将IP连接关系转换为硬件描述语言，为后续实现做准备。

工程文件结构

生成后的工程主要包含：

• fpga_top.sv：FPGA顶层Verilog文件
• xdma_bram_wrapper.v：block design的HDL封装
• xdma_bram.bd：IP连接图
• fpga_top.xdc：约束文件

第四步：硬件连接与驱动加载

完成FPGA工程实现并生成bitstream后，需要进行硬件连接和驱动配置。

FPGA板卡与PC连接

硬件连接注意事项：

• 将FPGA板卡插入PC的PCIe插槽
• 确保8PIN电源接口正确连接（红色框标记处）
• 连接JTAG下载器以便烧写bitstream

驱动加载步骤

驱动位于host_software/driver/xdma/目录，加载方法：

git clone https://gitcode.com/gh_mirrors/xil/Xilinx-FPGA-PCIe-XDMA-Tutorial cd Xilinx-FPGA-PCIe-XDMA-Tutorial/host_software/driver sudo ./load_driver.sh

第五步：BRAM读写测试

使用host_software/app_xdma_rw/目录下的测试程序验证BRAM读写功能：

编译测试程序

cd host_software/app_xdma_rw gcc xdma_rw.c -o xdma_rw

运行读写测试

# 向BRAM写入数据 ./xdma_rw /dev/xdma0_c2h_0 write 0x0 1024 random.bin # 从BRAM读取数据 ./xdma_rw /dev/xdma0_h2c_0 read 0x0 1024 readback.bin

AXI总线时序参考

时序图展示了AXI总线上的读写操作流程，有助于理解数据传输的底层机制。当测试程序运行正常时，实际波形应与图示一致。

总结与进阶

通过本文的步骤，你已经成功搭建了基于XDMA IP核的BRAM读写工程。这个基础框架可以扩展到更复杂的应用场景，例如：

• 通过host_software/app_xdma_mpeg2encode/目录下的程序实现视频编解码加速
• 修改XDMA配置以支持更高带宽的数据传输
• 添加更多外设（如GPIO、UART）到AXI总线上

项目提供的完整文档和示例代码（如doc/intro_pcie_x1_xdma_bram.md）可以帮助你深入理解每个环节的原理，建议结合实际需求进一步探索和优化。

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