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1. 项目概述：为什么我们需要双模神经元？

在神经形态计算和边缘AI硬件领域，功耗和面积是悬在设计师头顶的两把利剑。传统的数字电路虽然设计规则清晰，但每执行一次乘加运算，能量消耗都相当可观。模拟计算，尤其是基于生物启发的脉冲神经网络（SNN），提供了一条潜在的出路，因为它能用更少的操作和更低的精度来实现类似的功能。然而，把生物神经元用硅实现，从来不是一件简单的事。

其中，泄漏积分发放（LIF）模型是SNN中最核心、最常用的神经元模型之一。它的电路实现，长久以来面临一个经典的两难选择：要极致能效，还是要强大的接口能力？

追求极致能效的设计师会毫不犹豫地选择让所有晶体管都工作在亚阈值区。在这个区域，晶体管的栅源电压低于阈值电压，电流由载流子扩散主导，呈现指数关系。其静态电流可以低至皮安甚至飞安级别，每个脉冲的能量消耗可以做到几个飞焦耳（fJ），这对于电池供电的传感器节点来说是梦寐以求的。但是，亚阈值电路的“阿喀琉斯之踵”在于其极小的电压摆幅和极弱的驱动能力。它的输出信号幅度可能只有几十到几百毫伏，且输出阻抗很高。这意味着，如果你想用这个神经元的输出去驱动一个数字缓冲器、点亮一个LED，或者更常见的，去写入一个电阻式存储器（如忆阻器）的交叉阵列，你几乎肯定需要在后面级联一个甚至多个放大级或电平移位器。这些额外的电路不仅增加了面积和功耗，更引入了延迟和设计复杂性，最终可能把亚阈值省下来的那点能量又给“吃”了回去。

另一方面，工作在饱和区（强反型区）的电路则完全是另一番景象。它们可以提供从电源轨到地的全摆幅输出，噪声容限高，驱动能力强，能轻松地与标准CMOS数字逻辑或其他模拟模块“对话”。但代价是功耗显著增加，因为饱和区电流远大于亚阈值电流。一个纯饱和区设计的LIF神经元，其能效往往比亚阈值设计差一两个数量级。

那么，有没有可能“鱼与熊掌兼得”？这就是我们这次要深入探讨的双模CMOS LIF神经元设计的核心动机。它不是一个简单的折中，而是一种精巧的架构融合：让核心的、持续工作的积分功能在亚阈值区进行，以榨取每一分能量效率；同时，让瞬态的、需要驱动外部负载的接口功能（阈值比较、脉冲生成、复位）在饱和区进行，以保证强大的连接性。整个电路仅用5到6个晶体管，在一个标准电源电压下工作，无需任何外部放大级。这听起来像是一个“既要、又要”的完美方案，但它是如何实现的？背后又有哪些精妙的权衡和必须注意的“坑”？这正是本文要拆解清楚的内容。

2. 核心设计思路与架构拆解

2.1 从数学模型到电路映射：LIF的本质

任何硬件设计都始于一个清晰的行为模型。对于LIF神经元，其核心是一个带有泄漏路径的积分器。它的等效电路模型可以抽象为一个电容Cm（膜电容）并联一个电阻Rleak（泄漏电阻），并受到一个激励电流Iex的充电。膜电压Vm的动态由以下一阶微分方程描述：

Cm * dVm/dt + Vm / Rleak = Iex

当Vm充电达到一个设定的阈值电压Vth时，神经元“发放”一个脉冲，随后Vm被迅速重置到一个基础电压Vreset（通常为0V），循环重新开始。这个模型的解是一个指数充电曲线，其时间常数τ = Rleak * Cm直接决定了神经元的积分速度，进而影响其发放频率。

在电路实现中，我们需要用晶体管来扮演这些抽象元件：

• 积分电容Cm：通常不单独放置一个大电容（太占面积），而是巧妙地利用晶体管节点固有的寄生电容（如栅-漏电容Cgd、扩散区电容Cdb等）作为膜电容。这是实现超紧凑面积的关键。
• 泄漏电阻Rleak：这就是亚阈值晶体管的用武之地。一个栅极电压被控制在低电平（例如0V）的MOS管，当其源漏电压Vds较小时，在亚阈值区会呈现一个极高的动态电阻，范围在兆欧到吉欧量级，完美地模拟了生物神经元膜电导的泄漏特性。
• 激励电流Iex：可以由一个偏置在亚阈值或饱和区的晶体管电流源提供，用于控制神经元的输入刺激强度。
• 阈值比较与脉冲生成：这需要一个具有明确开关阈值的电路，通常是一个CMOS反相器。当Vm超过反相器的翻转点Vth(lif)时，输出发生跳变。
• 复位机制：需要在脉冲发放后，快速将Vm拉回Vreset。这可以通过一个受脉冲反馈控制的开关（晶体管）来实现。

2.2 双模架构的巧妙分工

理解了基本映射后，双模架构的精妙之处就显现出来了。它没有试图让一个晶体管同时做好所有事，而是根据任务特性，将其分配到最合适的工作区。

1. 亚阈值区任务：超低功耗的积分与泄漏这个任务交给了晶体管M1。在绝大部分时间（积分期），M1的栅极电压为低，处于深度亚阈值状态。此时，从积分节点（M1的漏极）看进去，M1呈现一个巨大的电阻Rleak。微小的激励电流Iex（纳安级）缓慢地对寄生电容Cm充电，Vm缓慢上升。这个过程功耗极低，因为流经M1的泄漏电流和充电电流都非常小。这里的一个关键洞见是：我们不是把亚阈值电流当作“bug”（泄漏），而是把它当作实现核心神经元泄漏动力学的“feature”。

2. 饱和区任务：鲁棒的接口与信号处理阈值检测和脉冲生成由反相器（M2和M3）完成。这个反相器被偏置在标准饱和区工作，以确保其具有陡峭的电压传输特性（VTC）和明确的翻转阈值Vth(lif)。当Vm缓慢爬升并超过Vth(lif)时，反相器输出会从一个电源轨快速翻转到另一个电源轨，产生一个边沿陡峭的脉冲。

这个脉冲随后驱动由M4和M5构成的第二个反相器（增益级）。该级同样工作在饱和区，有两个重要作用：

• 提供全摆幅输出：将内部较小的电压摆幅放大到完整的电源电压范围（例如0V到1.8V），使其能够直接驱动后续的数字逻辑或模拟负载。
• 生成复位反馈：其输出的跳变边沿通过一个简单的RC网络或直接耦合，产生一个短暂的高电平脉冲，反馈到M1的栅极。在这个短暂瞬间，M1被强驱动进入线性区或饱和区，导通电阻变得极小，从而快速泄放掉Cm上积累的电荷，将Vm复位。复位完成后，反馈脉冲结束，M1栅极恢复低电平，重新进入亚阈值泄漏状态，开始下一个积分周期。

这种分工的核心优势在于：高功耗的饱和区电路（M2-M5）只在Vm达到阈值的瞬间被短暂激活（产生脉冲和复位），其平均功耗很低；而持续工作的积分路径（M1）始终处于超低功耗的亚阈值状态。同时，输出级天然具备强大的驱动能力。这相当于用一个“常开”的超低功耗传感器（亚阈值积分器）去触发一个“按需启动”的高性能执行器（饱和区接口），在系统层面实现了能效和性能的平衡。

注意：这里的“双模”指的是电路内不同晶体管工作区的混合，而非单个晶体管在不同时间切换模式。M1在积分期是亚阈值，在短暂的复位期会被驱动至强反型区，但这属于其功能的一部分，并非设计追求的核心“双模”特性。核心的“双模”理念是架构层面的分工。

2.3 晶体管级电路图与工作阶段详解

让我们结合一个简化的原理图（对应论文中的Figure 5）来走一遍信号流：

1. 积分阶段：Iex对节点Vm（M1的漏极、M2的栅极）充电。M1栅极为低，处于亚阈值，提供高阻泄漏路径。Vm缓慢上升。
2. 阈值检测与脉冲前沿：当Vm超过反相器（M2, M3）的翻转点Vth(lif)，反相器输出Vint从高电平跳变为低电平。
3. 增益与脉冲后沿/复位：Vint的下降沿驱动M4-M5反相器，使最终输出Vout从低跳变到高（产生脉冲上升沿）。同时，Vout的高电平通过一个反馈路径（例如一个电容）产生一个正脉冲加到M1的栅极。
4. 复位阶段：M1栅极的这个正脉冲使其瞬间进入强导通状态，迅速将Vm节点放电至低电平（接近GND）。
5. 恢复与下一个周期：反馈脉冲结束，M1栅极恢复低电平，重新进入亚阈值状态。Vm在Iex作用下开始新一轮充电。

整个电路形成了一个自激振荡器，其振荡频率f由Iex、Rleak和Cm共同决定。这里最巧妙的一点是，复位信号来源于输出级自身，无需外部时钟或控制信号，实现了完全的自包含（self-contained）操作。

3. 关键设计参数、折衷与实现细节

3.1 核心参数：如何设定发放频率？

发放频率f是LIF神经元最关键的动态特性。根据推导（对应论文公式21, 31, 32），其表达式为：

f = 1 / [ Rleak * Cm * ln( (Vth(lif) - Rleak*Iex) / (Vreset - Rleak*Iex) ) ]

这个公式揭示了几个重要的设计关系：

1. Rleak的非线性：Rleak不是常数，它随Vm变化。在亚阈值区，Rleak(Vm) ≈ Vm / [ I0 * exp(-Vth/(n*Vt)) * (1 - exp(-Vm/Vt)) ]。可以看到，Rleak随Vm升高而增大。在工程上，我们常取Vm从Vreset到Vth(lif)区间内的平均值Rleak_avg进行估算。
2. Vth(lif)的角色：阈值电压由反相器（M2, M3）的尺寸比决定：Vth(lif) = [ sqrt(kp)*(Vdd - |Vthp|) + sqrt(kn)*Vthn ] / (sqrt(kn) + sqrt(kp))。通过调整M2和M3的宽长比(W/L)，可以精确设定Vth(lif)。但要注意，改变这两个管子的尺寸也会改变它们对Vm节点的寄生电容Cm，从而影响时间常数。因此，Vth(lif)和Cm需要协同设计。
3. Iex的直接控制：激励电流Iex是调节频率最直接、最线性的手段。增大Iex，充电速度加快，频率升高。
4. Cm的稳定作用：膜电容Cm是时间常数的另一个乘数。它主要由寄生电容构成，但为了稳定频率、减少工艺偏差和寄生注入的影响，通常会故意添加一个小的显式电容（如MIM电容）。增加Cm会降低频率，但能提高行为的可预测性和鲁棒性。

设计流程示例：

1. 确定目标频率范围（例如，10 kHz - 1 MHz）。
2. 根据工艺库参数，估算亚阈值晶体管M1在目标Vm范围内的平均Rleak（通常在百兆欧到吉欧量级）。
3. 根据布局预估和显式电容选择，确定Cm的总值（例如，100 fF量级）。
4. 利用频率公式，反推出所需的Iex范围。Iex通常在皮安到纳安量级。
5. 根据Vth(lif)的公式和期望的噪声容限，确定反相器（M2, M3）的尺寸。
6. 进行SPICE仿真，微调参数。

3.2 寄生电容：敌人还是朋友？

在亚阈值电路中，寄生电容的影响被极度放大。因为电流极小（纳安级），即使几个飞法（fF）的电容变化，也会显著改变充电时间。Vm节点的总电容Ct是：Ct = Cgd_M1 + Cdb_M1 + Cgs_M2 + Cgd_M2 + Cgb_M2 + Cgs_M3 + Cgd_M3 + Cgb_M3 + Cexplicit

这里有两个重要的实操心得：

心得一：将寄生电容转化为设计资源。与其试图消除寄生电容（不可能），不如在设计中将其作为Cm的一部分进行建模和利用。通过精确的寄生参数提取（Post-layout extraction），我们可以相对准确地预测Ct，从而预测频率。在紧凑型设计中，我们甚至有意依赖这些寄生电容作为主要的积分电容，以节省面积。

心得二：隔离与补偿是稳定性的关键。论文中提到了一个常见问题：如果理想电流源直接连接到Vm节点，外部电路的任何寄生电容都会直接叠加到Ct上，导致频率漂移。解决方案是增加一个隔离晶体管（如图中的M6）。M6作为一个共源级，其栅极接受输入电压Vex，漏极提供电流Iex给积分节点。这样，外部电路（驱动Vex的电路）的寄生电容被M6的源极隔离，不会直接影响Vm节点。同时，增加一个小的显式MIM电容Cm可以提供一个稳定的、占主导地位的电容基准，进一步抑制由M1栅漏电容Cgd耦合等引起的电荷注入效应，防止Vm在复位时出现负向过冲。

3.3 复位机制与潜在风险

复位阶段是电路中最动态的部分，也最容易出问题。当输出脉冲反馈回来驱动M1栅极时，M1会瞬间进入强反型区，以毫安级的大电流放电。这里需要注意：

• 复位脉冲宽度：必须足够宽，以确保Vm被充分放电到Vreset附近，但又不能太宽，否则会浪费能量并可能影响最小发放间隔。这个宽度通常由反馈路径中的RC时间常数决定，需要仔细仿真确定。
• 电荷注入与时钟馈通：M1栅极电压的快速跳变会通过其栅漏覆盖电容Cgd_M1向Vm节点注入电荷，可能导致Vm在复位后出现一个电压“毛刺”或偏移。这就是为什么需要显式电容Cm来“吸收”这部分注入电荷，减小电压扰动。
• 负电压箝位：在极端情况下，快速的电荷注入可能将Vm拉至地电位以下。由于MOS管的漏/源-衬底PN结在正向偏置约0.7V时会导通，这个结实际上充当了一个箝位二极管，将Vm的最低电位限制在约 -0.7V，防止了过大的负压损坏器件或导致闩锁。

实操技巧：在仿真中，务必进行工艺角（Corner）分析和蒙特卡洛（Monte Carlo）分析。亚阈值电流对工艺偏差（Vth波动）极其敏感，Rleak可能在不同Corner下有数倍甚至十倍的变化。这会导致发放频率发生巨大漂移。因此，在实际设计中，要么接受一个较宽的工作频率范围，要么必须引入某种形式的调谐机制，例如：

• 电流DAC调谐：用数模转换器（DAC）产生可编程的Iex，以补偿Rleak的变化。
• 电容阵列调谐：使用可开关的电容阵列来微调Cm。
• 体偏置调谐：如果工艺支持，通过改变M1的体电压来微调其阈值电压Vth，从而改变Rleak。

4. 性能评估、对比与版图实现

4.1 仿真结果与模型验证

在SkyWater 130nm工艺（SKY130 PDK）下，对电路进行仿真。电源电压Vdd=1.8V。通过扫描输入隔离管M6的栅压Vex，可以线性地调节Iex，从而获得不同的发放频率。

关键观察结果：

1. 频率范围：在Iex从几纳安到几十纳安的变化范围内，发放频率可以从几kHz变化到接近1MHz。这个范围覆盖了多数生物启发传感和脉冲处理应用的需求。
2. 模型准确性：将SPICE仿真得到的频率与基于平均Rleak的解析模型（公式32）预��的频率进行对比，两者吻合度很高。这证明了我们的理论模型足以指导初期设计。
3. 能量效率：每个脉冲的能量E_spike ≈ 0.5 * Cm * Vth(lif)^2。以Cm=123.5 fF,Vth(lif)=0.8V计算，E_spike ≈ 39.5 fJ。平均功耗P_avg = E_spike * f。在100kHz频率下，功耗仅约4 pW。这充分体现了亚阈值积分带来的能效优势。
4. 后仿真相差：完成版图后提取寄生参数进行后仿真（Post-layout simulation），发现频率比原理图仿真降低了约3-4%（例如从998kHz降至961kHz）。这完全在意料之中，因为版图引入了额外的连线电容和交叉耦合电容，增加了总的Ct，从而降低了频率。这个偏差在可接受范围内，且通过前期预留设计余量可以管理。

4.2 与同类设计的对比

下表将本设计与近年文献中一些有代表性的CMOS LIF神经元进行了对比：

对比分析：

• vs. 纯亚阈值设计：我们的设计在能量效率上做出了微小妥协（从个位数fJ到几十fJ），但换来了革命性的接口简化。省去输出放大器节省的面积和功耗，在系统级往往比神经元本身省下的那点能量更有价值。
• vs. 纯饱和区设计：我们的设计在能效上具有压倒性优势（低1-2个数量级），同时晶体管数量更少。
• vs. 其他混合设计：我们的架构更简洁，概念更清晰（明确的“亚阈值积分+饱和区接口”分工），且实现了真正的全摆幅输出而不需要额外增益级。

核心价值主张：本双模设计并非在单项指标上做到极致，而是在能效、面积、接口鲁棒性和设计简洁性之间取得了出色的平衡。它特别适合用于构建高密度、大规模集成的神经形态芯片，其中神经元需要直接与数字路由器、存储器阵列或其他模拟模块连接。

4.3 版图实现与面积考量

在130nm工艺下，该神经元的版图面积仅为408 µm²，极其紧凑。面积主要由晶体管M1和M6（如果使用）决定，因为为了获得高Rleak和精确的Iex，它们可能需要较大的长度L。显式电容Cm如果只用几fF到几十fF，其面积开销很小。

版图技巧：

1. 匹配与对称：虽然神经元是模拟电路，但若在阵列中大量使用，需要考虑器件匹配。M1的Rleak对Vth变化敏感，因此版图时应使用共质心等匹配技术来减小失配。
2. 寄生优化：Vm节点是高频敏感节点，应尽量缩短该节点的连线，并用地线或电源线进行屏蔽，以减少耦合噪声。
3. 电源隔离：输出级（M4, M5）在脉冲瞬间会产生较大的瞬态电流，可能引起电源毛刺。应在电源轨上放置足够的去耦电容，并将模拟电源（供给M1, M2, M3）与数字输出电源（供给M4, M5）进行一定隔离，防止噪声通过电源串扰到敏感的积分节点。

5. 实际应用考量、扩展性与未来方向

5.1 在系统中的应用：构建神经形态阵列

单个神经元性能再好，也需融入系统才能发挥价值。双模神经元的直接接口能力使其在构建阵列时具有显著优势。

与忆阻器交叉阵列的接口：这是神经形态计算的热门方向。忆阻器通常需要~0.5-1V的电压脉冲来进行写操作。纯亚阈值神经元的输出脉冲幅度不足，而饱和区神经元功耗又太高。本设计的全摆幅输出脉冲（0-1.8V）可以直接驱动忆阻器，无需额外的电平移位驱动器，简化了阵列周边电路，降低了整体功耗和面积。

构建二维神经元阵列：可以将成千上万个这样的神经元与局部互连网络集成。每个神经元的输出可以驱动一条行线或列线，通过可编程开关连接到其他神经元的输入或突触阵列。由于接口简单，路由开销小。

5.2 功能扩展：不止于基础LIF

基础LIF模型功能有限。得益于其饱和区接口的灵活性，本设计可以方便地进行扩展：

1. 抑制性输入：在积分节点Vm上并联一个由抑制脉冲控制的NMOS管。当抑制脉冲来临时，该管导通，为Vm提供一个额外的接地路径，加速其放电，从而抑制或延迟下一次发放。这实现了基本的兴奋-抑制平衡。
2. 多输入集成：可以用多个晶体管（如M6a, M6b...）并联，栅极分别接收不同的输入信号Vex1, Vex2...。它们的漏极电流在Vm节点求和，实现多输入信号的时空整合。
3. 自适应阈值：可以通过一个额外的电路模块，在每次发放后动态微调反相器的供电电压或偏置，从而改变Vth(lif)，实现发放频率适应或阈值自调节等复杂动力学。
4. 可配置时间常数：将显式电容Cm替换为一个由数字信号控制的小型电容阵列（Capacitor Bank），可以实现对神经元时间常数的数字编程，使其能适应不同时间尺度的信号。

5.3 局限性与挑战

没有完美的设计，双模神经元也有其挑战：

• 工艺敏感性：亚阈值电流对温度、工艺偏差极其敏感。这会导致神经元之间（失配）以及同一神经元在不同条件下（漂移）的频率发生显著变化。在要求精确时序的应用中，必须引入校准或自适应电路。
• 频率上限：由于复位机制和寄生RC延迟，其最高发放频率被限制在几MHz到几十MHz量级。对于需要GHz级处理速度的应用，此结构不适用。
• 噪声影响：亚阈值积分节点Vm是高阻抗节点，易受衬底噪声和电源噪声干扰。精心的版图布局、电源滤波和屏蔽至关重要。

5.4 给实践者的建议与避坑指南

如果你打算在项目中使用或借鉴此类设计，以下是我的几点经验之谈：

1. 仿真必须覆盖全角落：不要只做TT（典型-典型）工艺角的仿真。一定要跑FF（快-快）、SS（慢-慢）、FS、SF等所有工艺角，以及不同温度（-40°C, 27°C, 85°C, 125°C）。你会惊讶地发现频率变化范围可能高达10倍。基于此确定你的工作频率边界。
2. 预留调谐接口：在芯片设计时，务必为Iex的偏置电流预留一个可调的DAC或可编程电流镜。这是应对工艺偏差最有效的手段。也可以考虑为Cm预留几个可开关的单元电容。
3. 仔细处理复位路径：反馈复位路径的RC常数需要仔细优化。太慢会导致复位不彻底，Vm残留电压累积，影响周期一致性；太快则可能因边沿过陡引入更大的电荷注入。建议用仿真扫描确定最佳值。
4. 电源完整性是生命线：为模拟积分部分（M1, M2, M3）使用独立的、干净的电源轨或LDO，并与数字输出部分（M4, M5）做好隔离。在芯片级，考虑使用片上深N阱隔离来保护敏感的亚阈值电路。
5. 从系统角度评估价值：不要孤立地比较单个神经元的能量/脉冲。评估整个系统，包括突触、路由、存储器接口的总能耗和面积。双模神经元省去的输出缓冲器和电平转换器，在系统级可能带来更大的收益。

这个双模CMOS LIF神经元的设计，体现了一种优秀的工程思维：不是追求某个指标的极限，而是在矛盾的约束条件中��找最优的系统级解决方案。它用最小的面积和复杂度，巧妙地弥合了超低功耗模拟计算与鲁棒数字接口之间的鸿沟，为实用化、高集成度的神经形态芯片提供了一块坚实可靠的基石。在实际流片项目中，这种清晰的分工思想和对寄生参数的积极利用，往往比追求理论上的极致参数更能带来项目的成功。