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简介：本资源是一份面向PCB工程师、硬件开发人员及电子设计初学者的QFN封装标准化尺寸图集，聚焦解决元器件选型、焊盘设计与贴装可靠性等实际工程问题。PDF文档系统整理了多种常见QFN封装（如0.4mm、0.5mm、0.65mm引脚间距）的完整尺寸参数表，涵盖A0/A1/A3、D/E/D1/E1、kb/eL等关键符号的最小/最大值及典型值（单位毫米与英寸双标注），并明确标注了焊盘宽度、引脚长度、散热焊盘尺寸等影响焊接质量与热性能的核心数据。资源为单文件PDF，大小981KB，内容精炼、图表清晰，可直接用于Altium Designer或Cadence等EDA工具中的封装库创建与校验。目前已有5490人学习下载，是PCB Layout阶段快速查阅、规避虚焊短路、提升一次贴装成功率的实用型技术参考资料。

1. QFN封装尺寸图不是“查表工具”，而是PCB设计的校验基准线

你有没有遇到过：PCB打样回来，QFN芯片焊不上去，或者回流焊后虚焊、连锡、立碑？拆开飞线测试发现引脚根本没对准焊盘——不是嘉立创画错了，也不是嘉立创GERBER导出问题，而是你手里的那份《QFN封装尺寸图》压根没被当成设计输入，只当成了“参考手册”在焊盘画完后才翻出来比对。这恰恰是绝大多数学生做毕设、工程师赶项目时最典型的翻车起点：把尺寸图当“事后验证材料”，而不是“前置约束条件”。这份《QFN系列元器件封装尺寸图》不是PDF格式的静态文档，它是一套带公差边界的三维物理接口协议——A0/A1/A3定义了封装体在Z向的堆叠高度与共面性容忍度；D/E/D1/E1框定了XY平面的机械占位与引脚投影边界；kb/eL则直接锁死了焊盘宽度与长度的工艺窗口。它解决的不是“这个芯片长什么样”，而是“你的PCB焊盘必须长成什么样才能让这块芯片稳稳站住、可靠导通、有效散热”。适合正在做PCB课设、毕业设计、硬件小批量试产的工程师，也适合刚接手Layout任务却对封装公差体系缺乏实操认知的新人。别再拿Altium默认库随便改个数值就出图了——这份资源里每组Min/Max值背后，都对应着JEDEC MS-012、JEDEC MO-220等标准中明确规定的制造公差带和装配容错域。

2. 封装参数解构：从符号到物理意义的逐层穿透

QFN封装尺寸图表面看是一堆字母加数字的表格，但每个符号都不是随意命名，而是严格遵循JEDEC（联合电子设备工程委员会）标准定义的几何语义。理解这些符号的真实物理指向，是避免焊盘画错的第一道防线。下面以最常被误读的三组参数为例，结合实际尺寸数据展开说明。

2.1 A0/A1/A3：封装体高度与共面性的双重约束

A0、A1、A3这三个参数共同定义了QFN封装在垂直方向（Z轴）上的结构特征：

• A0：指封装本体顶部到PCB焊盘表面的标称高度（Nominal Package Body Height），即芯片塑封体的厚度。例如某型号标注“A0: 0.700/0.800 mm”，表示该器件在量产批次中，其塑封体厚度允许在0.700～0.800mm之间波动。这个范围直接影响热沉焊盘（Exposed Pad）与PCB铜皮之间的接触压力——若A0偏大而焊盘开窗过小，会导致热沉悬空；若A0偏小而焊盘过大，则可能引发底部空洞或助焊剂残留。

• A1：指封装本体底部（即引脚焊端所在平面）到PCB焊盘表面的距离，即“引脚共面高度”（Seating Plane to Terminal Tip）。典型值为“0.000/0.050 mm”，意味着引脚末端理论上应与封装底面齐平（0.000），但允许最大0.050mm的翘曲或凹陷。这是判断是否会发生“引脚悬空焊不上”的关键阈值。实测中若A1实测值＞0.04mm，往往需在钢网开孔时增加热沉焊盘区域的锡膏量来补偿。

• A3：指封装本体顶部到引脚末端的总高度（Overall Package Height），即A0 + A1。它决定了器件安装后的整体堆叠高度，影响屏蔽罩安装、连接器插拔、外壳间隙等结构适配问题。例如某QFN标注“A3: 0.900/1.000 mm”，则整机结构设计时，上方预留空间必须≥1.000mm，否则存在干涉风险。

提示：A0与A1的Min/Max组合，隐含了封装体翘曲（Warpage）的最大容忍值。例如A0 Max=0.800、A1 Min=0.000 → 实际A3 Max=0.800；而A0 Min=0.700、A1 Max=0.050 → A3 Min=0.750。因此A3的实际波动范围并非简单相加，而是由两者的极值组合决定，务必用极值法校验。

2.2 D/E/D1/E1：XY平面占位与引脚投影的刚性边界

D和E代表封装体在X/Y方向的外轮廓尺寸，D1和E1则代表底部热沉焊盘（Exposed Thermal Pad）的尺寸。它们不是“大概尺寸”，而是焊盘布局不可逾越的物理红线：

• D/E：通常为封装体在X/Y方向的最大包络尺寸（Maximum Outline Dimension），单位mm。例如“D: 2.900/3.100 mm, E: 2.900/3.100 mm”表示该QFN为正方形封装，边长允许在2.900～3.100mm之间浮动。这个范围直接决定PCB上器件丝印框（Silkscreen Outline）的绘制方式——丝印必须覆盖Max值（3.100mm），否则贴片机视觉识别会失败；同时丝印内边距必须留足Min值（2.900mm）+安全余量（建议≥0.1mm），否则焊接后塑封体可能压到丝印油墨导致爬锡不良。

• D1/E1：指底部裸露热沉焊盘的尺寸，是散热设计的核心输入。例如“D1: 2.300/2.500 mm, E1: 1.600/1.800 mm”表明热沉焊盘本身存在长宽两个方向的制造公差。注意：D1/E1的Min值才是焊盘设计的下限依据。若按Max值（2.500×1.800）设计焊盘，回流焊时易因锡膏流动导致热沉焊盘边缘溢锡，污染周边引脚；若按Min值（2.300×1.600）设计，则能确保所有批次器件的热沉都能完全覆盖焊盘，保障导热路径连续性。我一般会在Min值基础上统一加0.05mm作为焊盘尺寸（即2.35×1.65mm），既留出锡膏润湿余量，又规避溢锡风险。

2.3 kb/eL/b/L1/L2/L3：引脚焊端几何参数的工艺映射

kb、eL、b、L1、L2、L3等参数全部指向引脚焊端（Terminal Tip）的二维几何特征，它们是焊盘尺寸计算的直接源头：

• kb：引脚焊端宽度（Terminal Width），即引脚在X/Y平面上的横向尺寸。例如“kb: 0.180/0.300 mm”表示引脚宽度可在0.180～0.300mm间变化。焊盘宽度（Pad Width）必须≥kb Max（0.300mm）+ 锡膏延展余量（建议0.05～0.10mm），否则无法形成完整焊点。但也不能过大，否则易桥连。我通常取kb Max + 0.08mm = 0.38mm作为焊盘宽度。

• eL：引脚焊端长度（Terminal Length），即引脚在Y方向的纵向尺寸。例如“eL: 0.250/0.450 mm”。焊盘长度（Pad Length）应≥eL Max + 0.10mm（保证润湿长度），但≤eL Max + 0.20mm（防桥连）。推荐值为eL Max + 0.12mm = 0.57mm。

• b：引脚焊端厚度（Terminal Thickness），即Z向尺寸，单位mm。例如“b: 0.150/0.250 mm”。该值影响锡膏体积需求——b越大，所需锡膏厚度越高。在钢网设计中，若b Min=0.150mm，建议钢网开孔厚度≥0.12mm（按80%填充率反推）。

• L1/L2/L3：分别代表引脚外伸长度（Outer Lead Length）、内伸长度（Inner Lead Length）和引脚总长（Total Lead Length）。其中L1决定焊盘向外延伸距离，L2决定热沉焊盘与引脚焊盘之间的隔离间距。例如某型号“L1: 0.250/0.450 mm, L2: 0.230/0.430 mm”，则引脚焊盘外缘到热沉焊盘外缘的最小净空 = L1 Min − L2 Max = 0.250 − 0.430 = −0.180mm（负值！），说明引脚焊盘必然部分覆盖热沉焊盘边缘——此时必须在PCB上设置阻焊开窗（Solder Mask Opening）完全覆盖整个引脚+热沉区域，否则阻焊桥会阻挡锡膏流动。

3. PCB焊盘设计规范：从尺寸图到Gerber的完整映射链

拿到一份QFN尺寸图，不能直接抄数字进PCB软件。必须经过“参数提取→公差解析→焊盘建模→钢网匹配→阻焊校验”五步闭环，才能输出可量产的焊盘。下面以一款典型32引脚QFN（5×5mm body, 0.5mm pitch）为例，展示从尺寸图到实际焊盘的完整推导过程。

3.1 焊盘尺寸计算：基于JEDEC标准的保守取值法

我们截取该QFN尺寸图中关键参数（单位：mm）：

A0: 0.700/0.800 A1: 0.000/0.050 D: 4.924/5.076 E: 4.924/5.076 D1: 3.100/3.300 E1: 2.800/3.000 kb: 0.200/0.300 eL: 0.374/0.526 b: 0.150/0.250 L1: 0.250/0.450 L2: 0.230/0.430

按JEDEC MO-220标准及量产经验，焊盘尺寸取值逻辑如下：

• 引脚焊盘宽度（Pad Width）= kb Max + 0.08mm = 0.300 + 0.08 =0.38mm
• 引脚焊盘长度（Pad Length）= eL Max + 0.12mm = 0.526 + 0.12 =0.646mm（四舍五入取0.65mm）
• 热沉焊盘尺寸（Thermal Pad）= D1 Min × E1 Min =3.10mm × 2.80mm（不放大，仅微调：3.12×2.82mm）
• 引脚焊盘中心距（Pitch）= 尺寸图未直接给出，但可通过D/E与引脚数反推：5.076mm ÷ (N−1)，N=32 → 实际pitch ≈0.500mm（标准值）
• 热沉焊盘与引脚焊盘间距（Clearance）= L1 Min − L2 Max = 0.250 − 0.430 = −0.180mm → 必须重叠，故热沉焊盘外缘需超出引脚焊盘外缘至少0.10mm

最终确定焊盘参数：

Pin Pad: 0.38mm × 0.65mm, Center-to-Center = 0.500mm Thermal Pad: 3.12mm × 2.82mm, Center-aligned with package Solder Mask Opening for Pin Pads: 0.43mm × 0.70mm (Pad + 0.05mm) Solder Mask Opening for Thermal Pad: 3.22mm × 2.92mm (Pad + 0.10mm)

3.2 钢网开孔设计：锡膏体积的精准控制

QFN焊接成败，70%取决于锡膏量是否恰到好处。过多则桥连、立碑；过少则虚焊、空洞。钢网开孔必须与焊盘、引脚厚度（b）、锡膏颗粒度匹配：

• 引脚焊盘钢网开孔：采用矩形开孔，尺寸 = 焊盘尺寸 × 0.85（面积缩减系数），即 0.38×0.65 × 0.85 =0.323mm × 0.552mm→ 取整为0.32mm × 0.55mm
• 热沉焊盘钢网开孔：必须开网格（Grid Pattern）而非实心，防止回流时气体无法逸出。推荐5×5网格，线宽0.12mm，间隙0.15mm，覆盖率60%。即在3.12×2.82mm区域内，布置25个0.12×0.12mm方孔，中心距0.30mm。
• 钢网厚度：按b Min=0.150mm，目标锡膏厚度=0.12mm（80%填充），选用0.12mm厚激光切割钢网（非蚀刻）

注意：钢网开孔尺寸必须在PCB设计阶段同步定义，并输出至Gerber RS-274X格式的Solder Paste层（GTP/GBP），不能仅靠SMT厂自行解读。

3.3 阻焊与丝印：看不见却致命的两道防线

• 阻焊开窗（Solder Mask Opening）：必须大于焊盘，但不能过大。引脚焊盘阻焊开窗 = 焊盘尺寸 + 0.05mm（单边），即0.43×0.70mm；热沉焊盘阻焊开窗 = 热沉焊盘尺寸 + 0.10mm（单边），即3.22×2.92mm。若阻焊开窗＜焊盘，回流时锡膏被阻焊挤压，易导致引脚侧立（Tombstoning）；若＞焊盘过多，则锡膏铺展失控，桥连风险陡增。

• 丝印框（Silkscreen Outline）：必须按D/E Max值绘制，即5.076×5.076mm正方形框，线宽0.15mm。丝印内边距焊盘≥0.2mm，避免贴片机Mark点识别干扰。热沉焊盘区域禁止绘制丝印，否则回流时油墨碳化污染焊点。

• 热过孔（Thermal Vias）：热沉焊盘下方必须布置≥9个直径0.3mm的镀锡热过孔（Via in Pad），孔中心距0.6mm，呈3×3阵列。过孔必须塞孔并电镀填平（Filled & Capped），否则回流时锡膏被吸入过孔导致热沉虚焊。

4. 常见问题排查：QFN焊接失效的五大根源与现场诊断法

QFN焊接问题往往在回流焊后集中爆发，但根源早在焊盘设计阶段就已埋下。以下是我在多个项目中总结出的最易踩坑的五个点，每条均按“现象→原因→解决”结构给出可立即执行的诊断与修正方案。

4.1 现象：大量引脚虚焊，AOI显示焊点不饱满，X光可见焊料未润湿引脚侧面

原因：焊盘长度（Pad Length）小于eL Max，导致锡膏量不足，引脚侧面无足够焊料爬升。常见于直接套用旧库焊盘、未按当前尺寸图更新。
解决：立即测量实物引脚长度（卡尺测3颗引脚），确认是否≥eL Max；若属实，将焊盘长度统一增加0.10～0.15mm，并重新生成Gerber。同时检查钢网开孔是否同比例缩小——曾有项目因钢网厂误将焊盘尺寸当开孔尺寸，导致锡膏量只剩30%。

4.2 现象：器件中心区域（热沉）大面积空洞，热测试温升超标20℃以上

原因：热沉焊盘尺寸按D1/E1 Max设计（如3.30×3.00mm），导致锡膏铺展过度，中心区域锡膏被挤向四周，回流时气体无法排出。
解决：将热沉焊盘尺寸强制改为D1 Min × E1 Min（3.10×2.80mm），并在其上叠加5×5网格钢网（覆盖率60%）。补做DFM分析，确认热过孔数量≥9且全部塞孔电镀。

4.3 现象：相邻引脚间频繁桥连，尤其在器件四角位置

原因：焊盘宽度（Pad Width）过大 + 阻焊开窗过大。典型错误是Pad Width = kb Max + 0.15mm（超限），且阻焊开窗 = Pad + 0.10mm（双倍放大）。
解决：将焊盘宽度收紧至kb Max + 0.08mm（如0.300+0.08=0.38mm），阻焊开窗同步改为Pad + 0.05mm（0.43mm）。四角引脚可单独微调：将角部焊盘长度减0.05mm（降低锡膏流动性），并增加阻焊坝（Solder Mask Dam）宽度至0.08mm。

4.4 现象：器件立碑（Tombstoning），一侧引脚全焊上，另一侧全部翘起

原因：引脚焊盘中心距（Pitch）与实际器件不一致，或两侧焊盘热容差异过大。常见于用0.4mm pitch库焊盘焊0.5mm pitch器件，或热沉焊盘未开阻焊导致一侧吸热过快。
解决：用高倍显微镜测量实物pitch（卡尺精度不够），确认是否为标准0.5mm；若确认，检查热沉焊盘阻焊开窗是否完整——曾有项目因热沉区域丝印误盖阻焊，导致该侧焊盘被油墨覆盖，锡膏无法熔融，引发严重力矩失衡。

4.5 现象：回流后器件共面性差，部分引脚悬空，ICT测试接触不良

原因：A1参数被忽略，焊盘未考虑引脚共面度公差。当A1实测达0.045mm时，若焊盘平面未做阶梯补偿，最高引脚与最低引脚落差达45μm，超出常规ICT探针行程。
解决：在PCB顶层铜皮上，对QFN区域做0.03mm局部铜厚补偿（Copper Thickness Compensation），即在焊盘下方增加一层0.03mm厚铜皮，使所有引脚在回流时受力更均衡。此操作需在Gerber前与板厂确认可行性。

5. 设计验收与答辩通关：用三张表锁定交付质量

QFN封装设计是否合格，不能靠“看起来差不多”来判断。我带过的每个项目，最终交付前必过三张表：参数映射表、焊盘比对表、DFM报告表。这三张表既是给导师/客户看的交付物，也是你答辩时最硬的底气——当被问“为什么焊盘是0.38×0.65？”时，你能立刻翻出表1第7行指出kb Max=0.300mm，再翻表2展示实测引脚宽度0.295mm，最后用表3证明该焊盘通过了所有SMT厂DFM规则。下面给出三张表的标准模板与填写要点。

5.1 参数映射表：尺寸图到PCB设计的逐项溯源

提示：此表必须与尺寸图PDF打印件钉在一起，每行右侧空白处手写“已核对”并签名。答辩时导师若质疑某参数，你可当场翻开原始尺寸图指给他看。

5.2 焊盘比对表：实物测量与设计值的毫米级校验

在PCB打样前，务必用高倍显微镜（≥20X）实测3颗同型号QFN器件的以下参数，并填入下表。实测值必须全部落在尺寸图Min/Max范围内，且设计值必须覆盖实测极值：

注意：若实测D1 Min=3.175mm > 设计焊盘3.12mm，则热沉无法完全覆盖焊盘，必须立刻修改焊盘为3.18mm。此表是答辩时证明你“真测过实物”的铁证。

5.3 DFM报告表：SMT厂认可的工艺合规性声明

将PCB Gerber文件提交至嘉立创/捷配等支持DFM分析的平台，导出标准DFM报告（.pdf），从中提取关键项填入下表。所有“Fail”项必须100%修复，否则贴片厂拒收：

提示：DFM报告必须是彩色PDF，重点页（Fail页）用荧光笔标出，并附板厂书面回复邮件截图。答辩PPT中放这张表，比讲十页原理更有说服力。

从那以后我每次交付QFN设计，都强制走一遍这三张表：先填参数映射表确保源头正确，再拿显微镜实测三颗芯片填比对表堵住“纸上谈兵”漏洞，最后用DFM报告把工艺风险扫清。三张表齐备，图纸才算真正完成——不是画完了，而是能焊上了。希望帮到你。

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