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干嵌入式或者偏底层的 C 开发，没有人不认识__align(4)。但见过和用对之间，其实隔着一条挺宽的沟。我刚接触这个关键字的时候，也一度以为它就是"让结构体紧凑一点"的咒语，直到在调试 DMA 数据搬运时因为缓冲区地址没对齐栽了跟头，才开始认真研究内存对齐背后的机制。今天这篇就围绕__align(4)这个编译器扩展指令展开，说清楚它到底在改什么、CPU 和编译器为什么要管对齐、以及实际项目中哪些地方必须显式写出来。适合嵌入式开发、单片机工程师，以及想彻底搞懂结构体对齐、C 底层内存布局的读者。

1. 内存对齐到底在解决什么问题

1.1 CPU 不是按字节读内存的

内存对齐的根源，得从 CPU 访问内存的方式说起。很多人以为 CPU 想读哪个字节就读哪个字节，实际上绝大多数 CPU 是按"字"来读取的。32 位处理器的总线宽度是 4 字节，64 位处理器是 8 字节，一次内存访问拿回一个完整的字长。这就好比去快递柜取件：一个柜门一个格子，格子大小固定。如果你的包裹完整落在一个格子里，开一次门就能拿走；如果包裹斜着放，占到了相邻两个格子，那就得开两次门，再把两半拼起来。

放到内存里，情况类似。一个 4 字节的 int 变量，如果它的起始地址落在 4 的整数倍上，比如 0x00、0x04、0x08，那么 CPU 一次读 4 字节刚好完整取到它，这叫对齐访问。如果它的起始地址是 0x02，那么这次读取会跨过两个总线周期，CPU 要先读 0x00~0x03，再读 0x04~0x07，然后把中间的 0x02~0x05 拼回来。硬件要多干活，这是性能损失；运气再差一点，碰到不支持非对齐访问的体系结构，比如某些 ARM 核，CPU 会直接触发异常，表现为程序跑飞、HardFault、复位。

一个非常有用的二进制特性：4 字节对齐的地址，低 2 位一定是 00。因为 4 的倍数在二进制表示里末两位永远为零。同样，8 字节对齐的地址低 3 位是 000，16 字节对齐低 4 位是 0000。这个特性在实际工程里经常被用来"偷"指针的低位当标志位用，很多内核代码就是这么干的。

1.2 编译器默认的对齐规则

C 语言标准没有严格规定变量怎么对齐，实际行为由平台 ABI 决定。不过在嵌入式桌面平台上，规则基本是这么几条：char 的对齐系数是 1，short 是 2，int 和 float 是 4，double 在 32 位 ARM 上默认是 8，在 64 位平台上通常也是 8；每个变量分配的起始地址必须是它自身对齐系数的整数倍。

结构体的规则稍微复杂一点。结构体的整体对齐系数等于它所有成员里最大的对齐系数，而且结构体的 sizeof 结果必须是这个对齐系数的整数倍。为了满足这两个要求，编译器会在成员之间和结构体尾部插入填充字节，也就是 padding。

举一个最常见的例子：

struct demo { char c; int i; };

c 占据偏移 0，i 必须从 4 的倍数开始，所以编译器在 c 后面塞 3 个填充字节，i 落在偏移 4，结构体总大小是 8。很多人第一次算出来是 5，觉得编译器是不是疯了，其实这正是对齐规则在起作用。

成员顺序同样影响大小。char, char, int这样排，两个 char 连续占偏移 0 和 1，int 从 4 开始，总大小 8；而char, int, char这样排，int 前要填充 3 字节，尾部还要补 3 字节，总大小变成 12。同样是三个成员，只是顺序不同，内存占用差了 4 个字节。这是结构体设计中最容易出效果的一个优化点。

2. __align(4) 的本质与使用语法

2.1 它改的是编译器对地址的安排

__align(4)是编译器提供的扩展指令，作用是明确告诉编译器：给我把这个变量、这个结构体类型放在 4 字节边界上。注意，它不是一个运行时函数，不改变内存分配器的行为，它影响的是编译阶段对变量地址的分配、结构体成员偏移的计算以及 sizeof 的大小。

它和默认对齐有什么区别？对 int、uint32_t 这类本身对齐系数就是 4 的类型来说，加不加__align(4)结果一样，编译器本来就会把变量放到 4 的倍数地址上。它的价值出现在两种场景。

第一种，把对齐系数调高。比如你定义一个uint8_t buffer[256]，编译器默认只会按 1 字节对齐这个数组的首地址，因为数组的对齐系数由元素类型决定。但如果你后面要拿这块缓冲区去做 DMA 搬运，而 DMA 控制器要求缓冲区首地址必须是 4 字节甚至更高对齐，那就必须显式写成：

__align(4) uint8_t buffer[256];

这样数组的首地址低 2 位强制为 00，满足外设要求。这是__align(4)使用频率最高的场景。

第二种，把结构体的整体对齐系数调到你需要的值。比如某个场景里你希望结构体按 4 对齐而不是按默认的 8 对齐，可以在类型定义时加上__align(4)。此时需要注意的是，编译器在安排内部成员时，会按照这个新的对齐要求重新计算偏移，成员的偏移和结构体的总大小都可能发生明显变化。不同编译器对"降低对齐"的细节处理并不完全一致，这一点一定要在目标平台实测验证。

2.2 不同编译器下的等效写法

严格来说，__align(4)并不是 C 标准语法，它是 ARM 编译器、Keil MDK 环境下提供的关键字。换到其他编译器，写法完全不同。

结构体类型定义时写法也有对应差异：

typedef __align(4) struct { // ... } msg_a; // ARMCC 风格 typedef struct { // ... } __attribute__((aligned(4))) msg_b; // GCC 风格

需要特别提醒一个细节：GCC 的aligned(4)语义是"保证对齐至少为 4 字节"，它只能把对齐要求提高，不能把一个自然对齐已经是 8 字节的东西按 4 字节来放。也就是说，如果结构体里含 double，你写aligned(4)并不会让结构体整体变成 4 字节对齐，编译器依然会按 8 字节处理，因为 8 比 4 更严格，aligned(4) 实际上是一个空操作。ARMCC 的__align(4)在设计上则可以指定对齐值为 4，行为和 GCC 有差异。所以迁移代码时千万不要以为换个关键字就万事大吉，至少要在目标平台上重新打印sizeof和成员偏移确认一下。

C11 的_Alignas是对跨平台最友好的方案，但要求编译器支持 C11 标准。对老式单片机工程，编译器可能还停留在 C99，这时候就只能按平台关键字来写。

3. 实操场景：什么情况下必须自己指定对齐

3.1 DMA 缓冲区和外设驱动

DMA 是__align(4)用得最多的场景，没有之一。很多外设控制器，比如串口 DMA、ADC 采样缓冲、以太网描述符，都要求内存缓冲区首地址满足一定的对齐。原因有两层：一是外设本身可能按字为单位写入内存，地址不对齐会导致数据写到错误的字节位置；二是 DMA 传输如果请求一个非对齐的起始地址，总线会做额外的拆分操作，轻则性能打折，重则直接传输错误。

实际的写法一般像这样：

__align(4) static uint8_t uart_rx_buf[128]; __align(4) static uint8_t uart_tx_buf[128];

在定义上，uint8_t数组默认只按 1 字节对齐，你不写__align(4)，编译器可以把它放在任何地址上。如果你的代码里假设它一定对齐，那就埋了一颗雷。这颗雷在 x86 上可能一辈子不炸，因为 x86 容忍非对齐访问，只是慢一点；但换到 ARM 平台，某次运行到未对齐的地址，直接 HardFault。

另外，如果你的缓冲区是通过malloc分配的，需要注意：桌面 Linux 的 malloc 一般会返回 16 字节对齐的地址，嵌入式 RTOS 的堆则不一定。想保证分配出的内存带特定对齐，不要靠 malloc，要用 C11 的aligned_alloc或者 POSIX 的posix_memalign这类带对齐参数的内存分配函数。编译器关键字只对静态和栈上的变量生效，处理不了堆内存。这个边界经常被搞混。

3.2 结构体对齐导致的大小陷阱

另一个高频坑在协议解析。假设你定义了一个报文头结构体：

typedef struct { uint8_t type; uint32_t len; uint8_t crc; } header_t;

按照默认对齐，type 在偏移 0，len 在偏移 4（前面有 3 字节填充），crc 在偏移 8，结构体大小是 12。如果协议本身定义的是 9 字节紧凑格式，直接拿sizeof(header_t)去当长度用，或者直接把收到的字节流强转成header_t*，数据会完全错位。

处理这个问题有几种思路，但思路之间有天壤之别。

第一种，把结构体加上__packed或者#pragma pack(1)，让它按 1 字节对齐，这样 sizeof 就是 9，和协议对得上。代价是内部成员可能不再处于对齐地址上，ARM 上访问这类成员时要小心，直接用指针解引用轻则变慢，重则触发异常。我的建议是，packed 结构体配合memcpy使用：把数据从缓冲区拷到本地 struct 变量，再用本地变量访问，或者用memcpy把某个字段单独拷出来。访问次数不多时，这是最稳的做法。

第二种，如果你所在平台对性能敏感、访问又很频繁，那就不要用 packed，而是用__align(4)或自然对齐设计结构体，保证每个字段都在对齐地址上。然后发送和接收两端约定好按相同的结构体定义交互，只需要传输结构体的二进制内容，配合sizeof统一计算长度即可。网络协议一般不这么做，但在板内、板间紧耦合通信里很常见。

第三种，也是通用性最强的，手写打包和解包函数，显式控制每个字节放到哪个偏移，不依赖结构体布局。做跨芯片、跨编译器通信时我强烈推荐这种方式，它消灭了 padding 这个不确定因素。

这三个思路侧重点完全不同，核心都是同一个问题：结构体在内存里的实际布局到底是多少，你要么让协议适配布局，要么让布局适配协议。

把__align(4)和结构体布局结合起来的典型例子，可以看下面这个对比。假设一个结构体包含 double：

typedef struct { char flag; double value; uint8_t tail; } __align(4) sample_t;

在 ARMCC 环境下，加__align(4)后，成员会按 4 字节对齐重新安排：flag 在偏移 0，value 在偏移 4，tail 在偏移 12，结构体大小 16。如果不加，double 按 8 字节对齐，flag 后面要填 7 字节，value 在偏移 8，tail 在偏移 16，总大小 24。两种布局差了 8 个字节，而且成员偏移完全不同。如果你的代码里有按固定偏移解析的逻辑，这个差异必须搞清楚。

顺带一提，尽量用成员重排而不是对齐指令来压缩结构体大小。把小的成员放前、大的成员放后，往往不用任何特殊关键字就能省下 padding。上面那个例子如果不含 double，而是char, uint32_t, char，重排成char, char, uint32_t就能把 sizeof 从 12 降到 8。这是成本最低的优化。

4. 避免踩坑的检查手段与经验

4.1 在代码里验证对齐是否生效

__align(4)写了，不验证就当它生效，这是很多 bug 的温床。编译器可能会因为优化选项、结构体嵌套、位域等原因，给出和你预期不一样的布局。验证手段其实很简单，三招就够。

第一，用offsetof检查成员偏移。它是标准定义在stddef.h里的宏，不用创建结构体变量就能拿到某个成员的偏移量：

#include <stddef.h> printf("offsetof(len) = %zu\n", offsetof(header_t, len));

第二，用_Alignof或__alignof__来取类型的对齐要求，核对它是不是 4。GCC 和 ARMCC 都支持__alignof__，C11 标准写法是_Alignof。

第三，在运行时直接对变量地址取模。比如：

if (((uintptr_t)&buffer & 0x3) != 0) { // 地址没有 4 字节对齐 }

因为 4 字节对齐地址的低 2 位一定是 0，所以地址按位与 0x3 应该等于 0。这个判断不需要除法，效率很高。

更严肃的工程做法是在编译期断言。如果结构体长度或者对齐要求不满足，直接编译报错，而不是等到运行时才崩：

_Static_assert(sizeof(header_t) == 12, "header_t size changed unexpectedly!"); _Static_assert(offsetof(header_t, len) == 4, "header_t len offset changed!");

这种断言在协议栈、驱动代码里非常有用，任何人改了结构体成员顺序或加了字段，编译立刻暴露问题。

4.2 非对齐访问的经典翻车现场

最经典的翻车代码，长这样：

uint8_t raw_buf[64]; // 从串口/网口收到的一帧数据填满 raw_buf header_t *hdr = (header_t *)raw_buf; // 强转 uint32_t len = hdr->len; // 非对齐读

这段代码的问题在于，raw_buf是一个uint8_t数组，编译器只会按 1 字节对齐它。当它的实际地址不是 4 的倍数时，hdr->len这个 4 字节整型就落在非对齐地址上。编译器看到你已经做了强转，会认为目标地址没问题，直接生成一次普通的内存读指令，运行到 ARM 上就可能异常。

正确的做法有两种。如果缓冲区定义在你的掌控范围内，直接在定义处加__align(4)：

__align(4) uint8_t raw_buf[64];

这样缓冲区首地址本身就是 4 字节对齐的，只要结构体内部布局正确，整个强转是安全的。但如果缓冲区是从外部传入的、由 IO 层分配的，你没法控制它的对齐，那就别强转，老老实实用memcpy：

header_t hdr; memcpy(&hdr, raw_buf, sizeof(hdr)); uint32_t len = hdr.len;

只读单个字段也可以这样：

uint32_t len; memcpy(&len, raw_buf + 4, sizeof(len));

个人经验是，协议解析这类场景里，只要数据来源不是自己完全掌控的静态定义，一律先 memcpy 再访问，省下来的 CPU 周期远不够赔一次半夜查 bug 的时间。编译器对 memcpy 有大量优化，小尺寸拷贝常会被优化成几条加载指令，性能并没有想象中那么差。

GCC 还提供了一个编译警告选项-Wcast-align，这类强转会触发警告。在嵌入式工程里建议打开它。虽然有警告不代表一定会出错，但至少可以帮你快速定位到所有可疑强转。

4.3 位域和 packed 混用要格外小心

位域的对齐行为在各个平台上非常不一致。ARM 编译器有自己的位域分配规则，一般是按存储单元来连续分配，但到底是从低地址开始还是高地址开始、位域是否能跨越单元边界，都由 ABI 和编译器版本决定。所以涉及位域的时候，不要拿着你在 x86 上测出来的结果去推算 ARM 上的布局，几乎必翻车。

把__align(4)和__packed同时用在一个结构体上，是一个语义上很拧巴的操作：一边要求压缩到 1 字节对齐，一边要求 4 字节对齐，两者矛盾。不同编译器对冲突语义的处理方式不同，有的以 packed 为主，有的直接忽略其中一个，结果很难预测。我的建议是别这么写。如果确实需要结构体外层按 4 对齐、内部字段紧凑，那就在字段之间手动添加填充字节，用显式布局替代编译器魔法，反而可控得多。

4.4 快速排查清单

最后整理一份我自己排查内存对齐问题时的清单，按优先级排列：

• 程序移植到 ARM 后出现 HardFault 或总线异常，第一反应检查所有指针强转和缓冲区定义，大概率是未对齐访问。
• 结构体sizeof和预期不一致，先打印成员偏移，再检查是否有 padding 以及成员顺序是否合理。
• DMA 数据出现错位、字节顺序不对，检查缓冲区地址低 2 位是否为 0，同时确认外设配置的地址和你实际传入的地址一致。
• 结构体数组遍历时索引错位，注意 packed 结构体的 sizeof 不再是自然对齐的倍数，数组元素之间可能不再对齐，索引计算和访问都要小心。
• 需要与硬件寄存器映射结构体配合时，给结构体加__align(4)时先验证成员偏移，千万别拍脑袋，用编译期断言锁住布局。

这些坑我基本都踩过一遍。尤其是强转解析缓冲区那个问题，表面看是偶发崩溃，实际是每次启动时缓冲区地址碰巧不同，运气好就不崩，运气差就在某个分支上崩，定位起来极其折磨。后来我养成了一个习惯：任何跨层传递的缓冲区，能对齐就显式对齐，不能对齐就 memcpy，永远不要在不可控的地址上做非对齐强转。

__align(4)本身不复杂，复杂的是它牵出的内存布局、硬件行为、跨编译器差异这一整条链路。把这一块彻底搞清楚，对排查底层 bug 的帮助是立竿见影的。我自己在代码里还习惯把对齐检查和结构体布局断言写成一个独立头文件，每次编译都跑一遍，算是给后续维护的人省了不少事。如果你之前只是看着别人写__align(4)就跟着抄，希望这篇能帮你把背后的机制补完整。