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如果你第一次用单片机读一个电位器，可能会觉得ADC（模数转换器）是个再简单不过的活：供电、接引脚、读寄存器，完事。但当代码烧进去、串口打开，你会看到采样值一会儿543，一会儿545，一会儿又蹦到550，那种"明明接线没错但数据不稳"的挫败感，几乎每个做嵌入式的人都经历过。

ADC转换这件事，真正值得研究的部分远不止"读那个数字"。采样原理决定了你该用多大采样时间，取平均的方式决定了你是在消除噪声还是掩盖信号失真，而精度则涉及从参考电压到PCB布线的一整条链路。这篇内容是我做多个采集项目之后关于ADC的汇总笔记，覆盖采样原理、软件滤波、精度分析、过采样设计等几个核心环节，适合刚接触单片机的初学者，也想给正在调不稳定采样的老手一个排查方向。

1. 采样过程里的三个隐形环节：采样保持、量化、编码

很多教程把ADC描述成"输入电压，输出数字"，一句话带过。但实际完成一次转换，芯片内部经历的是三个完全不同的环节——采样保持、量化、编码。不理解这三个环节，你后面排查采样问题时会少很多思路。

1.1 采样保持：电容充电那点事

ADC内部几乎都有一个采样电容。转换开始前，芯片会用一个模拟开关把输入引脚和采样电容连接起来，电容开始充电，直到电容电压追上外部输入电压。这个充电过程需要时间，也就是手册里常说的采样时间（Sampling Time）或采样保持时间。

这里有一个在外行看来极其反直觉的结论：ADC的输入引脚不能看成"高阻无损"的。在采样瞬间，它是一个挂了几 pF 到几十 pF 电容的开关，开关闭合时，外部信号源要给这个电容快速充电。如果你的信号源阻抗很高，比如直接接了一个100kΩ的大电阻网络，RC 充电时间就会变长。采样时间设置不够，电容还没充到最终电压，开关就断开了，读数偏低而且不稳定。

你可以把采样想象成用一个小水杯去河里舀水：你只有0.5秒舀水时间，水杯刚沉下去就提起来，舀到的水量自然随你怎么拿杯子而变化。信号源阻抗就是"河水到杯口之间的通道长度"，通道太长，水来不及流满。

1.2 量化：连续电压变成"阶梯"

采样保持之后，模拟电压还要被量化成离散层级。一个 N 位 ADC，满量程被分成 2^N 份。假设参考电压是5V，12位ADC就有4096个码值，每一个码值对应的电压是：

5V / 4096 ≈ 1.22 mV

这就是 LSB（Least Significant Bit，最低有效位）的电压含义。量化过程不可避免会引入一个舍入误差，叫量化误差，范围是 ±0.5 LSB。这个误差是原理性存在的，你换再贵的芯片都有，只不过位数越高，LSB对应的电压越小，量化误差对人的观感就越不明显。

1.3 编码：从码值换算成真实电压

量化完成之后，码值会按一定编码格式输出，通常是直接二进制或二进制补码。把码值换回电压的标准公式是：

V_in = code × V_ref / 2^N

这里最关键的是 V_ref。它决定了整个转换结果的比例尺。如果参考电压本身漂了，就算ADC内部完美无缺，读出的码值对应真实电压也是错的。所以做高精度测量的项目，参考电压的重要性经常比ADC芯片本身还高。

另外，奈奎斯特采样定理在这里也有一个容易被忽视的实践含义。很多人以为"采样率至少是信号频率的两倍就行"，但这只是在信号重建意义上，实际做测量时，如果你采集的信号频率接近采样率的一半，会出现混叠，原本低频的信号被折叠成另一个频率，测出来的数值完全失真。所以ADC前级加一个抗混叠滤波器，或者至少加一阶RC低通，是稳定采样的基础动作。

2. 采样值跳动的真正来源：噪声不是一种，是四种

串口打印的采样值上下跳动，大部分人的第一反应是"软件滤波没做好"。但我现在的习惯是反过来：先搞清楚噪声从哪来，再决定用哪种滤波方式。因为滤波只是手段，治标不治本；而且不是所有噪声都适合用同一类滤波器处理。

2.1 四种噪声的鉴别与对策

做ADC采样项目时，我遇到过的基本上就四类干扰：

识别噪声类型有一个很实用的办法：把ADC输入接到一个稳定的直流电压源，连续采500个点，画出码值直方图。如果码值围绕一个中心点对称分布，像一座小山，那主要是白噪声，取平均能有效提高精度；如果码值整体在一个区间来回漂移而没有明显中心，那大概率是参考电压或者电源纹波问题；如果偶尔出现一个离群值，其他都是平的，那就是脉冲干扰，中值滤波才是对症的药。

2.2 采样时间不足引发的"假噪声"

还有一类跳动，根源不在噪声，而在采样时间。我遇到过一个问题：用某款Cortex-M内核的MCU读取一个高阻分压网络时，读数一直比理论值低十几毫伏，而且跳得很欢。后来翻参考手册才发现，ADC采样时间寄存器被设成了最小值1.5周期，对高阻源来说远不够。

排查方法很简单：把采样时间逐步加大，比如从1.5周期加到239.5周期，观察读数变化。如果读数稳定地偏移了一个方向，最终趋于某个值不再变化，那基本就是采样时间不够。这个特性和随机噪声不同——随机噪声是左右跳，充电不足是稳定偏低。这个区分经验很重要，因为我见过太多人把采样时间问题当成白噪声，疯狂叠均值滤波，结果读数稳定了，但依然偏着一大截。

2.3 采样率设置的另一层影响

采样率太高时，相邻采样之间电容没完全放电，或者上一次转换的残留电荷影响下一次结果，也可能造成读数不稳。所以某些MCU的ADC推荐先做一次校准（比如内部注入校准），再开始正常转换。不同系列的校准方式不一样，有的上电自动做，有的需要在初始化代码里显式触发，这个一定要看对应手册，别想当然。

3. 取平均这步操作，90%的人用错了场景

"采样值跳，取平均就好了"，这句话在大部分入门教程里都成立，但在实际项目中，取平均是最容易被用坏的招。我用过均值、中值、去极值平均、滑动平均，每种方法都有自己的适用边界，用错了场景不但白费算力，还会引入新问题。

3.1 均值滤波：只对白噪声有效

均值滤波的数学基础是：白噪声的均值为0，采N次求平均，信噪比能提升√N倍。理论上采样次数翻4倍，有效分辨率提升1位。但均值滤波有一个隐含前提——噪声是随机的、零均值的。如果你的干扰是有规律的纹波（比如50Hz工频纹波叠加到直流信号上），而你恰好平均了半个周期的采样点，结果反而可能落在波峰和波谷之间某个诡异位置，并不比单次采样更接近真值。

一个容易被忽略的点是：均值窗口越大，系统响应越慢。在温度、压力这类缓变信号上，慢一点问题不大；但在需要用ADC监听过流和保护电机的场景，几百毫秒的滤波延迟代价极其昂贵。我见过一个电机驱动保护板，取平均窗口叠到128次，结果过流烧了MOS管，滤波延迟有一半责任。

3.2 中值滤波：对付毛刺的正确工具

如果噪声表现为偶发毛刺——比如附近有个继电器吸合，或者电机启动瞬间产生带状干扰——均值滤波会把毛刺平均进结果里，读数依然被拉偏。这时候中值滤波更合理：取N个采样值排序，取中间值。它的逻辑是，毛刺作为少数异常值会被排序挤到两端，中间值天然免疫。

我习惯的毛刺处理方案是：先取5到7个样本做中值滤波，再对中值的结果做一次轻量平均。中值去毛刺，平均压白噪，各干各的活。

3.3 去极值平均：工程上最常用的折中

取N个采样值，去掉一个最大值和一个最小值，然后对剩下N-2个值求平均，这种方法叫去极值平均（也叫掐头去尾平均），在工业采集端特别常见。N取5～7时，它能防单个毛刺，又能保留平均的降噪能力，计算量也不大。

用这个方法时有一个小坑：如果毛刺连续出现，比如持续5个采样点都受到干扰，掐头去尾就挡不住了。所以它更适合"偶发毛刺"的场景。连续干扰的场合，必须回到硬件滤波上做文章。

3.4 滑动平均：动态信号的正确姿势

对于一直在变化的信号，一次性采N个点取平均的方式会让输出变得台阶化——信号变了，平均结果要跳好几拍才追得上。滑动平均（移动平均）用固定长度的窗口，每来一个新采样，窗口滑动一次，算一次平均，输出是连续平滑的。这是处理动态信号最常用的软件滤波方式。

滑动窗口长度的选择要权衡：窗口太长，信号细节被抹平；窗口太短，滤波效果不明显。我的经验是从窗口长度等于你关心的最小时间尺度对应的周期数开始调。比如你的有效信号频率是100Hz，采样率是10kHz，一个信号周期内约100个采样点，窗口设50到100就比较合适。窗口设成这个信号周期的1到2倍，既能平滑又能保持动态响应。

3.5 滤波的代价，必须说清楚

软件滤波的本质是拿时间换精度，任何滤波器都在降低系统的带宽。对直流或低频测量来说这无所谓，但在需要捕捉快速变化的场景，滤波就成了绊脚石。更好的做法往往是：硬件先做一阶或二阶低通RC滤波，把高频噪声在模拟域压下去，软件只做轻量的平滑。这样既照顾了动态响应，又不会让噪声进到ADC里。

4. 分辨率不等于精度：ENOB、INL/DNL与误差校正

"这个是12位的ADC，精度应该不差吧"——这句话是很多采样精度项目的起点，也是不少设计翻车的起点。分辨率是ADC能输出多少个码值，精度是这些码值和真实电压之间的符合程度，两者完全不是一回事。

4.1 ENOB：有效位数才是你真正拿到的

一颗标称12位的ADC，因为内部噪声的存在，实际可靠的分辨率往往到不了12位。手册上会给出ENOB（Effective Number of Bits，有效位数），比如某芯片的ENOB是10.5位。这意味着你从12位码值里能提取到的真实信息，折合下来和一颗10.5位的理想ADC差不多。多出来的那1.5位，主要是噪声。

ENOB和信噪比（SNR）之间的关系是：

ENOB = (SNR - 1.76) / 6.02

其中SNR单位是dB。换句话说，ADC内部电路噪声越大，SNR越低，ENOB越瘪，你从采样值里榨取的真实精度就越有限。所以选ADC芯片，不能只看位数，ENOB才是衡量实际精度的硬指标。

4.2 INL和DNL：尺子刻度的歪斜

INL（积分非线性）和DNL（微分非线性）是描述ADC静态精度的两个关键参数。打个比方，理想ADC是一把刻度绝对均匀的尺子，INL就是整把尺子的刻度相对于标准位置整体歪了多少，DNL就是某两格之间的宽度比其他格宽或窄了多少。

DNL如果超过1 LSB，说明某些码值是跳过的——你输入电压连续变化，输出的码值却缺了一段，这叫丢码（Missing Code）。在伺服控制、测量仪表这类对单调性有要求的场景，丢码是很严重的问题。

处理INL/DNL误差的方法是查表校正：在实验室里用高精度电压源给ADC输入一系列已知电压，记录码值，建立码值到真实电压的修正表。现场校正的成本比较高，但做测量仪器时几乎必做。

4.3 失调和增益误差：两点就能校准

比INL/DNL更常见的误差是失调误差（Offset Error）和增益误差（Gain Error）。失调误差相当于一条线的截距不对，输入0V时输出不是0，而是偏了几个码；增益误差相当于斜率不对，输入满量程时输出不是4095，而是偏出或偏少。

这两类误差是线性的，用两点校准就能修正：分别测量最低点和最高点的真实电压与ADC码值，然后线性插值修正整条曲线。实操上，最常见的校零方法是把ADC输入接到GND，采集的值作为零点偏移，以后每个采样值都减掉这个偏移量。增益校准则需要一个精准的参考电压源，通常用TL431或更高精度的基准，施加一个接近满量程的电压，计算出增益系数。

要注意的是：失调和增益误差本身会随温度漂移，校准在某一个温度下完成，在另一个温度点多少会跑偏。严格要求温度稳定性的设计，要么选低漂移的ADC，要么定期复校。

4.4 参考电压：最容易被忽略的精度大头

一个12位ADC，参考电压是5V，那么1个LSB对应约1.22mV。如果参考电压本身波动了5mV，相当于是4个LSB的系统误差——比你辛辛苦苦调试的所有滤波都大。但很多人设计的ADC电路里，参考电压就是直接从3.3V电源拉过来的，而这个3.3V可能同时给WiFi模块、电机驱动、数码管供电，纹波大得能当信号看。

我做大电流产品的惯性做法是：参考电压脚单独走线，加一个RC滤波器或者直接用独立基准芯片供电，至少要保证参考电压的噪声远小于LSB电压。这一点在做高精度测量时优先级极高，它的重要性排在滤波算法之前。

5. 用"硬件姿态"换稳定读数：PCB、参考电压与采样时间

软件滤波再强，也救不了毛躁的硬件设计。这个道理我是被一次次的返工教育出来的。反过来说，只要硬件的底子打好，软件上的滤波代码甚至可以砍掉一大半。

5.1 PCB布局：模拟数字别打架

ADC输入引脚是模拟信号，但MCU内部和周围全是数字信号。数字信号翻转瞬间会产生较大的电流突变，通过地线和电源平面耦合到模拟输入上。所以常规做法是：模拟地（AGND）和数字地（DGND）在PCB上分区，最后在ADC芯片下方或某个单点汇合，避免数字地电流穿过模拟区。

参考电压的走线要尽量短粗，旁路电容（通常100nF+10μF组合）要尽量靠近ADC的Vref引脚。输入信号走线远离时钟线、PWM线和开关电源的走线。如果空间允许，采样输入在进入MCU之前加一个RC低通，时间常数按信号频率设计，能滤掉相当一部分高频噪声。

5.2 输入阻抗与采样时间的匹配计算

设置ADC采样时间，不能靠猜。核心依据是外部信号源阻抗和内部采样电容构成的RC网络。一个粗略的准则是：源阻抗每增加10kΩ，采样时间至少增加一倍。更准确的做法是查手册里的ADC输入等效电路，算RC充电到多少位精度需要多长时间。

工程上有一个简单公式做估算：

t_sample > (R_source + R_internal) × C_sample × ln(2^N / 0.5)

某个12位ADC内部R_internal约1kΩ，C_sample约4pF，如果外部源阻抗10kΩ，总电阻约11kΩ，算出来需要的采样时间约为：

11kΩ × 4pF × ln(8192) ≈ 4.4e-8 × 9 ≈ 396ns

这只是理论下限，实际还要留2到3倍裕量。很多MCU的采样时间是可配置的，宁可多给别少给。

5.3 采样时间设置的实用经验

我调ADC代码时，基本流程是：先用手册推荐的最大采样时间跑一遍，确保读数稳准，然后逐步减小采样时间，观察读数是否还稳定。如果某个采样时间档位下读数出现明显偏移或跳动加剧，就往回退一档。这个过程只需要十几分钟，能帮你避掉很多"为什么读数偏低"的玄学问题。

另外，ADC在连续转换模式和单次转换模式下的稳定度也不同。连续模式下每个采样之间可能受到数字总线的规律性干扰；单次触发模式下时序可控，Web应用、电池检测这类对稳定度要求高的场景建议用定时器触发采样，留足采样保持时间。定时器触发的另一个好处是采样间隔精确，后面做FFT或数字滤波时，频率计算才准确。

5.4 抗混叠RC的工程取值

如果被测信号本身是慢变信号，但PCB环境里高频干扰比较多，可以在ADC输入前加一阶RC低通，截止频率大约按：

f_c = 1 / (2πRC)

取R=1kΩ、C=100nF时，f_c约为1.6kHz。如果你的信号变化频率只有几十Hz，这个滤波绰绰有余；但如果你要测的是一个几十kHz的动态信号，这样取值会把信号本身也衰减掉。所以RC参数必须结合有效信号带宽设计——这也是为什么很多系统要区分"有效信号"和"噪声"的频段，不能一刀切。

6. 过采样能不能把12位变成16位？原理与代价

"用软件把12位ADC提升到16位精度"——凡是玩过几天ADC的人，应该都听过这种说法。它确实有数学基础，也确实有严格的适用条件，但很多人只记住了前半句，忽略了后半句，最后得出的数据自欺欺人。

6.1 过采样的数学原理

过采样的核心思想是：如果噪声是白噪声，采样N次求平均，信噪比可以提高√N倍。而ADC每提高1位有效分辨率，需要信噪比提升6dB，也就是电压比值大约提升2倍。所以：

√N = 2，即 N = 4

这意味着，每提高1位有效分辨率，需要过采样4倍；从12位提升到16位，需要过采样256倍。

这套理论的成立前提有三个：第一，噪声必须是白噪声，均值为零；第二，噪声幅度必须比0.5个LSB大，否则噪声不足以随机跨越量化台阶；第三，信号本身在采样期间是稳定的，没有随时间大幅变化。最后一个条件尤其重要——如果你采的本身是个快速变化的信号，过采样平均下来，得到的是信号在时间窗口内的平均值，而不是瞬时值，高速信号会被严重抹平。

6.2 我实测过采样的一次经历

我在某个项目中用12位ADC做高精度温度采集，目标是想把温度分辨率从0.1℃推到0.02℃。理论计算需要的过采样率约是4的3次方到4次方倍，也就是64到256倍。代码写起来很简单，256个采样点求平均，也就几百行代码的事。但实测下来，有效分辨率提升明显没有理论那么干净。

排查下来原因有两个：一是电路板上的噪声不完全符合白噪声模型，有周期性纹波成分，平均只能抑制随机部分；二是参考电压本身有低频漂移，平均窗口越长，漂移误差反而被完整地包含进结果里。后来我加了硬件二级滤波，换了个低漂移基准，过采样才真正"兑现"了它的理论效果。

6.3 过采样的代价与适用边界

过采样不是免费的。每提高1位，转换时间至少翻4倍，功耗跟着涨，CPU占用也涨。在电池供电的产品里，这种代价往往比省一颗高精度ADC芯片更不划算。

适用场景是低频缓变信号，比如温度、压力、电池电压监测。不适用的场景是音频采样、动态电流波形这类高速信号——那里有专门的Delta-Sigma ADC在做这件事，本质上也是一种过采样架构，但它配合了噪声整形滤波器，把噪声推向更高频段再滤除，效果比简单平均好得多。

6.4 如果你决定用过采样，这些细节别漏

代码实现时要注意：采样不能全部集中在一次转换里，最好均匀分布在定时器周期内，避免所有采样点被周期性噪声的同一点污染。累加时用32位变量，防止溢出。平均结果的码值再参与后续计算时，别忘了类型转换，避免整数除法吃掉精度。

还有一点容易被忽略：过采样处理之后，你得到的有效位数提升了，但如果你输出的数据宽度还是12位，那提升没有意义。要真正体现16位有效分辨率，输出变量要用16位甚至32位存储，并且要正确地将衰减加回去。用均值滤波提升分辨率时，每4倍平均得到的有效位数增加1位，但如果用12位ADC做256次平均，输出码值应该除以16才是16位分辨率的等效码值，否则数值看似变大了很多，实际信息量没有变化。

做ADC采样的这些年，我踩过最大的坑就是"一上来就堆软件滤波，不愿意回头查硬件"。现在的原则很朴素：先保证采样时间充足、地线干净、参考电压稳定，再来谈用多少倍的均值滤波。如果你的ADC读数在2到3个LSB内随机跳动，那是很正常的白噪声表现，不用过分焦虑；真正需要警惕的是那种稳定偏低或漂移的误差，它往往指向采样时间或参考电压，而不是"缺一重滤波"。

最后留一个小技巧：调试ADC电路时，用一个稳定的直流电压源（而不是悬空引脚或接个电位器）作为输入，连续采样几千个点看直方图。直方图的形状和漂移方向，比任何示波器图都能更快地告诉你噪声类型——这是我每个项目验证ADC电路的第一道工序，也推荐你试试。