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简介：这是一份面向FPGA初学者与数字系统课程实践者的VGA显示类综合实验项目，聚焦于按键交互与实时图形逻辑的硬件实现。资源完整实现了在主流FPGA开发平台上运行的弹球小游戏，通过物理按键控制挡板移动，实时计算弹球轨迹并生成标准VGA时序信号驱动显示器，涵盖状态机设计、同步控制、像素坐标映射与双缓冲显示等核心知识点。压缩包共115个文件，含15个Quartus工程数据库（cdb/hdb）、8个Verilog源码（v）及备份（bak）、7个时序分析报告（rpt）、6个编译日志（qmsg），以及sof配置文件、qpf工程文件、readme说明文档等，结构完整，便于工程复现与模块级调试。资源包仅3.79MB，轻量易部署，已有1233人学习下载。读者可直接加载sof文件上板验证，结合VGA.v、Key_Set.v等关键模块源码深入理解输入采集、游戏逻辑与视频输出的协同机制，是掌握FPGA图形显示开发流程的典型入门范例。

1. FPGA弹球游戏：用三个物理按键驱动VGA显示的实时弹球物理引擎，适合数字电路课设与HDL入门实战

你有没有试过在没有CPU、没有操作系统、甚至没有一行C代码的前提下，让一个像素小球在显示器上真实反弹？不是仿真波形图，不是ModelSim里的绿色方块，而是接上VGA线、插上HDMI转接器、真真切切看到球撞墙减速、触底回弹、受重力下坠——所有逻辑全靠Verilog硬写，所有时序全靠FPGA内部PLL锁相环精准约束。这个资源就是这样一个「纯数字电路实现的弹球小游戏」完整工程包：它不调用任何IP核（除基础PLL），不依赖软核处理器，从按键消抖、状态机调度、物理积分计算到VGA时序生成，全部用同步时序逻辑+组合逻辑完成。适合刚学完《数字逻辑设计》想落地第一个显示类项目的学生，也适合想补足“硬件时间感”的嵌入式工程师——它逼你亲手算清楚50MHz时钟下每帧640×480@60Hz要分多少拍、水平同步脉冲宽多少ns、垂直消隐期能塞进几轮物理更新。这不是玩具Demo，是能放进课程设计答辩PPT里、带波形截图和实拍视频的硬核工程。

2. 弹球物理引擎：用定点数积分实现重力加速度与碰撞响应，不依赖浮点IP

2.1 为什么必须用定点数而非浮点？——FPGA资源与精度的硬边界

FPGA片上没有原生浮点乘法器（除非高端器件配DSP slice且显式调用浮点IP），而弹球运动需要持续做v_y = v_y + g * dt和y = y + v_y * dt这类累加运算。若强行用IEEE754单精度浮点，仅一个加法就需占用数十个LUT+多个DSP，且时序收敛极难。本工程采用Q12.4 定点格式（12位整数+4位小数），即数值范围为 [-2048, 2047.9375]，最小分辨率为 1/16 = 0.0625。重力加速度g设为 16（对应实际物理值 16 × 0.0625 = 1.0 单位/帧），这样每次积分只需一次加法+一次移位，完全规避乘法器消耗。关键在于：物理参数不是按现实单位设定，而是按FPGA可高效运算的整数尺度重新标定。比如屏幕高度480像素，球半径8像素，那么Y轴位置用12位整数足够覆盖（0~480 → 0~480×16=7680，Q12.4下7680 < 8192）。

2.2 物理状态机：四状态循环驱动位置更新与碰撞检测

弹球运动被抽象为四个同步状态，由主时钟驱动（50MHz），每个状态严格占用1拍，确保时序可预测：

// 状态定义（精简版） localparam IDLE = 2'b00; localparam UPDATE_V = 2'b01; // 更新速度：v_y = v_y + g localparam UPDATE_P = 2'b10; // 更新位置：y = y + v_y localparam CHECK = 2'b11; // 检测碰撞并修正：触顶/触底/撞墙则翻转v_y/v_x // 状态转移逻辑（关键节选） always @(posedge clk) begin if (rst_n == 1'b0) state <= IDLE; else case (state) IDLE: state <= UPDATE_V; UPDATE_V: state <= UPDATE_P; UPDATE_P: state <= CHECK; CHECK: state <= IDLE; // 一帧物理更新完成 endcase end

提示：状态机不直接驱动VGA像素，而是每帧（16.67ms）触发一次物理更新。VGA显示模块读取当前ball_x,ball_y坐标，实时绘制球体——这是典型的“解耦设计”：物理计算与显示刷新异步，避免因复杂计算拖慢VGA时序。

2.3 碰撞检测的边界处理：为什么用“位置+半径”比“中心坐标”更鲁棒？

球体在VGA上实际渲染为8×8像素实心方块（非圆形，降低逻辑复杂度）。碰撞检测若只判断中心坐标是否越界（如y > 480），会导致球体一半已穿出屏幕才反弹，视觉上“穿墙”。本工程采用“外接矩形包围盒”检测：

// 球体实际占据区域：[x-4, x+3] × [y-4, y+3]（8像素宽高） wire top_hit = (ball_y_int - 4) <= 0; // 上边界：球顶碰到屏幕顶（y=0） wire bottom_hit= (ball_y_int + 3) >= 479; // 下边界：球底碰到屏幕底（y=479） wire left_hit = (ball_x_int - 4) <= 0; // 左边界 wire right_hit = (ball_x_int + 3) >= 639; // 右边界（640像素宽） // 碰撞响应：速度反向 + 微小阻尼（模拟能量损失） assign v_y_next = bottom_hit | top_hit ? -v_y_cur * 14/16 : v_y_cur; // 14/16 = 0.875 阻尼系数 assign v_x_next = left_hit | right_hit ? -v_x_cur * 15/16 : v_x_cur;

注意v_y_next计算中用了*14/16而非简单取负——这是通过右移4位再乘14实现的定点阻尼，避免球无限反弹。若省略此步，球会像幽灵一样在地面高频抖动，这是新手最常翻车的物理失真点。

3. VGA时序生成：从50MHz时钟到640×480@60Hz的逐行扫描控制

3.1 为什么选640×480@60Hz？——教学FPGA的黄金参数组合

主流开发板（如Xilinx Basys3、Intel DE10-Lite）标配50MHz或100MHz晶振，而640×480@60Hz的像素时钟恰好为25.175MHz。本工程采用50MHz输入→PLL倍频/分频→25.175MHz像素时钟的方案。选择此分辨率是因为：

• 水平总周期 800 像素（640显像+16消隐），垂直总周期 525 行（480显像+45消隐），数值规整，计数器位宽小；
• 时序参数公开标准（VESA），示波器可直接比对；
• 对初学者友好：25MHz时钟下，每行约31.7μs，有充足时间插入逻辑（如球坐标比较）。

3.2 VGA信号三要素：HSYNC、VSYNC、RGB的时序协同

VGA不是“把数据喂给显示器”，而是严格遵循时序协议的握手过程。本工程用两个独立计数器实现：

// 水平计数器：每像素加1，满800清零 reg [9:0] h_cnt; // 0~799 always @(posedge px_clk) begin if (h_cnt == 10'd799) h_cnt <= 10'd0; else h_cnt <= h_cnt + 1'b1; end // 垂直计数器：每行结束（h_cnt==799）时加1 reg [8:0] v_cnt; // 0~524 always @(posedge px_clk) begin if (h_cnt == 10'd799) begin if (v_cnt == 9'd524) v_cnt <= 9'd0; else v_cnt <= v_cnt + 1'b1; end end // HSYNC生成：行同步脉冲（宽度96像素，起始位置656） assign hsync = (h_cnt >= 10'd656) && (h_cnt < 10'd752) ? 1'b0 : 1'b1; // VSYNC生成：场同步脉冲（宽度2行，起始位置490） assign vsync = (v_cnt >= 9'd490) && (v_cnt < 9'd492) ? 1'b0 : 1'b1;

注意：HSYNC/VSYNC低电平有效，且必须在消隐期内发出。若把hsync写成(h_cnt==656)这样的单拍脉冲，显示器将无法锁相——这是示波器抓到的第一个必查信号。

3.3 显示内容合成：如何在正确像素位置画出弹球？

VGA显示模块不存储帧缓存，而是“边算边显”：每一拍计算当前(h_cnt, v_cnt)是否落在球体区域内，若是则输出RGB=8’b11100000（红球），否则输出黑（0）。关键逻辑如下：

// 球体区域判断（8×8像素方块） wire in_ball_region = (h_cnt >= ball_x_int - 4) && (h_cnt <= ball_x_int + 3) && (v_cnt >= ball_y_int - 4) && (v_cnt <= ball_y_int + 3); // RGB输出（简化版，实际含灰度渐变） assign r = in_ball_region ? 8'd224 : 8'd0; // R通道高电平 assign g = in_ball_region ? 8'd0 : 8'd0; // G通道关 assign b = in_ball_region ? 8'd0 : 8'd0; // B通道关

此处ball_x_int/ball_y_int是物理引擎输出的整数坐标（Q12.4格式已截断小数部分）。若未做截断直接用Q12.4值比较，会导致球体位置跳变——因为小数部分在像素级无意义，必须向下取整。

4. 按键消抖与交互逻辑：三个物理按键如何映射为“启动/暂停/重置”功能

4.1 为什么机械按键必须消抖？——示波器下真实的“毛刺地狱”

开发板上的轻触按键是机械结构，按下/释放瞬间会产生10~20ms的电压抖动。若直接将按键信号接入状态机，一次按下可能被识别为5次触发。本工程采用两级同步+计数器消抖组合方案：

// 第一级：跨时钟域同步（防止亚稳态） reg [1:0] key_sync_r; always @(posedge px_clk) begin key_sync_r[0] <= ~key_in; // 按下为低电平，取反便于后续处理 key_sync_r[1] <= key_sync_r[0]; end // 第二级：20ms计数消抖（50MHz下=1,000,000拍） reg [19:0] cnt_debounce; reg debounced_key; always @(posedge px_clk) begin if (key_sync_r[1]) begin // 按键未按下，计数器清零 cnt_debounce <= 20'd0; debounced_key <= 1'b0; end else begin if (cnt_debounce == 20'd999999) begin // 满20ms cnt_debounce <= 20'd0; debounced_key <= 1'b1; // 确认按下 end else cnt_debounce <= cnt_debounce + 1'b1; end end

提示：debounced_key是稳定高电平脉冲，宽度固定1拍（20ms后首拍）。后续逻辑用posedge debounced_key检测上升沿，确保每个按键动作只触发一次。

4.2 三键功能分配：为什么“暂停”比“启动”更难实现？

三个按键分别定义为：

• KEY0：Start/Stop（启停切换）
• KEY1：Reset（重置球至初始位置）
• KEY2：Speed Up（加速，增加重力g值）

难点在Start/Stop：它不能简单改变物理引擎使能信号，否则会导致球在空中突兀静止（违反物理连续性）。本工程采用“冻结速度但持续更新位置”策略：

// 物理引擎使能信号 wire engine_en = (state == IDLE) ? start_flag : 1'b1; // 仅IDLE态受控 // 但位置更新逻辑仍运行，只是速度不更新 assign v_y_next = pause_flag ? v_y_cur : v_y_update; // 暂停时v_y保持不变 assign v_x_next = pause_flag ? v_x_cur : v_x_update;

这样暂停时球继续按当前速度滑行，直到下次碰撞才停止——符合直觉，且避免状态机死锁。

4.3 按键防误触：长按与短按的区分逻辑

KEY2（加速）若每次按下都增加g值，用户手抖可能连按两次导致g过大。本工程加入长按阈值（500ms）：

// 长按计数器（500ms = 25,000,000拍 @50MHz） reg [24:0] long_press_cnt; always @(posedge px_clk) begin if (~debounced_key) begin // 按键按下期间计数 if (long_press_cnt == 25'd24999999) long_press_flag <= 1'b1; else long_press_cnt <= long_press_cnt + 1'b1; end else begin // 松开时清零 long_press_cnt <= 25'd0; long_press_flag <= 1'b0; end end // 短按：松开时检测未达长按阈值 wire short_press = (posedge debounced_key) && (~long_press_flag); wire long_press = (posedge debounced_key) && (long_press_flag);

短按KEY2加g=1，长按KEY2加g=5——这是用户反馈最友好的交互设计。

5. 避坑指南：五个让FPGA新手调试三天找不到原因的致命细节

5.1 现象：VGA显示雪花噪点，但HSYNC/VSYNC波形正常

原因：RGB数据线未做时序约束，导致建立/保持时间违例。综合工具将RGB路径优化成不同延时，显示器采样时部分位已翻转。
解决：在XDC约束文件中强制RGB信号组内等长（set_property IOSTANDARD LVCMOS33 [get_ports {r[7:0]}]+set_property PACKAGE_PIN ...后，添加set_property OUTPUT_DELAY 2.5 [get_ports {r[7:0] g[7:0] b[7:0]}]并执行report_timing_summary -delay_type min_max确认余量>0.5ns。

5.2 现象：按键偶尔失灵，示波器看按键信号干净

原因：未对按键进行跨时钟域同步，debounced_key在50MHz域采样时发生亚稳态，导致单拍脉冲丢失。
解决：必须用两级寄存器同步（如4.1节代码），且第二级输出才作为有效按键信号。禁用任何“单级同步+打两拍”的偷懒写法。

5.3 现象：球在屏幕底部反复微跳，不真正静止

原因：碰撞检测使用>= 479判断触底，但球位置更新后y可能变为479.9，下帧v_y反向但数值过小，导致y在479~480间震荡。
解决：在CHECK状态中强制将触底位置钳位：ball_y_int <= 479 - 4;（球底对齐479，球顶在475），同时v_y清零而非仅反向。

5.4 现象：下载bitstream后球不动，但仿真波形显示坐标在变

原因：VGA时序计数器未复位，或复位信号未同步到像素时钟域。上电时h_cnt/v_cnt处于随机值，HSYNC/VSYNC相位错乱。
解决：在顶层模块中，用px_clk的前100个周期强制拉低复位（rst_n_px <= (cnt_rst < 100) ? 1'b0 : 1'b1;），确保所有VGA相关逻辑在稳定时钟下初始化。

5.5 现象：加速后球飞出屏幕顶部，且不再回落

原因：重力g增大后，v_y积累过快，单帧内y变化量超过屏幕高度，导致top_hit检测失效（y-4直接小于0，但未经过中间状态）。
解决：在UPDATE_P状态中增加越界保护：ball_y_int <= (ball_y_int + v_y_cur > 479+4) ? 479+4 : (ball_y_int + v_y_cur);先限幅再检测碰撞。

6. 实战验证技巧：用ILA核抓取物理引擎关键信号，三步定位时序问题

6.1 ILA配置：只抓4个信号，却能覆盖90%故障场景

Vivado的ILA（Integrated Logic Analyzer）是FPGA调试的后悔药。但新手常犯错误：抓10个信号导致布线失败或采样率不足。本工程精简为以下4路，全部在px_clk域采样：

提示：触发条件用“或”逻辑组合，避免多条件AND导致错过瞬态。ILA深度设为1024，足够捕获1帧以上数据。

6.2 波形分析法：从VGA波形反推物理引擎健康度

当ILA捕获到一帧数据后，按此顺序排查：

1. 看h_cnt/v_cnt是否线性递增：若出现跳变（如v_cnt从239直接到241），说明垂直计数器时序违例；
2. 看ball_y_int在v_cnt=240附近是否连续变化：若每帧跳跃>10像素，说明v_y_cur过大或积分频率错误；
3. 看v_y_cur在ball_y_int触底（≈475）后是否立即变负且绝对值减小：若仍为正，碰撞响应逻辑未生效。

6.3 硬件闭环验证：用手机慢动作录像测帧率

理论帧率60Hz，但实际可能因逻辑过载掉到58Hz。用iPhone慢动作（240fps）录制VGA屏幕，逐帧数球从顶到底的耗时。例如：球从y=0到y=479耗时12帧，则实际帧率为240/12 = 20fps——这说明物理引擎占用了过多逻辑资源，需检查UPDATE_V/UPDATE_P状态是否被复杂逻辑拉长。此时应将g值下调，或拆分物理计算到更多状态拍。

从那以后我每次交付FPGA显示类项目，都强制走一遍这三步：先用ILA抓基准波形，再用慢动作录像验帧率，最后用示波器量HSYNC宽度。不是信仿真，是信硬件吐出来的每一个脉冲。希望帮到你。

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