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搜索"TIA"这个词的时候，结果页经常一半是西门子博途（TIA Portal，那套PLC编程环境的安装教程和授权问题），一半是模拟电路里的跨阻放大器（Transimpedance Amplifier）。这两样东西除了缩写撞车，没有半点关系，本文只谈后者。跨阻放大器是光电二极管、光电倍增管、电流输出型传感器最常用的前端电路，它的任务是把微弱的电流信号转成电压信号，本质是一个电流-电压转换器。很多人搭第一版TIA的时候会卡在同一个地方：明明照着数据手册选了运放，反馈电阻也算对了，结果要么带宽差一大截，要么输出自激振荡，要么增益随频率掉得莫名其妙。追根到底，问题往往出在对输入阻抗和输出阻抗的理解上——这两个参数不是教科书里那两个拿来背的公式，它们直接决定电路的带宽、噪声、稳定性和线性度。下面我把自己从推导到实测、从选型到画板的整套思路整理出来，适合刚接触TIA的硬件工程师、做光电检测的在校学生，以及需要给传感器配前端电路的嵌入式开发者参考。

1. TIA输入阻抗的真正定义：别被"虚短"两个字骗了

1.1 从光电二极管到运放反相端：信号到底怎么走

先把电路结构摆清楚。一个最典型的TIA由一个运放、一个反馈电阻Rf、一个反馈电容Cf（有时是寄生，有时是刻意加的）组成。光电二极管的阳极接地（或接偏压），阴极接到运放的反相输入端，运放的同相输入端接参考电压（通常是地或一个偏置电压）。光照射到二极管上产生光电流，这个电流从反相输入端被"吸"走，运放靠调整输出使反相输入端维持在与同相端相同的电位，于是输出端电压就等于光电流乘以Rf，符号相反。

这个结构里，运放反相输入端的节点是整个电路最关键的一个点，我习惯叫它"求和节点"或者"虚拟地"。说它是"地"，是因为理想情况下它的电位被反馈强制拉到跟同相端一致；说它"虚拟"，是因为它并没有真的接到地上，任何流入或流出这个节点的电流，都必须通过反馈网络流到输出端。理解了这一点，输入阻抗的定义就顺理成章了：TIA的输入阻抗，是指从光电二极管看进去、在反相输入端这个节点上呈现的等效阻抗，它描述的是这个节点对外来电流的"抵抗能力"。

很多人第一反应会拿运放数据手册里的"输入阻抗"往上套，比如看到一个CMOS运放标着输入阻抗10^13欧姆，就以为整机的输入阻抗也是这个量级。这个理解是错的，而且错得很彻底，后面会专门讲为什么。

1.2 输入阻抗不是运放的输入阻抗

区别在哪？运放数据手册里的输入阻抗（更准确说是差分输入电阻和输入电容），是指运放两个输入端之间的阻抗，也就是"你直接拿两个探头量同相端和反相端"时会看到的阻抗。但在TIA里，运放被接成了并联-并联负反馈（也叫shunt-shunt反馈），输入端是电流源性质的信号源，反馈网络从输出端"跨"回到输入端。

负反馈有一个非常核心的作用：它会按照环路增益的倍数，改变电路在输入和输出端口呈现的阻抗。具体到并联-并联反馈，反馈会降低输入节点上的电压摆幅——同样的电流注入，节点电压变化更小，表现出来就是输入阻抗被压低。压低的倍数，约等于1加上运放的开环增益。

所以你会看到一个反直觉的结论：运放自身的输入阻抗越高（比如FET输入级、CMOS输入级），TIA整体输入节点的阻抗反而越接近理论下限。这不是矛盾，而是因为TIA的输入阻抗几乎完全由Rf和开环增益决定，运放自身输入阻抗只是并上去的一个"背景项"。只有当运放自身输入阻抗低到跟Rf/(1+A)可比时，它才会明显影响结果，而这种情况在常规运放里基本不会出现。

1.3 输出阻抗常被忽略，却决定了后级能不能接

相比输入阻抗，输出阻抗在TIA设计里更常被忽视。很多人的思路是：TIA的输出直接接ADC或者接下一级放大器，反正输出是个电压，运放能驱动不就完了？实际上，TIA的输出阻抗决定了三件事：一是能不能带动后级的负载电阻或开关电容网络，二是输出端接容性负载时会不会振荡，三是输出信号的建立时间能不能满足采样要求。

输出阻抗也有一个"负反馈压低"的规律：运放本身的开环输出电阻通常在几十欧姆到几百欧姆量级，接成闭环后，这个电阻会被环路增益"除"掉，变成一个非常小的值。但这个压低是有条件的——只在环路增益还高的频段成立。频率一高，开环增益滚降，输出阻抗就跟着往上爬，最终在运放的单位增益带宽附近回到开环输出电阻的水平。这个频率特性，正是很多人在高速TIA上翻车的原因。

2. 输入阻抗的定量推导与几个决定它的量

2.1 用负反馈基本式一步推出Zin表达式

推导其实很干净，不需要复杂的节点方程。设运放的开环增益为A，输入信号是电流源，反馈元件是阻抗Zf（在TIA里Zf = Rf并联Cf）。反相输入端节点电压记为Vn，输出记为Vo。运放的同相端接地，所以理想运放的输出满足Vo = -A·Vn（考虑反相）。通过反馈网络流出的电流是(Vn - Vo)/Zf。输入电流Iin全部流入这个节点，所以Iin = (Vn - Vo)/Zf。

把Vo = -A·Vn代进去：Iin = (Vn + A·Vn)/Zf = Vn(1+A)/Zf。

于是节点的等效输入阻抗就是：

Zin = Vn / Iin = Zf / (1 + A)

这就是并联-并联反馈输入阻抗的核心表达式。它在直流和低频下退化成Zin ≈ Rf/A0（A0是运放直流开环增益），这也是为什么TIA的输入阻抗看起来这么低。表达式里没有任何一项跟"运放自身的输入电阻"有关，这就是前面说的"输入阻抗不是运放的输入阻抗"的定量依据。

如果考虑实际的输入节点上还挂着输入电容Cin（包括运放输入电容、光电二极管结电容、PCB走线电容），那么准确的表达式是Zf/(1+A)与1/(sCin)的并联。但在分析输入阻抗的直流和低频值时，通常忽略电容项；只有分析高频稳定性时，Cin才变成主角。

2.2 数值代入：为什么TIA输入阻抗低到毫欧级

光看公式没感觉，代入数就成了。取一个常见的组合：Rf = 100kΩ，运放直流开环增益A0 = 100dB，也就是10^5。

Zin(直流) ≈ Rf / A0 = 100kΩ / 100000 = 1Ω

如果运放的直流开环增益更高，比如120dB（10^6）：

Zin(直流) ≈ 100kΩ / 1000000 = 0.1Ω

换成一颗高开环增益的精密运放，或者Rf取小一些（比如10kΩ），输入阻抗很容易落到几十毫欧的量级。实测时你会发现，用普通的万用表或者LCR表根本量不出这个值，因为探头的引线电阻、接触电阻就比它大。这也解释了为什么TIA的输入节点对漏电流极其敏感——任何微安级的漏电流，都会在节点上产生可观的电压误差。

这里有个容易被忽略的细节：光电二极管本身的并联电阻（也叫分流电阻，Rsh）会与Zin形成抢电流的关系。一个硅光电二极管的Rsh通常在10^9到10^11欧姆量级，比TIA的输入阻抗大好几个数量级，所以绝大部分光电流乖乖流进运放。但如果用的是某些小面积、高暗电流的器件，Rsh可能掉到10^7欧姆级别，此时分流损失就开始影响精度了。做高精度光功率计时，这个参数必须查数据手册。

2.3 输入阻抗随频率上升，这才是坑的源头

Rf/(1+A)里的A不是常数，它随频率滚降。单极点运放的开环增益可以写成A(jω) = A0/(1 + jω/ωp)，其中ωp是主极点角频率，跟单位增益带宽GBW的关系是GBW = A0·fp。代入输入阻抗公式：

Zin(jω) = Rf·(1 + jω/ωp) / A0

这个表达式的含义很直观：低频时Zin ≈ Rf/A0，是一个很小的电阻；随着频率升高，Zin呈上升趋势，在频率到达主极点时上升为低频值的√2倍，之后以每十倍频20dB的斜率往上爬，一直到单位增益带宽频率，此时Zin约等于Rf。

为什么这事重要？因为输入阻抗的频率特性决定了输入节点的电压波动幅度。光电二极管的结电容是随两端电压变化的非线性电容，节点电压波动越大，结电容的调制效应越强，信号的失真也越明显。在低频、低阻抗状态下，节点电压被死死钳住，非线性几乎看不出来；一旦到了几十兆赫兹以上，输入阻抗升高，节点上出现可观的电压摆幅，非线性失真就冒头了。做高速、高线性度TIA的人，往往要在这个频率区间特别小心。

3. 输出阻抗的推导、负载配合与容性负载陷阱

3.1 闭环输出阻抗怎么算

输出阻抗的推导思路跟输入阻抗类似，但方向是反的。设运放自己的开环输出电阻是Ro，环路增益是Aβ（在TIA里，由于输入是理想电流源，反馈系数β≈1），那么闭环输出阻抗近似为：

Zout ≈ Ro / (1 + Aβ) ≈ Ro / (1 + A)

取个典型值：Ro = 100Ω，A0 = 100dB = 10^5，那么低频输出阻抗约1毫欧。实际测量中你很少能测到这么低，因为PCB走线的电阻、焊点、探头接地回路都会引入寄生，一般实测在几十毫欧到几百毫欧之间。但方向是对的：TIA的输出在低频段几乎是个理想电压源。

频率一上去，情况就变了。A随频率滚降，Zout跟着上升。在GBW处A=1，Zout回到Ro的量级。所以如果你用一颗GBW = 10MHz的运放做TIA，输出阻抗在10MHz附近就已经爬到几十欧姆了，这时候再接一个几百皮法的负载电容，输出的建立时间会被严重拖慢，甚至振荡。

3.2 后级ADC、负载电阻与输出摆幅的三角关系

输出阻抗跟后级怎么配，是个经常被合在一起考虑的问题。如果后级是高输入阻抗的ADC（比如逐次逼近型SAR ADC的输入端有一小段采样保持电容），那么直流负载很轻，输出阻抗低不低无所谓；但采样瞬间，ADC的采样电容要在很短时间内从TIA取走电荷，这时候TIA的输出阻抗和ADC的采样开关电阻一起构成RC时间常数，直接决定建立精度。

如果后级是一个负载电阻RL，比如某些射频或视频应用里需要50Ω端接，那TIA输出必须在驱动50Ω的同时保持摆幅和线性度。这就是个硬约束：输出电流 = 输出电压 / RL，而运放的输出短路电流是有限的。一颗输出电流20mA的运放，驱动50Ω负载时最大不失真输出摆幅也就1V峰值左右，再高就削顶。

我个人的经验是，在TIA输出和负载之间放一个小的隔离电阻（比如10Ω到50Ω），既能限制容性负载带来的相位损失，又能给输出级一点"呼吸空间"。这个电阻的代价是分压误差，但只要后级输入阻抗远大于隔离电阻，误差可以忽略。给高速ADC做驱动时，这个隔离电阻几乎是标配。

3.3 容性负载：最容易炸的稳定性问题

容性负载是TIA输出端最常见的稳定性杀手。原因不难理解：输出阻抗Zout和负载电容CL构成一个极点，这个极点在反馈环路里会带来额外的相位滞后。当滞后积累到180°附近，环路就从负反馈变成了正反馈，电路开始振荡。

判断会不会振荡，有个粗略的估算：负载极点频率fL = 1/(2π·Zout·CL)。如果这个频率落在环路增益还大于1的频段内，而且离交越频率太近，稳定性就危险。举例来说，Zout在高频已经升到50Ω，CL = 100pF，那么fL = 1/(2π×50×100e-12) ≈ 32MHz。如果这颗运放的GBW只有10MHz，交越频率在10MHz附近，负载极点在32MHz之外，还算安全；但如果GBW是50MHz，交越频率接近负载极点，相位裕度就会被吃掉一大块。

处理办法有几个：一是串联隔离电阻，把负载极点往外推；二是选输出阻抗更低、驱动能力更强的运放；三是直接在输出端加一个小的RC缓冲网络（snubber）来阻尼振铃。这三种手段不冲突，可以叠加使用。

4. 影响因素全景：从运放参数到PCB铜箔

4.1 运放本身：GBW、开环增益、输入电容、输出电阻

影响TIA输入输出阻抗的运放参数，排在第一梯队的是开环增益A0和增益带宽积GBW，其次是输入电容Cin和开环输出电阻Ro。

A0直接决定低频输入阻抗和低频输出阻抗被压低的倍数。A0越高，输入节点的钳位越硬，输出端的电压源特性越理想。精密光功率计喜欢用高A0的零漂移运放，原因就在这。

GBW决定的是"低压低阻状态能维持到多高频率"。GBW越宽，输入阻抗的上升拐点越靠后，输出阻抗的低值区间越宽。但它有代价：GBW越高的运放，噪声通常越大，功耗越高，价格也越贵。这是一个必须权衡的取舍，没有万能选择。

Cin是稳定性分析的起点。运放输入电容本身通常只有几皮法，但PCB走线的杂散电容、光电二极管的结电容加起来，很容易凑到十几皮法。这个总电容和Rf一起构成噪声增益的零点，是TIA补偿计算的核心输入之一。选运放的时候，输入电容这一栏千万别跳过。

Ro则决定输出阻抗的高频上限。对于需要驱动重负载或者长电缆的场合，Ro小的运放优势明显。但Ro小往往意味着输出级偏置电流大，静态功耗上去了。同样是个取舍。

4.2 反馈网络：Rf、Cf、寄生电容与漏电流

反馈网络是TIA的"心脏"。Rf决定跨阻增益，也直接进入输入阻抗表达式（Zin = Zf/(1+A)），Rf越大，输入阻抗的绝对值越大。做高增益TIA（比如Rf = 1GΩ）时，输入阻抗在低频也能到几十欧姆甚至上百欧姆，输入节点的钳位效果明显变弱，各种漏电流、寄生效应就开始显形。

Cf的作用是补偿，它在反馈网络里制造一个高频极点，抵消输入电容带来的零点，保证环路稳定。Cf太小，稳定性不够；Cf太大，带宽被白白牺牲。第6节会给出具体算法。

寄生电容是隐形杀手。反馈电阻的焊盘、运放两个输入引脚之间的走线、甚至反馈电阻本体的寄生电容，都会在反馈路径上叠加一个不可控的Cf。做高阻值TIA时，一颗0805封装的1GΩ电阻，本体寄生电容就有0.1pF到0.2pF，跟精心计算的Cf同一个量级。这时候要么换更小封装的电阻，要么在布局上把反馈路径的焊盘面积压到最小。

漏电流的影响在高阻值TIA里尤其突出。PCB板材的体电阻、助焊剂残留、空气中的湿气，都会在求和节点上产生纳安级甚至微安级的漏电。这些漏电乘以Rf，就是实打实的输出误差。所以高阻TIA的输入节点周围通常要做防护环（guard ring），并且避免使用助焊剂残留多的工艺。

4.3 环境与工艺：温度、电源、二极管结电容

温度对TIA的影响是多路径的。运放的GBW随温度变化（通常有几十ppm/℃的漂移），A0也会变；Rf本身有温度系数，薄膜电阻在50ppm/℃量级，厚膜电阻差一些；光电二极管的暗电流大约每升高10℃翻一倍，结电容也随温度小幅变化。这些因素叠加起来，会让输入输出阻抗和整体增益在温度变化时一起漂。

电源电压的影响主要体现在输出摆幅和运放的偏置点上。增益带宽积对电源电压的敏感度通常不高，但输出级的可用摆幅是跟着电源走的。低压供电的TIA，输出摆幅受限更明显，动态范围被压缩。

光电二极管的结电容是随反偏电压变化的，这一点直接和输入阻抗耦合。光伏模式（零偏压）下结电容最大，可能几十甚至上百皮法；反偏几伏之后，结电容能降到几皮法。所以在TIA输入端施加一个反偏电压，既能提高带宽，又能降低输入电容对稳定性的压力——代价是暗电流增大、噪声上升。这个选择本质上是在带宽和噪声之间做权衡。

5. 把阻抗量出来：仿真与实测的可行做法

5.1 SPICE里三行代码扫出输入阻抗曲线

仿真输入阻抗比实测靠谱得多，因为它不受探头寄生影响。做法是在TIA的输入端并一个交流电流源，扫频，然后测量输入节点的电压，两者相除就是Zin。下面是一个简化的LTspice风格网表片段：

I1 0 in AC 1 XU1 0 in out OPAMP_MODEL Rf in out 100k Cf in out 0.5p .ac dec 100 1 100Meg .meas AC Zin_dc FIND V(in)/1 AT=1

关键在于：交流电流源必须接在输入节点和地之间，模拟光电二极管的电流注入方式。测量的是节点电压V(in)，因为激励电流幅值设成1A，所以V(in)的数值直接等于阻抗的模。跑完AC扫描，用波形查看器画V(in)的幅度曲线，就得到完整的Zin频率响应。

想同时看输出阻抗，就把输入端的电流源去掉，在输出端串一个交流电流源（注入到输出节点），测输出电压。不过注意，输出端注入电流时电路仍在闭环状态，测出来的是闭环输出阻抗，这正是我们想要的。如果只想看开环输出阻抗，需要断开反馈环，那属于另一套分析。

仿真时有个细节容易踩坑：不要忘了把光电二极管的结电容和运放的输入电容都放进模型。很多库里的运放模型只包含输入端的一个小电容，实际电路里Cd可能是它的十倍。少了这一项，仿真出来的相位裕度会好看得不真实。

5.2 实测思路：环路增益法与输出阻抗法

输入阻抗实测的难点在于阻抗太低，普通探头和网络分析仪的端口阻抗都是50Ω，直接接上去就改变了电路。可行的做法是间接测量：在输入节点和电流源之间串一个已知的电阻Rs（远大于Zin），测量节点电压Vn和Rs两端的电压，用分压关系反推。Rs取值要仔细，太大信号太弱，太小又起不到隔离作用，通常取Zin估计值的几十倍。

输出阻抗实测相对容易。方法是在输出端加一个小幅度的交流扰动，测量扰动电流和输出电压变化，比值就是输出阻抗。实操上可以用一个已知电阻Rtest串在输出和地之间，测量Rtest两端的电压变化来推算电流。要注意扰动的幅度要小，别让运放进入非线性区。

另一个更实用的替代方案是直接测环路增益。用注入变压器在反馈环路的某一点注入小信号，测量注入点前后两个节点的电压比，就能得到环路增益的幅度和相位曲线，从曲线读出相位裕度。这个方法对判断稳定性比直接测阻抗更直观，也是我在实际调试时最常用的手段。

5.3 测量时的禁忌与探头的坑

有几个操作是明确不能做的。第一，绝对不要用万用表的电阻档去量TIA的输入节点。万用表电阻档会施加一个测试电压，对于一个输入阻抗只有几毫欧、且连接着运放输入的节点来说，这个测试电压会直接把运放推出线性区，读数毫无意义，某些情况下还可能因为输入过载损坏器件。

第二，示波器探头的输入电容通常在10pF到15pF，直接挂在TIA输出端会显著改变高频响应，让你误以为电路在振荡或者带宽不足。测量高速TIA输出时，应该用低电容探头，或者用一段50Ω同轴电缆端接匹配后再测。

第三，测量环境里的电磁干扰很容易通过探头的地线环路耦合进来。TIA是高阻抗、小信号电路，一根几厘米长的探头地线就能把几十兆赫兹的干扰引入。用弹簧地针代替鳄鱼夹地线，是标准做法。

第四，测输入节点电压时，探头的输入电容会直接并入求和节点，改变补偿电容的平衡点，可能让原本稳定的电路变得不稳定。这种场合更适合用高阻值的无源探头加衰减器，或者干脆用仿真代替实测。

6. 常见问题速查与实战避坑

6.1 症状-原因-对策对照表

TIA调试中的问题大多有规律可循，下面这张表是我这些年攒下来的高频对照表：

这张表的使用方式是自上而下逐条排查，不要跳步。很多看起来像"运放坏了"的问题，实际上只是Cf差0.2pF，或者输入节点上有一层看不见的助焊剂。

6.2 补偿电容的计算与试凑

补偿电容是TIA里最需要精算的一个元件，也是最后经常需要试凑的一个。理论最优值来自让噪声增益的转折点正好落在开环增益曲线和噪声增益曲线的交点上，推导结果如下：

Cf = sqrt( Cin / (2π · Rf · GBW) )

其中Cin是求和节点上的总电容（运放输入电容 + 光电二极管结电容 + PCB杂散），Rf是反馈电阻，GBW是运放的单位增益带宽积。

代入一组实际数字：Cin = 10pF，Rf = 100kΩ，GBW = 100MHz。

Cf = sqrt( 10e-12 / (2π × 100e3 × 100e6) ) = sqrt( 10e-12 / 6.283e13 ) = sqrt( 1.59e-25 ) ≈ 0.4pF

对应的闭环带宽（-3dB）可以用另一个式子估算：

f-3dB ≈ sqrt( GBW / (2π · Rf · Cin) ) = sqrt( 1e8 / (2π × 100e3 × 10e-12) ) = sqrt( 1e8 / 6.283e-6 ) ≈ 4MHz

0.4pF这个值在实际焊接里很难精确实现，因为一个普通焊盘的寄生电容就有0.2pF左右。我的做法是：先按计算值选一个接近的电容（比如0.5pF），焊上去测阶跃响应，看有没有过冲和振铃。如果过冲超过10%，说明阻尼不够，把Cf按20%的步进往上加；如果上升沿明显被拖慢，说明Cf过大，往下减。通常两三轮就能找到合适的值。

如果Rf特别大（比如1GΩ），计算出来的Cf可能只有0.1pF不到，这时候不要指望焊一个实体电容，而是靠反馈电阻的寄生电容和焊盘电容来"充当"这个Cf。这种情况下，反馈电阻的封装、走线长度就成为补偿精度的决定因素，布局要格外讲究。

6.3 几个我踩过的坑

第一个坑是忽略了光电二极管的结电容与反偏电压的关系。早期做一套光谱检测前端，样品室里的二极管没加反偏，结电容接近80pF，按Cin=10pF算的Cf完全不够，电路一直在高频振铃。后来加了几伏反偏，结电容掉到5pF以下，一次就稳了。这件事让我养成一个习惯：算Cin之前，先确认二极管的工作模式。

第二个坑是反馈电阻的封装选错了。用1GΩ电阻时顺手拿了0805封装，结果反馈路径的寄生电容比计算值大了将近一倍，带宽被压掉一半。换成0402甚至更小封装之后，问题解决。高阻值场合下，封装尺寸对寄生电容的影响比电阻精度本身还重要。

第三个坑是电源去耦的位置。有一次电路在实验室里测得好好的，装进机箱之后就间歇性振荡。查了半天发现是电源线太长，去耦电容离运放电源引脚有3厘米，高频时这段走线的电感让运放看到了一个高阻抗的电源。把去耦电容挪到距离引脚5毫米以内，振荡消失。这个教训很朴素，但确实要吃一次亏才记得住。

第四个坑跟输出端有关。我曾经把一个TIA输出直接接到一段两米长的同轴电缆上，电缆另一头是示波器的高阻输入。结果输出端出现明显的振铃。原因是电缆的分布电容在TIA输出端形成了一个容性负载，把相位裕度吃光了。后来在输出端串了33Ω电阻，并且在电缆末端做了正确的端接，振铃才消下去。

回过头看，TIA的输入输出阻抗说到底就是负反馈在输入输出端口上的投影：输入阻抗由Rf和开环增益共同决定，输出阻抗由Ro和开环增益共同决定，两者都随频率上升而恶化，而恶化的速度由运放的GBW定调。补偿电容、PCB布局、光电二极管的偏置选择，本质上都是在跟这个频率特性做博弈。我在实际项目里的体会是，与其花时间反复换运放，不如先把Cin这个参数老老实实测准——把结电容、走线电容、输入电容都算进去，再用公式算Cf，往往一次就能把电路调稳。测Cin最省事的办法是断开反馈环，用LCR表在输入节点对地量一次，虽然不完美，但比单看数据手册准得多。