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做硬件设计这些年，我在高精度ADC上踩过的最深的坑，就是选型时把“分辨率”当成了“精度”。第一版方案里我挑了一颗24位的Delta-Sigma ADC，数据手册上SINAD标到130多dB，满心以为做出来的采集板测个微伏级信号没什么问题。结果打样回来一测，整个系统实际有效位数连16位都不到，零输入时输出码乱跳，温度一变跑得更是离谱。

后来花了两个多星期一层层排查，才意识到问题根本不在这颗ADC本身，而是选型的时候被“24位”这个数字带偏了。真正起决定作用的，是有效位数、参考电压温漂、前端驱动建立时间这些平时不太起眼的参数。这篇文章我就想把这些年做高精度ADC选型和电路设计的经验整理出来，重点聊聊哪些参数才是关键，以及怎么把这些参数翻译成一张可落地的选型清单。内容适合正在做数据采集、传感器调理、精密仪器或者工业控制类硬件设计的同学参考，尤其是那些准备第一次选高精度ADC，或者选完了发现实测性能不达标的朋友。

1. 选型第一步不是翻芯片手册，而是先做需求量化

很多工程师选ADC的习惯是从“我要几位的”开始，比如“项目要求高精度，那得上24位”，然后就去原厂官网按分辨率筛选。这个顺序不能说完全错，但很容易导致后续所有参数都跟着一个并不合理的起点去凑。

正确的做法是先回答一个问题：你手里的信号到底是什么样的？

举两个最典型的场景。如果你做的是温度采集或者称重传感器信号调理，信号本身是直流或者缓慢变化的，满量程范围明确，系统最终要的是“在某个温区范围内保持多少精度”。如果你做的是振动监测或者音频采集，信号是动态的、有带宽的，系统关注的是信噪比、失真和带外抗混叠能力。这两种应用对ADC参数的需求方向完全不同。

我自己的习惯是，动手看任何芯片之前，先强制自己填一张需求表。表格项大致包括：

• 信号类型（直流缓变/交流动态）
• 信号满量程范围和最小分辨率需求
• 目标系统误差或精度指标
• 信号最高频率和需要的最小采样率
• 通道数量以及多通道轮询还是同步采样
• 供电域、功耗限制
• 工作温度范围
• 主控接口类型（SPI/I2C/并行）

1.1 怎么把“最终精度”翻译成位数需求

这是选型里最容易出偏差的一步。很多人以为系统要求0.01%精度，那ADC分辨率取个17位就够用了，因为1/2^17约等于0.00076%，看上去绰绰有余。但这是只算了量化噪声。

系统里还有参考电压温漂、前端放大器噪声、电源纹波、PCB漏电流、传感器自身漂移等一系列误差源。ADC的量化误差只是整个误差预算中的一部分。我一般会给ADC部分分配总误差预算的1/3到1/2，然后在这个基础上再留2到3位冗余。

举个例子，一个测温项目要求0.05°C精度，量程0到100°C，那么动态范围是2000比1，折算下来大约需要11位。分配到ADC部分的精度需求提高一倍，也就是需要约12位有效分辨率。再考虑到环境温度变化、长期漂移和量产一致性，我最终选的是一颗20位以上的Delta-Sigma ADC，实测系统ENOB做到18位左右才稳定满足指标。

选型时宁可ADC有效位数富余一点，也不要卡着理论底线选。因为后期你会发现，PCB布局、电源质量、机械结构带来的误差远比你预期的大。

1.2 把需求表变成筛选条件

需求表填完以后，选型参数就自动浮现了。比如温度采集项目，采样率只需要几十SPS，那我直接锁死低速率、高分辨率的Delta-Sigma架构；如果是电机电流采样或者电力线监测，采样率需要几十kSPS甚至更高，还要考虑同步，那SAR架构更合适。

这一步的核心目的是把选型范围尽量缩窄，避免在几百颗芯片里大海捞针。我通常会先用采样率和有效位数两个硬指标在选型工具里过滤一遍，再用手册里的SINAD、INL、温漂等参数做第二次筛选。

2. 精度指标怎么读：ENOB才是选型的真正门槛

高精度ADC选型最核心的部分，就是看懂手册上的精度指标。这里面的坑实在太多了，我一个个拆开讲。

2.1 分辨率不等于有效位数

这是最基础也最容易被忽略的一条。分辨率是ADC输出的二进制位数，比如24位；有效位数（ENOB）是用SINAD换算出来的，反映了在实际噪声条件下系统真正能分辨的位数。公式是：

ENOB = (SINAD - 1.76) / 6.02

SINAD的单位是dB，代表信号与噪声加失真的比值。一颗标称24位的ADC，SINAD如果是130dB，换算下来ENOB大约21.3位，这已经算是非常优秀的器件了。但市面上不少24位ADC在低增益下SINAD只有100dB左右，换算下来ENOB只有16到17位。如果你不了解这个换算关系，直接把24位当成系统精度去设计，后面会有很大的心理落差。

所以我现在看选型手册，第一页“特性概要”里最关注的不是分辨率，而是SINAD和ENOB。如果手册连SINAD都不给，只写“24位无失码”，那这颗芯片的交流精度大概率比较保守，需要谨慎评估。

2.2 INL和校准的可能性

INL（积分非线性）描述的是实际转换特性曲线相对理想直线的最大偏差。比如一颗ADC的INL是10ppm，意味着满量程任意点相对理想直线的偏差不超过十万分之一。INL是系统性的确定性误差，理论上可以通过查表校准掉，但前提是INL曲线随温度、供电的变化是可重复的。

实际选型时，我关注的不是“能不能校”，而是“不校准的时候INL有多大”。因为一旦整个系统需要逐片校准INL，产线的测试时间、设备成本和软件复杂度都会大幅上升。对大多数项目来说，选一颗INL本身就很小的ADC，远比选一颗INL大但“可以软件校准”的芯片省心。精密测量应用里，INL最好控制在个位数ppm，这样配合外部校准点做一下增益和失调校准，系统精度就能做得比较漂亮。

2.3 DNL与无失码的意义

DNL描述的是每个量化台阶宽度的偏差。如果某个台阶的宽度接近0甚至为负，就会导致丢码（missing code），转换曲线不再单调。对闭环控制系统来说，单调性丢失意味着控制量输出可能出现跳变，轻则毛刺，重则系统振荡。

我见过一个温控项目，功率调节用的是低速PID，ADC丢码导致输出控制字出现重复段，加热器功率来回跳动，整个温场稳定性始终不达标。排查到最后就是DNL引起的。所以只要是反馈控制类的应用，选型时务必看DNL指标的保证值，同时确认手册里是否明确写了“No Missing Code”保证。

2.4 SNR、THD、SFDR各自管什么

如果你做的是交流信号采集，光看ENOB还不够。交流指标里：

• SNRF指信号与噪声的比值，不包含失真分量
• THD指谐波失真总量
• SFDR指最大杂散分量与基波的比值，对频谱分析类应用尤其重要
• SINAD把噪声和失真都算进去，跟ENOB直接挂钩

不同的应用关注点不一样。音频采集看重THD和噪声；振动监测更看重SFDR，因为要区分小信号和谐波干扰；电力谐波分析则要求THD极低，否则会误判电能质量。看手册的时候还要注意指标的测试条件，比如输入频率、输入幅度是-1dBFS还是满幅，条件不同数据差异很大。同一颗ADC在低频输入下SFDR可能到120dB，但到了接近奈奎斯特频率的输入下掉到90dB也不奇怪，关键看你的信号落在哪个频段。

3. 采样率与架构选择：SAR和Delta-Sigma的取舍没那么简单

确定了精度指标之后，下一个硬约束就是采样率和信号带宽。这一步直接决定了你该用SAR架构还是Delta-Sigma架构。

3.1 奈奎斯特定理的工程版本

理论上采样率大于2倍信号最高频率就够了，但工程上很少有人真的按2倍去设计。原因很现实：抗混叠滤波器需要足够的过渡带，否则高频噪声会折叠到带内。

如果信号带宽是1MHz，你只按2.1MSPS采样，那就需要一个过渡带极窄的滤波器，阶数可能要到七八阶甚至更高，成本和调试难度直线上升。把采样率提到3到4倍信号带宽，滤波器的压力和指标要求会大幅降低。这是一笔非常划算的系统级交易。

3.2 SAR ADC的真实适用场景

SAR（逐次逼近）架构的特点是采样率范围宽，从几十kSPS到几MSPS甚至更高，延迟低，多通道切换快，而且功耗和成本通常优于同精度的Delta-Sigma。

我一般会在这些场景优先考虑SAR：多通道巡检、电机相电流采样、伺服控制、需要快速建立和逐点采样的数据采集系统。SAR ADC的线性度受内部电容匹配限制，做到16位以上高性能的SAR成本不低，但16位级别是成熟区，选择面也很宽。

SAR的一个独有优势是转换是逐点独立的，没有数字滤波器群延迟，非常适合闭环控制这类要求“采到即用”的场景。如果用Delta-Sigma，数字滤波器的群延迟可能会让控制环路相位裕度大幅下降。

3.3 Delta-Sigma ADC的优势和代价

Delta-Sigma架构的精髓是过采样加噪声整形。它用远高于奈奎斯特频率的调制器把量化噪声推到高频，再用数字低通滤波器滤除，换来了很高的有效位数。低频段做到20位以上ENOB基本是Delta-Sigma的天下。

代价是三个：一是带宽低，通常几千SPS到几百kSPS，再高就吃力了；二是转换结果存在群延迟，信号链的实时性变弱；三是数字滤波器对输入阶跃的建立时间较长，多通道切换时会明显拖慢有效吞吐率。

我曾经在某个多路温度采集项目里踩过这个典型坑。单通道数据速率标称4.8kSPS，看起来完全够用，但8通道轮询模式下，每个分到只有600SPS，连300Hz信号的边都摸不到。后来改成每通道独立采样，或者改用SAR加外部调理，才把轮询吞吐率的问题解决。

3.4 多通道场景必须算“有效吞吐率”

这是很多人容易漏掉的一点。Delta-Sigma ADC的数字滤波器对每个新通道的第一次转换需要一定的稳定时间，如果芯片在多路复用模式下每次切换后都要重新建立，那有效数据速率不等于“通道数分之一”，而是会更低。

选型时务必去数据手册里找多通道转换时间的表或者曲线，不要只看单通道最高数据速率。同样地，SAR ADC虽然切换快，但前端采样电容的充电时间、多路开关的导通电阻这些因素也要计入建立时间预算。

4. 参考电压与基准源：系统精度的隐形天花板

说句实话，很多高精度ADC系统做得不好，根源根本不在ADC本身，而是参考电压这一环先垮了。基准源的温漂、初始精度和噪声，会以接近满量程的比例直接折算到ADC输出上。

4.1 温漂计算必须覆盖全温区

基准温漂的单位是ppm/°C，含义是温度每变化1°C，输出电压变化的相对比例。假设基准电压5V，温漂10ppm/°C，环境从25°C升到75°C，温升50°C，那么电压变化就是10ppm × 50 = 500ppm，也就是0.05%。如果系统总精度目标是0.01%，这颗基准直接让预算爆掉了。

实际选型时，我习惯把温漂需求按全工作温区来算，而不是只看25°C附近的典型温漂。精密基准的温漂一般有对应的温区范围，比如-40°C到+85°C全温区保证3ppm/°C，这种参数才是可靠的。

补充一个细节：有些基准源标称温漂很低，但文档里给的是“典型值”，不是“保证值”。量产时不同批次的表现可能差异很大，建议把温漂参数中心值适当留余量，或者干脆选有批量保证曲线的品牌型号。

4.2 基准噪声怎么跟ADC噪声匹配

参考电压还有一项容易被忽视的指标：输出噪声，尤其是低频的1/f噪声。在长时间采样的精密测量里，基准的1/f噪声会直接叠加到测量结果上，表现为读数缓慢漂移。

经验上，基准噪声的等效值最好远小于ADC的一个LSB的等效电压。如果ADC的ENOB是20位，满量程5V，那么一个LSB约4.8微伏。基准噪声如果折算到输出端有十几微伏RMS，系统精度就会被基准吃掉大半。

实际测试时，可以通过把ADC输入端短接，连续采集几千个点看输出码分布，再把基准源换成低噪声基准对比，立刻就能看出噪声贡献占比。

4.3 基准缓冲器到底要不要加

很多高精度ADC的参考输入端是一只开关电容网络，转换过程中会周期性地抽取电荷。如果你用一个内阻偏高、带宽偏低的基准源直接去带，参考电压会被“拉毛”，出现周期性纹波，直接影响转换精度。

解决方式有两种：要么选内置缓冲器的ADC，要么在外部加一个低噪声、低输出阻抗的基准缓冲放大器。缓冲器选型时重点看噪声密度、输出驱动能力和带宽，不能用普通运放随便顶上，否则又把噪声引回来了。

我有一个实测对比：同一颗ADC，参考源从普通LDO切换到低噪声基准加缓冲器之后，系统输出噪声整体下降约40%，长时间漂移指标明显改善。这部分的成本和设计工作量很小，收益却很直接。

5. 输入前端设计：单端还是差分，驱动电路怎么配

ADC选得再好，信号进不去也是白搭。输入前端的取舍往往是系统性能的分水岭。

5.1 单端输入和差分输入的适用边界

差分输入对共模噪声的抑制能力远强于单端，特别适合传感器远距离传输、桥式应变电路、以及地平面比较“脏”的应用场景。只要PCB空间和传感器输出形式允许，我尽量优先选择差分输入。

单端输入不是不能用，但要求参考地要非常干净，信号源阻抗要低，走线要短。工业现场如果传感器远离采集板，单端结构的共模干扰很容易让测量结果毫无参考价值。

还要提一句“伪差分”结构，它的负端内部有处理，但共模抑制能力有限，不能跟真差分混为一谈。选型手册里要看共模抑制比（CMRR）指标，如果这个参数给得很保守，那这颗ADC的差分多半是噱头。

5.2 PGA增益不是越高越好

不少高精度ADC内置了可编程增益放大器（PGA），增益从1到128，甚至更高。PGA确实可以把小信号直接放大，省去外部调理电路，但高增益会同时放大前端噪声、基准噪声和自身失调，并不总是划算。

我的习惯是：能靠后级软件算法配合低增益解决的，不轻易开高增益。因为高增益档位下，ADC带宽通常会下降，ENOB也可能变差，而且校准失调的难度会变大。通常我只用32倍以内的增益，绝大多数场景8到16倍就够用了，配合外部低噪声放大器做第一级调理，效果更可控。

5.3 驱动放大器的建立时间：最容易翻车的环节

ADC在采样时刻会有采样电容和开关网络，瞬间抽取电荷。如果信号源阻抗比较高，比如几十千欧的高阻传感器直接连ADC输入端，采样电容来不及充电，转换结果就会出现建立误差。

解决办法是加一级低阻抗驱动运放，但运放也不是随便选的。核心指标是两个：输出建立时间要足够短，带内噪声要足够低。

经验值我给2到3倍裕量：如果ADC采样时间是500ns，那驱动运放的建立时间最好在200ns以内，让它能在采样窗口内把电压稳到所需精度。我见过有人用了一颗经典精密运放，直流精度很不错，但增益带宽积和建立时间根本不够，10kHz采样率下建立误差就占了1个LSB@18bit。换了一颗合适的高速低噪声运放后，实测噪声性能立刻提升。

5.4 抗混叠滤波器的度怎么把握

对SAR ADC来说，抗混叠滤波器是刚需，但RC时间常数不能太慢，否则采样时电压还没稳定。对Delta-Sigma ADC来说，内部过采样和数字滤波已经天然削弱了混叠风险，抗混叠要求相对宽松，主要用来滤掉带外强干扰。

一个常用的做法是在驱动运放和ADC之间放一个一阶RC低通，截止频率取采样率的5到10倍。这样既能压掉部分高频干扰，又不会明显拖慢建立时间。如果是电力环境里的高电磁干扰场景，可以再加一级有源滤波器，但要重新评估建立时间，整个信号链会变“钝”。

6. 完整选型流程与避坑清单：把理论变成能落地的决策

最后我把自己目前固定使用的选型流程和踩坑清单整理出来，照着走基本能避开大部分问题。

6.1 从需求表到候选芯片的七步流程

1. 填好需求表，明确精度、采样率、通道数、接口、温区、功耗这六个硬条件。
2. 在原厂选型工具里用“有效位数或SINAD”和“采样率”两个维度做初筛。
3. 拿到候选芯片后，打开数据手册第一页特性概要，核对ENOB、INL、DNL、PGA范围、参考电压要求。
4. 翻到“典型性能曲线”部分，重点看噪声随增益或带宽变化的曲线，以及温漂曲线。
5. 检查参考电路和应用笔记，确认有完整的驱动、基准和电源去耦参考设计。
6. 申请评估板或者用厂家提供的在线仿真工具，实测零输入噪声和已知信号源下的失真表现。
7. 输出选型对比表，从性能、成本、供货、封装难度五个维度做最终决策。

6.2 高精度ADC选型中我踩过的几个坑

• 只看位数不看ENOB，结果系统有效精度远低于预期。
• 忽略基准温漂，25°C调好的系统一过温就漂到天边。
• 多通道轮询时只看了单通道数据速率，没算建立时间，实际吞吐率腰斩。
• 前端放大器随便选，直流精度够但建立时间不够，带宽一上来误差就变大。
• 没检查参考输入抽取电流，常规基准直接被拉出周期性纹波。
• 布局时模拟地和数字地处理草率，高精度ADC的性能被地噪声吃掉大半。

6.3 评估板上必做的三个验证测试

选型阶段的实测验证不能省。我会在评估板上固定做三个测试：

• 零输入噪声测试：把输入端短接或接地，连续采样10k个点，统计输出码的分布标准差，换算成有效位数。
• 线性度扫描测试：用精密信号源从0到满量程扫描几十个点，看INL是否跟手册一致。
• 长时间漂移测试：在温控环境下连续记录24小时，观察输出码的漂移趋势，判断是否存在热循环导致的迟滞。

这三个测试做完，基本能判断一颗ADC在真实系统里的表现能不能接近手册指标。如果第一项测试的有效位数就比手册ENOB低很多，那大概率是评估板供电或者驱动电路的问题，先别急着怀疑芯片。

6.4 一点体会

高精度ADC选型这件事，表面上是选一颗芯片，实际上是在为整个模拟信号链定基调。ADC后面所有去耦、基准、驱动、布局，都是围绕这颗芯片的参数特征展开的。把ENOB、INL、DNL、温漂这些参数吃透，把需求表填清楚，选型就不容易跑偏。

我做那个24位ADC项目时，问题最后定位到一半来自基准源噪声，一半来自前端电源纹波，跟ADC本身关系反而不大。重新调整后系统ENOB从17位提到20位以上。从那以后我养成了一个习惯：每次选型都先问自己一句“这颗芯片在系统里，到底哪个参数才是真正的瓶颈？”想清楚这个问题，选型文档翻起来要快得多。