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1. 从“导通”到“开关”：MOS管到底在电路里扮演什么角色

很多人第一次接触MOS管，是在一块开关电源板或者电机驱动板上。看到三个引脚、一个散热片，心里想的是“这不就是个电子开关吗”。但真把它焊上去，问题就来了：为什么栅极加电压了，漏极和源极之间还是不通？为什么它发热比我预想的严重得多？为什么关断的时候总有尖峰？

这些问题的根源，都在于把MOS管当成了一个理想开关。实际上，MOS管是一个电压控制型器件，它的导通与关断，靠的是栅极电压在半导体内部建立起导电沟道。这个沟道不是瞬间形成的，也不是没有代价的。栅极和沟道之间隔着一层极薄的氧化层，形成了一个电容结构，这就是寄生电容的来源。你要让沟道形成，就得给这个电容充电；你要让它消失，就得把电荷放掉。充放电都需要时间，也需要驱动电流。

所以，MOS管在电路里的真实角色，更像是一个带电容负载的受控电阻。导通时它呈现一个很小的电阻，叫导通电阻Rds(on)；关断时它呈现一个很大的电阻，但中间还夹着一堆寄生电容在捣乱。你给栅极的信号，本质上是在控制这个电阻的阻值，而不是在控制一个机械触点的开合。

理解这一点，后面所有的驱动设计、损耗计算、死区时间选择，才有落脚点。否则你看到的永远是一堆公式和波形，不知道它们为什么长那样。

1.1 三个引脚的真实身份：栅极、漏极、源极

MOS管的三个引脚，名字听起来很抽象，但它们的职责非常明确。

栅极（Gate）是控制端。它不流过主电流，只负责建立电场。你可以把它想象成水龙头的旋钮，旋钮本身不出水，但它决定了水流的大小。栅极的关键参数是栅极阈值电压Vgs(th)和栅极电荷Qg。Vgs(th)告诉你至少要加多少电压才能开始形成沟道，Qg告诉你每次开关需要给栅极充多少电荷。

漏极（Drain）和源极（Source）是主电流的通道。对于N沟道MOS管，电流从漏极流向源极，前提是栅极电压比源极电压高出Vgs(th)以上。这里有一个容易被忽略的细节：源极的电位不是固定的。在很多开关电路中，源极接在负载下端或者地线上，但一旦MOS管导通，源极电位就会被拉高，导致实际的Vgs变小。这就是为什么高边驱动需要专门的电荷泵或者自举电路。

对于P沟道MOS管，极性反过来，栅极电压低于源极电压时导通。P管通常用在高边开关场合，因为它的源极可以固定在电源正极，驱动起来相对简单。但P管的导通电阻通常比同规格的N管大，价格也贵一些，所以在大电流场合，工程师还是倾向于用N管加自举驱动。

1.2 导通条件的本质：Vgs大于Vgs(th)只是起点

数据手册上写的Vgs(th)通常是一个范围，比如2V到4V。很多新手看到这个参数，就以为栅极加3V就能完全导通。实际上，Vgs(th)只是开始形成沟道的临界点，这时候沟道很薄，导通电阻很大，管子会严重发热。

真正要让MOS管进入完全导通状态，Vgs需要达到数据手册中Rds(on)测试条件所规定的电压，通常是10V或者4.5V（逻辑电平MOS管）。在这个电压下，沟道充分展开，Rds(on)降到标称值。如果你只给3.3V，而管子是标准10V驱动的型号，Rds(on)可能是标称值的几倍甚至十几倍，损耗自然就上去了。

所以选型的时候，第一件事是看Rds(on)对应的Vgs是多少。如果是单片机直接驱动，必须选逻辑电平MOS管，也就是Vgs=4.5V或2.5V时Rds(on)仍然很低的型号。否则中间必须加一级驱动芯片。

1.3 寄生电容：开关速度的隐形天花板

MOS管内部有三个主要的寄生电容：Ciss（输入电容）、Coss（输出电容）、Crss（反向传输电容，也叫米勒电容）。

Ciss是栅极和源极之间的电容加上栅极和漏极之间的电容，它决定了每次开关需要充多少电荷。Coss是漏极和源极之间的电容，它影响关断时的电压尖峰。Crss是栅极和漏极之间的电容，它是米勒效应的罪魁祸首。

米勒效应是什么？简单说，在MOS管开通的过程中，漏极电压从高变低，这个变化会通过Crss耦合到栅极，把栅极电压“拽”住，形成一个平台期。在这个平台期内，栅极电压几乎不变，但漏极电流和漏极电压同时在变化，管子处于线性放大区，损耗非常大。平台期越长，开关损耗越大。

这就是为什么驱动电路不能只看直流电压，还要看驱动电流。驱动电流越大，给Crss充放电越快，平台期越短，开关损耗越小。但驱动电流太大也有副作用，后面会细说。

2. 驱动电路设计：从单片机IO到栅极之间的那道坎

单片机IO口直接驱动MOS管栅极，是很多初学者踩的第一个坑。IO口输出高电平3.3V或5V，看起来能超过Vgs(th)，但实际效果往往很差。原因有两个：一是IO口的输出电流能力有限，通常只有几十毫安，给栅极电容充电太慢；二是IO口的高电平电压不够，标准MOS管需要10V才能完全导通。

所以，驱动电路的核心任务就两个：提供足够的电压，让MOS管完全导通；提供足够的瞬时电流，让栅极电容快速充放电。

2.1 为什么需要驱动芯片：电流能力的硬性要求

栅极驱动电流可以用一个简单公式估算：

I_drive = Qg / t_sw

其中Qg是栅极总电荷，t_sw是你希望的开关时间。假设一个MOS管的Qg是50nC，你希望开关时间控制在100ns以内，那么驱动电流至少需要500mA。单片机IO口那点电流，差了一个数量级。

驱动芯片的作用，就是把控制信号放大成大电流、合适电压的栅极驱动信号。常见的驱动芯片有单通道、双通道、半桥、全桥等不同拓扑。选型的时候主要看几个参数：峰值输出电流、工作电压范围、传播延迟、死区时间控制能力。

比如德州仪器的UCC27524，峰值输出电流5A，传播延迟只有十几纳秒，适合高频开关场合。而一些光耦隔离驱动芯片，虽然隔离性能好，但传播延迟在微秒级别，只能用在低频场合。

2.2 自举电路：高边N沟道MOS管的驱动方案

高边N沟道MOS管的源极不接地，而是接在负载和电源之间。导通时源极电位接近电源电压，这时候栅极电压必须比电源电压还高，才能维持Vgs大于Vgs(th)。自举电路就是用来产生这个高于电源的电压的。

自举电路的核心是一个自举电容和一个自举二极管。当低边MOS管导通时，高边MOS管的源极被拉到地，自举电容通过自举二极管从电源充电，电容两端电压接近电源电压。当低边关断、高边需要导通时，自举电容的下端（接高边源极）电位升高，上端（接高边栅极）电位被“顶”到电源电压加上电容电压，从而提供足够的Vgs。

自举电容的容量选择很关键。太小了，开关过程中电荷不够，Vgs会跌落；太大了，充电时间变长，低频时可能来不及充满。经验公式是：

C_boot > 10 × Qg / ΔV

其中ΔV是你允许的自举电压跌落，通常取0.5V到1V。比如Qg=50nC，ΔV=0.5V，那么C_boot至少需要1μF。实际选型时还要考虑电容的耐压和温度特性，一般用X7R或X5R陶瓷电容。

自举二极管要选快恢复二极管，反向恢复时间要短，否则在高频开关时会产生额外的损耗和噪声。耐压要高于电源电压，电流能力要满足自举电容的充电需求。

2.3 栅极电阻：不是随便放一个就行

栅极电阻Rg的作用，是限制栅极充放电电流，从而控制开关速度。Rg太小，开关太快，会产生严重的电压尖峰和电磁干扰；Rg太大，开关太慢，开关损耗增加。

选Rg的时候，先确定你想要的开关时间。假设驱动电压Vdrive，栅极电荷Qg，那么：

Rg ≈ Vdrive × t_sw / Qg

但这个公式只考虑了栅极电荷，实际电路中还有驱动芯片内阻、PCB走线电感等因素。所以Rg通常从一个较大值开始试，比如10Ω，然后逐步减小，同时观察漏极电压波形和管子温度。如果漏极电压有严重振铃，说明开关太快，需要增大Rg；如果管子发热严重，说明开关太慢，需要减小Rg。

还有一个细节：开通和关断可以用不同的Rg。开通时慢一点，可以减小电压尖峰；关断时快一点，可以减小关断损耗。实现方法是在Rg两端反并联一个二极管，或者用两个电阻分别串联二极管再并联。

2.4 米勒效应下的驱动电流计算

前面提到米勒平台期，这个阶段栅极电压不变，但驱动芯片仍然需要输出电流，因为Crss在充放电。这个电流叫米勒电流，大小取决于漏极电压变化率：

I_miller = Crss × dVds/dt

假设Crss=100pF，漏极电压在100ns内从100V降到0V，那么dVds/dt=1000V/μs，I_miller=100mA。如果驱动芯片的峰值电流只有200mA，那么大部分电流都被米勒电流占用了，栅极电压上升会更慢，平台期更长。

所以选驱动芯片的时候，峰值电流要留足余量，至少是米勒电流的3到5倍。这也是为什么高频大功率场合，驱动芯片的电流能力往往要好几安培。

3. 损耗计算与热设计：MOS管为什么会烫

MOS管的损耗主要分两部分：导通损耗和开关损耗。导通损耗是管子导通时，电流流过Rds(on)产生的热量；开关损耗是管子在开通和关断过程中，同时承受电压和电流产生的热量。

很多人在选型时只看Rds(on)，觉得越小越好，结果发现管子还是烫。原因就是忽略了开关损耗，或者开关损耗因为驱动设计不当而变得很大。

3.1 导通损耗：Rds(on)随温度变化的陷阱

导通损耗的计算公式很简单：

P_cond = I_rms² × Rds(on) × D

其中I_rms是漏极电流有效值，D是占空比。但这里有一个关键点：Rds(on)会随温度升高而增大。数据手册上的Rds(on)通常是在25°C下测的，实际工作时结温可能到100°C甚至更高，这时候Rds(on)可能是25°C时的1.5倍到2倍。

所以计算导通损耗时，要用热态下的Rds(on)。数据手册里通常会有一个曲线图，显示Rds(on)随结温的变化。如果没有，可以按1.5倍保守估算。比如25°C时Rds(on)=10mΩ，100°C时按15mΩ算。

还有一个容易忽略的点：占空比D。在PWM电路中，MOS管不是一直导通的，导通损耗要乘以占空比。但在一些持续导通的场合，比如负载开关，D=1，这时候导通损耗就是全部。

3.2 开关损耗：米勒平台期的能量去了哪里

开关损耗的计算稍微复杂一些。开通损耗和关断损耗可以分别估算：

P_sw_on = 0.5 × Vds × Id × t_on × f_sw P_sw_off = 0.5 × Vds × Id × t_off × f_sw

其中t_on和t_off是开通和关断时间，f_sw是开关频率。这个公式假设电压和电流是线性变化的，实际波形可能更复杂，但用来估算足够了。

关键问题是：t_on和t_off怎么确定。它们取决于驱动电流、栅极电荷、米勒电容。前面说的米勒平台期，就是开关损耗的主要来源。在平台期内，漏极电压在变，漏极电流也在变，管子同时承受高电压和大电流，瞬时功率很大。

减小开关损耗的方法有几个：增大驱动电流，缩短平台期；降低开关频率，减少开关次数；选用Qg和Crss更小的MOS管；在漏极和源极之间加吸收电路，减小电压尖峰，但吸收电路本身也会消耗能量。

3.3 热阻与散热片选型：从结温反推散热需求

知道了总损耗P_total，下一步是算结温：

T_j = T_a + P_total × R_th(j-a)

其中T_a是环境温度，R_th(j-a)是从结到环境的总热阻。总热阻包括结到壳R_th(j-c)、壳到散热片R_th(c-s)、散热片到环境R_th(s-a)。数据手册里通常给出R_th(j-c)和R_th(j-a)（无散热片时）。

如果T_j算出来超过150°C，就必须加散热片。散热片的选型，是根据你允许的T_j反推R_th(s-a)：

R_th(s-a) < (T_j_max - T_a) / P_total - R_th(j-c) - R_th(c-s)

其中R_th(c-s)是管子壳和散热片之间的接触热阻，加导热硅脂的话大约0.5°C/W到1°C/W，不加的话可能到2°C/W以上。

实际选散热片的时候，还要考虑风冷还是自然冷却。自然冷却的散热片热阻通常比较大，需要更大的表面积；风冷可以显著降低热阻，但需要风扇，增加了成本和噪声。

3.4 实测损耗与仿真验证：LTspice自己建MOS模型

理论计算之后，最好用仿真验证一下。LTspice是一个免费的电路仿真工具，自带一些MOS模型，但有时候你需要自己建模型。

自己建MOS模型，需要从数据手册里提取几个关键参数：Vgs(th)、Rds(on)、Ciss、Coss、Crss、Qg。LTspice的MOS模型卡里，这些参数都有对应的字段。比如Ciss对应Cgs+Cgd，Coss对应Cds+Cgd，Crss对应Cgd。

建好模型后，搭一个简单的开关电路，加上驱动信号和负载，跑瞬态仿真。观察漏极电压、漏极电流、栅极电压波形，然后计算损耗。LTspice可以直接对电压和电流的乘积积分，得到能量，再除以周期就是功率。

仿真结果和理论计算会有偏差，因为仿真模型不可能完全准确，PCB寄生参数也没有考虑进去。但仿真可以帮助你快速比较不同方案，比如不同Rg值、不同驱动电压下的损耗差异。

4. 典型应用电路拆解：从开关电路到RS485自收发

MOS管的应用场景非常广，从简单的负载开关到复杂的电机驱动，从电源转换到通信接口。这里挑几个有代表性的电路，拆解一下设计要点。

4.1 低边开关电路：最简单也最容易出问题

低边开关是MOS管最基本的用法：源极接地，漏极接负载，负载另一端接电源。栅极加高电平，管子导通，负载得电。

这个电路看起来简单，但有几个坑：

第一，栅极电阻不能省。没有Rg，栅极电容充放电电流不受限制，可能超过驱动芯片的峰值电流，导致驱动芯片过热或者损坏。Rg一般取10Ω到100Ω，具体看开关频率和驱动能力。

第二，栅极下拉电阻必须有。在驱动信号消失或者悬空时，栅极电压不确定，管子可能误导通。加一个10kΩ到100kΩ的下拉电阻到地，确保栅极电压为0时管子可靠关断。

第三，感性负载要加续流二极管。如果负载是继电器、电磁阀、电机等感性负载，关断时电感会产生反向电动势，可能击穿MOS管。在负载两端反并联一个快恢复二极管，给电感电流提供续流路径。

第四，注意源极电位变化。低边开关的源极接地，电位固定，驱动简单。但如果负载电流很大，PCB走线电阻会导致源极电位略微升高，实际Vgs变小。所以源极走线要尽量短、尽量粗。

4.2 高边开关电路：P管还是N管加自举

高边开关的负载一端接地，MOS管在电源和负载之间。这时候用N管的话，源极电位接近电源电压，需要自举电路或者隔离电源来驱动栅极。用P管的话，源极接电源正极，栅极拉低就导通，驱动简单，但P管的Rds(on)通常比同规格N管大，价格也贵。

选择哪种方案，主要看电流大小和成本敏感度。小电流场合，比如几十毫安到几百毫安，用P管直接驱动，简单省事。大电流场合，比如几安培以上，用N管加自举驱动，虽然电路复杂一点，但损耗更低，长期来看更划算。

自举电路的设计要点前面已经说了，这里补充一个：自举电容的耐压要足够。自举电容两端电压接近电源电压，但高边导通时，电容下端电位升高，上端电位更高，所以电容承受的电压是电源电压加上Vgs驱动电压。比如电源12V，驱动电压10V，自举电容耐压至少要25V，实际选50V更稳妥。

4.3 MOS搭建的RS485自收发电路：230400波特率下的时序考量

RS485通信是工业现场常用的差分通信方式，半双工，收发共用一对差分线。传统的RS485收发器芯片有一个DE（发送使能）引脚，需要单片机控制收发切换。用MOS管搭建自收发电路，可以利用发送数据本身来自动控制收发切换，省掉一个IO口。

这个电路的核心思路是：发送时，数据线上的电平变化通过MOS管控制收发器的DE引脚。具体来说，发送数据空闲时为高电平，MOS管导通，DE拉低，收发器处于接收状态；发送数据起始位为低电平，MOS管关断，DE被上拉电阻拉高，收发器进入发送状态。

在230400波特率下，位宽大约是4.3μs。MOS管的开关速度必须远快于这个时间，否则收发切换会滞后，导致数据丢失或者波形畸变。所以MOS管要选Qg小、开关快的型号，栅极电阻要小，上拉电阻也不能太大，否则DE引脚上升沿太慢。

实测中，230400波特率下，MOS管的开关延迟要控制在几百纳秒以内。如果发现通信误码率高，先用示波器看DE引脚的波形，确认收发切换是否及时。如果DE上升沿太慢，减小上拉电阻；如果DE下降沿太慢，减小栅极电阻。但上拉电阻太小会增加功耗，栅极电阻太小会增加EMI，需要折中。

还有一个细节：RS485差分线的偏置电阻。在空闲状态下，差分线需要有一个确定的电平，通常用两个偏置电阻把A线拉高、B线拉低。偏置电阻的阻值要合适，太小了增加功耗，太大了抗干扰能力差。一般取560Ω到1kΩ。

4.4 逆变器碳化硅MOS吸收电路设计：从硅到碳化硅的跨越

碳化硅MOS管相比硅MOS管，开关速度更快、耐压更高、导通电阻更低，在逆变器、光伏、电动汽车等场合越来越受欢迎。但碳化硅MOS管的开关速度太快，带来的电压尖峰和电磁干扰也更严重。

吸收电路的作用，就是吸收开关过程中的能量，抑制电压尖峰。常见的吸收电路有RC吸收、RCD吸收、C吸收等。

RC吸收是最简单的：在MOS管的漏极和源极之间并联一个电阻和一个电容串联。电容吸收尖峰能量，电阻消耗能量。RC吸收的参数选择，要根据开关频率、漏极电流、寄生电感来定。经验公式是：

C_snubber = I_pk × t_f / V_clamp R_snubber = V_clamp / I_pk

其中I_pk是漏极峰值电流，t_f是关断时间，V_clamp是你允许的最大电压。比如I_pk=10A，t_f=20ns，V_clamp=50V，那么C_snubber=4nF，R_snubber=5Ω。

RCD吸收比RC吸收多一个二极管，可以减少电阻上的功耗。二极管在关断时导通，把尖峰能量存到电容里；开通时二极管截止，电容通过电阻放电。这样电阻只在开通时消耗能量，关断时的能量被电容吸收，效率更高。

碳化硅MOS管的吸收电路设计，还要考虑寄生电容的影响。碳化硅MOS管的Coss比硅管小，但开关速度更快，dV/dt更大，所以对吸收电路的要求更高。实际调试时，先用示波器看漏极电压波形，如果尖峰超过额定电压的80%，就必须加吸收电路。

5. 那些数据手册不会告诉你的实操细节

数据手册给了你参数，但没告诉你这些参数在实际电路中怎么表现。下面这些经验，都是踩过坑之后总结出来的。

5.1 开尔文接法：为什么源极要走单独的一根线

开尔文接法，也叫四线制接法，核心思想是把大电流路径和驱动回路分开。MOS管的源极引脚，既流过主电流，又是驱动回路的参考点。如果主电流在源极引脚上产生压降，驱动回路的Vgs就会受到影响。

开尔文接法的做法是：从MOS管的源极焊盘单独引出一根线，接到驱动芯片的地，这根线不流过主电流。这样驱动回路的参考点就是源极焊盘的真实电位，不受主电流路径压降的影响。

在大电流、高频率场合，开尔文接法可以显著改善开关性能，减少误导通和损耗。很多MOS管的数据手册里会标注“Kelvin Source”引脚，就是专门为开尔文接法设计的。

5.2 死区时间：不是越大越安全

死区时间是在半桥或全桥电路中，上下两个MOS管都关断的一段时间。目的是防止上下管同时导通，造成直通短路。但死区时间太大，会增加损耗，因为死区期间电流通过体二极管续流，体二极管的正向压降比MOS管导通电阻上的压降大得多。

死区时间的选择，要刚好覆盖上下管的开关时间。如果上管关断需要100ns，下管开通需要50ns，那么死区时间至少150ns。实际取值要留一些余量，比如200ns到300ns。

但死区时间也不是固定不变的。温度变化、驱动电压波动、器件老化都会影响开关时间。所以设计时要留足够的余量，同时用示波器实测上下管的栅极电压波形，确认没有重叠。

5.3 体二极管：什么时候它会要你的命

MOS管内部有一个体二极管，从源极指向漏极。在大多数开关电路中，体二极管是反向偏置的，不导通。但在某些场合，体二极管会导通，带来问题。

比如在半桥电路中，死区期间，电感电流通过下管的体二极管续流。体二极管的正向压降大约是0.7V到1V，比MOS管导通时的压降大得多，所以死区期间的损耗很大。而且体二极管的反向恢复特性比较差，关断时会产生尖峰和噪声。

在同步整流电路中，体二极管的问题更突出。同步整流用MOS管代替整流二极管，利用MOS管的低导通电阻减小损耗。但如果死区时间没控制好，体二极管会先导通，然后MOS管才导通，体二极管的反向恢复会导致额外的损耗和噪声。

解决办法是尽量减小死区时间，或者用没有体二极管的MOS管（比如某些碳化硅MOS管），或者用并联肖特基二极管来分流体二极管电流。

5.4 栅极振荡：驱动电阻和PCB布局的配合

栅极振荡是MOS管开关过程中常见的现象，表现为栅极电压波形上有高频振铃。原因是栅极回路存在电感，和栅极电容形成了LC振荡。

栅极回路的电感，主要来自PCB走线和驱动芯片内部。走线越长、越细，电感越大。所以驱动芯片要尽量靠近MOS管栅极，走线要短、要粗。

栅极电阻Rg可以阻尼振荡，但Rg太大会增加开关损耗。所以要在振荡和损耗之间折中。如果Rg已经减到很小，振荡仍然严重，那就要检查PCB布局，看看栅极回路面积是不是太大了。

还有一个技巧：在栅极和源极之间并联一个小电容，比如100pF到1nF，可以吸收高频振荡。但这个电容会增加栅极电荷，影响开关速度，所以只在振荡严重时使用。

5.5 并联MOS管：均流问题比你想的复杂

在大电流场合，单个MOS管可能不够，需要并联使用。并联MOS管的核心问题是均流。如果两个MOS管参数不一致，或者PCB布局不对称，电流会偏向其中一个管子，导致它过热甚至损坏。

均流的关键是让每个MOS管的驱动回路和主电流回路尽量对称。驱动电阻要各自独立，不能共用一个电阻。PCB布局要对称，源极走线要等长。最好用同一批次的MOS管，参数一致性更好。

还有一个技巧：在源极串联一个小电阻，比如几毫欧，可以强制均流。但这个电阻会增加损耗，所以只在均流要求高的场合使用。

温度也会影响均流。MOS管的Rds(on)随温度升高而增大，所以温度高的管子电流会减小，有一定的自均流效果。但如果两个管子温度差异太大，自均流效果就不明显了。所以并联MOS管要共用散热片，让温度尽量一致。

6. 选型与验证：从需求到量产的最后一步

选型不是看哪个参数好就选哪个，而是要根据实际需求来权衡。下面是一套从需求到验证的完整流程。

6.1 从电压电流反推MOS管规格

第一步是确定最大漏极电压Vds。在开关电路中，关断时漏极电压会有一个尖峰，通常是电源电压的1.5倍到2倍。所以MOS管的额定Vds要大于这个尖峰电压。比如电源48V，尖峰可能到80V，那么MOS管额定Vds至少100V。

第二步是确定最大漏极电流Id。这个电流包括负载电流和尖峰电流。MOS管的额定Id通常是在壳温25°C下的值，实际工作时壳温可能到80°C甚至更高，额定Id要打折。一般按额定Id的50%到70%来使用。

第三步是确定Rds(on)。根据允许的导通损耗和最大电流，反推Rds(on)：

Rds(on) < P_cond_allow / (I_rms² × D)

其中P_cond_allow是你允许的导通损耗，I_rms是漏极电流有效值，D是占空比。算出来的Rds(on)要对应实际工作结温下的值，不是25°C下的值。

第四步是确定栅极电荷Qg和电容。开关频率越高，Qg和电容的影响越大。高频场合要选Qg小、Coss小的型号，比如碳化硅MOS管或者超级结MOS管。

6.2 驱动芯片选型：峰值电流、传播延迟、死区控制

驱动芯片的选型，主要看几个参数：

峰值输出电流：要大于米勒电流的3到5倍。前面算过，米勒电流可能到几百毫安，所以驱动芯片峰值电流至少1A。

传播延迟：包括开通延迟和关断延迟。高频场合要选传播延迟小的，比如几十纳秒。低频场合可以放宽。

死区控制：半桥和全桥驱动芯片通常有内置死区控制，可以设置死区时间。如果没有内置，就要用单片机或者外部逻辑来产生死区。

隔离能力：如果驱动回路和主回路需要隔离，就要选隔离驱动芯片，比如光耦隔离或者磁隔离。隔离驱动芯片的传播延迟通常比非隔离的大，选型时要注意。

保护功能：一些驱动芯片有欠压锁定、过流保护、过热保护等功能，可以提高系统可靠性。但保护功能也会增加成本和复杂度，根据实际需求选择。

6.3 实测波形分析：从振铃到平台期的判读

实测波形是验证设计的最直接手段。用示波器看栅极电压、漏极电压、漏极电流三个波形，可以判断很多问题。

栅极电压波形：看上升沿和下降沿是否干净，有没有振铃。如果有振铃，说明栅极回路电感太大，或者Rg太小。看平台期是否明显，平台期越长，开关损耗越大。

漏极电压波形：看关断时的尖峰有多高，有没有振铃。尖峰超过额定Vds的80%就要加吸收电路。看开通时的下降沿是否干净，有没有米勒平台导致的延迟。

漏极电流波形：看开通和关断时的电流变化率，有没有尖峰。电流尖峰通常来自寄生电容的充放电，或者体二极管的反向恢复。

把三个波形放在一起看，可以计算开关损耗。开通时，漏极电压下降和漏极电流上升的交叠面积，就是开通损耗；关断时，漏极电压上升和漏极电流下降的交叠面积，就是关断损耗。

6.4 批量一致性：从样品到量产的坑

样品测试通过，不代表批量生产没问题。批量生产中，器件参数分散性、PCB工艺偏差、焊接质量都会影响性能。

器件参数分散性：不同批次的MOS管，Vgs(th)、Rds(on)、Qg都有差异。如果设计余量不足，某些批次的管子可能发热严重或者开关异常。所以设计时要留足够的余量，关键参数按最坏情况计算。

PCB工艺偏差：走线宽度、铜厚、过孔质量都会影响寄生电感和电阻。批量生产时，PCB厂的工艺能力可能有波动，导致某些板子的开关性能变差。所以PCB设计要留足够的余量，关键走线要加粗。

焊接质量：MOS管的散热焊盘焊接不良，会导致热阻增大，结温升高。批量生产时，要检查焊接质量，比如用X光检查焊点空洞率。空洞率太高的话，热阻会显著增大。

测试覆盖：批量生产时，要对每块板子做功能测试和老化测试。功能测试检查开关是否正常，老化测试检查长时间工作下的温升和稳定性。老化测试通常跑几个小时到几十个小时，可以暴露一些潜在问题。

7. 写在最后：一些零散但有用的经验

MOS管这个东西，说复杂也复杂，说简单也简单。核心就是理解它的电容特性，设计好驱动电路，控制好损耗和温升。但实际调试中，总会遇到一些意想不到的问题。

比如有一次，我用一个逻辑电平MOS管做负载开关，单片机IO口直接驱动，电路很简单，但批量生产后发现有些板子发热严重。查了半天，发现是IO口的高电平电压不一致，有些单片机的高电平只有2.8V，而MOS管的Vgs(th)最大是2.5V，导致管子没有完全导通。后来在IO口和栅极之间加了一个三极管做电平转换，问题才解决。

还有一次，做半桥电路，死区时间设了500ns，觉得够安全了。结果高温测试时，上下管还是直通了。后来发现，高温下MOS管的关断时间变长了，500ns不够。把死区时间加到1μs，问题解决。所以死区时间要按最高工作温度下的开关时间来算，不能按常温。

这些经验，数据手册上不会写，仿真也仿不出来，只能在实际项目中慢慢积累。希望这篇内容能帮你少走一些弯路。