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干电源设计的人，多少都有过这样的经历：原理图画完，板子打样回来，一上电发现输出电压振荡、纹波大得离谱，或者轻载时啸叫。我早期就是这么过来的，后来把DC/DC电源模拟技术当成正式工具，而不是“仿真玩一下”，整个开发节奏才变了。所谓DC/DC电源模拟，简单说就是在不焊板子的情况下，把变换器拓扑、控制环路、寄生参数、甚至热特性搬到软件里先跑一遍。拿Buck、Boost、Buck-Boost、反激这些常见拓扑来说，模拟能帮你提前回答“占空比选多少合理”“补偿网络要不要加”“电感饱和电流留多大余量”这类问题。这套思路不只适用于DC/DC，AC/DC的功率级同样能套用。下面我会把这几年的实战经验整理出来，从原理到工具，从搭建模型到查错，尽量讲得能让你直接照着做。

1. DC/DC电源模拟到底在模拟什么

1.1 模拟不是一个“玄学”，而是四个尺度

很多人听到“电源模拟”就以为是在电脑里搭个电路看波形，这其实只抓住了最浅的一层。我用下来的理解是，DC/DC电源模拟至少包含四个互相关联的尺度。第一个是拓扑级，验证最基本的电压转换关系、占空比、电感电流连续还是断续；第二个是控制环路级，验证补偿网络是否能在不同负载下保持稳定；第三个是寄生参数级，把PCB走线、器件封装、驱动回路等寄生因素放进去，看真实波形和效率会受多大影响；第四个是系统级，包括热仿真、EMI预估、多路电源上电时序、甚至整机供电树的阻抗分析。

这四个尺度不是互相独立的。比如拓扑级觉得电感选小了，到了环路级可能发现电流纹波太大导致输出噪声超标；而寄生参数级加的snubber吸收电路，又会反过来影响环路模型的增益。所以我的建议是：不要指望一次仿真解决所有问题，而是根据当前阶段选对尺度。早期概念阶段，用理想模型快速验证；临近画板时，把寄生参数和PCB布局影响加进去；真要量产，再跑热和EMI相关仿真。用这种方式，仿真才不是摆设。隔离型的反激、ACF反激也一样，在仿真里加上变压器模型和漏感参数，VDS尖峰、振铃都会暴露出来，处理起来比单靠经验猜测要直观得多。

1.2 为什么要先模拟再打样

我见过不少工程师觉得仿真浪费时间，尤其是一些硬件老手，习惯凭经验选参数直接画板。但说实话，一次打样和返工的成本，足够做几十轮仿真了。更关键的是，很多电源问题在实验室里非常难排查，比如环路不稳定带来的振荡，你可能测了好几天都找不到原因，而仿真里可以直接看内部节点波形，一秒定位到补偿电容选小了。

我用一个真实对比来说明：早期做一个24V转12V的Buck，为了省时间没仿真，板子回来轻载就啸叫，输出纹波高达100多mV。后来我重新在仿真里加入输出电容ESR和环路模型，发现相位裕量不到20度，属于典型的补偿参数不对。调了补偿网络后，再打样一次就通过。从那以后，我养成了习惯：不管多简单的DC/DC，至少先做开环波形仿真和负载阶跃仿真，再进入原理图正式设计。这个流程看着多花了半天时间，实际上省掉的返工周期可能是一周。

2. 常用模拟工具与建模思路

2.1 工具怎么选：别总盯着某一个

DC/DC电源模拟的软件很多，但各有侧重，不可能一个工具通吃。我用过的工具里，LTspice属于免费又普及的那一类，适合做通用电路仿真，器件的官方模型也往往先发在这上面，缺点是收敛性有时候让人头疼，而且做环路扫频需要额外的设置。Simetrix/Simplis是电源工程师更偏爱的工具之一，Simplis在大信号开关仿真上速度很快，但也要看个人习惯。PSIM在做控制策略、特别是数字电源验证时很方便，很多基于STM32的数字电源项目，前期都用它搭控制模型。PLECS把热和系统级仿真做得很顺手，适合做损耗估算和系统集成。

我简单整理了几款常用工具的特点，大家可以按项目阶段选型。

工具选型不是越贵越好，而是看你的瓶颈在哪。如果只是评估一个简单Buck方案，LTspice就够用；如果要做严谨的环路稳定性分析，Simplis这类带小信号扫频功能的工具会更顺手；如果是做数字电源算法，那就优先考虑PSIM或者Matlab Simulink。别把时间花在折腾工具上，目标是让仿真服务于设计。

2.2 建模时最容易忽视的三个环节

工具选好只是起步，模型建得准不准才是模拟技术的关键。我碰到的比较典型的问题集中在三个环节：电感模型、电容模型和开关管模型。很多人仿真直接用理想电感，但实际电感有直流电阻DCR、饱和电流和寄生电容。DCR会影响效率和纹波，饱和电流不够会在重载时电流突变。电容方面，输出电容的ESR和ESL对纹波的影响远大于容值本身，这也是很多仿真和实测对不上的原因。开关管模型则要关注导通电阻Rds(on)、栅极电荷Qg、输出电容Coss和体二极管特性。在高压和高速开关场景下，这些参数会显著影响开关损耗和振铃。

一个简单的做法是：仿真初期用厂商提供的SPICE模型，但别直接拿过来就用，先确认模型适用于目标电压、电流和频率范围。拿电感来说，如果供应商没有给出模型，我一般会自己搭一个“理想电感+DCR+并联寄生电容”的等效电路，虽然简单，但仿真结果已经能接近实测了。负载模型也需要注意，常用恒阻负载不适合模拟实际数字负载的瞬态变化，建议至少加一个恒流源加阶跃的组合，看环路动态响应。另外在建模阶段就养成良好的命名习惯，把输入、开关节点、输出、功率地都命名清楚，后面排查问题会省非常多事。

3. 一个完整的Buck电路模拟实操案例

3.1 从24V转12V规格出发：参数怎么算

空谈模型不如来一个实例。我以最常见的24V转12V、2A输出Buck电路为例，开关频率设为200kHz。这个频率不算高，但对学习模拟技术足够了。首先做理想占空比估算：CCM模式下D约等于Vout/Vin，也就是12/24等于0.5，实际要加上开关管压降，会有几个百分点的偏差。然后选电感。以允许电感电流纹波为负载电流的30%来算，ΔI_L等于0.6A，电感最小值可以按下式估算：L = (Vin - Vout) × D / (f × ΔI_L)，代入就是12 × 0.5 / (200k × 0.6) = 50μH，实际取47μH或56μH都可以。电感取值直接影响电流连续程度和环路特性，太小的电感会让电流进入BCM甚至DCM，环路更容易不稳。

输出电容的计算要从两个角度考虑：一个是容值满足电荷平衡，另一个是ESR满足纹波要求。如果要求输出纹波小于50mV，那么ESR最好低于ΔV/ΔI_L，也就是50mV除以0.6A，大约83mΩ。低ESR的MLCC很容易做到，但要注意MLCC在直流偏压下容量会下降，仿真时如果用了标称容值，实测纹波往往会偏大。至于容值，可以用C ≥ ΔI_L / (8 × f × ΔV_ripple)来粗算，这里的ΔV_ripple一般取纹波电压中由电容充放电引起的部分，如果ESR主导就按ESR算。实际设计里，我会把容值适当放大，保证瞬态响应时电压跌落不超过设计限值。完成这些计算后，就可以在仿真软件里搭一个理想Buck电路了。

3.2 从开环到闭环：补偿网络的仿真验证

搭好理想Buck后，先跑开环。给固定占空比，看看稳态输出是否接近12V，电感电流波形是不是连续的三角波。如果波形不对，先检查电感和二极管或同步管的连接极性。开环稳定后，再引入电压反馈和补偿网络。我习惯用Type II补偿，穿越频率取开关频率的1/10左右，也就是20kHz附近，相位裕量至少要45度。这样既能保证动态响应，也能避免噪声和开关频率干扰控制环路。

补偿元件的具体取值可以用中频带增益来算，这里不纠结公式的每一步，仿真里可以直接用参数扫描看输出瞬态。我会在仿真里给负载加一个阶跃，比如从1A跳到2A，观察输出电压跌落幅度和恢复时间。如果跌落大、恢复慢，说明穿越频率偏低；如果波形振荡，说明相位裕量不够。这个调试过程在仿真里非常快，直接改电容电阻参数看趋势就行。等仿真里的阶跃响应满意了，再按相同参数画到原理图里，打样成功率会高很多。这里有个容易骗自己的地方：仿真里的探头点是理想节点，看不到PCB寄生，所以千万别把仿真指标卡得太极限，要留出实测余量。

3.3 让仿真贴近真实：加入寄生参数与PCB布局影响

理想状态跑通只是第一步，真正有价值的是加入寄生参数后再看一次波形。我会在仿真里给开关节点串一个几十nH的走线电感，给输入和输出电压源加上等效串联电感，在MOSFET的栅极串一个驱动电阻，然后重新跑开关波形。这时如果观察开关节点电压，通常会出现振铃和过冲。这个现象可以理解为：PCB走线电感与MOSFET输出电容Coss形成了LC谐振回路，振铃频率大约是1/(2π√(L_parasitic × Coss))。频率越高，越说明是近端寄生造成的，而不是控制环路问题。

解决振铃最常用的办法是加RC吸收电路，也就是常说的snubber。仿真里可以先测量振铃频率，再用经验公式估算snubber电阻和电容。R的取值一般在振铃特征阻抗附近，C则取开关节点寄生电容的2到4倍。把snubber加进仿真后重新看波形，过冲会有明显改善，但效率会略降，这就需要在EMI、效率和损耗之间平衡。这类细节不仿真很难预判，也是我认为DC/DC电源模拟技术最有价值的地方。如果是反激电源，VDS尖峰主要来源于变压器漏感，必须在仿真里加入漏感模型和钳位电路，才能看到跟实测一致的原因。

4. 模拟里的典型坑：仿真报错、收敛失败与GND网络问题

4.1 “电源和地已被连接，请检查GND网络”到底在说什么

很多刚接触仿真的人看到“电源和地已被连接，请检查GND网络”这类报错就懵了。其实这句话通常意味着在你的原理图里，电源符号和地符号在元器件连接逻辑上冲突了，或者不小心把不同属性的地直接短接到了一起。仿真软件不比人脑，它会严格检查每一个网络节点，只要有一个不合理的电源对地连接，就会报“检查GND网络”。

我处理这个方法一般分三步：第一步，打开网表查看器，看哪些元件连接到了GND网络；第二步，确认是不是有两个不同的地符号，比如模拟地和数字地，如果你在DC/DC仿真里把模拟地、功率地都接成同一个GND节点，软件就会认为它们被连接到一起；第三步，检查电源符号，尤其是用了VCC和VDD两种符号，但实际没区分时也会出现类似问题。在DC/DC仿真中，我建议明确分开“输入电源正负”和“控制地功率地”，但仿真模型里通常只需要一个统一的地节点，不要人为制造参考点冲突。

4.2 收敛失败、时间步长过小的问题怎么排查

仿真中途报“算不下去”或者时间步长一缩再缩，也是高频问题。这往往不是电路真的有问题，而是模型数值特性太差。比如电感电流在某个瞬间变化率极大，或者某个开关管的模型内部包含非物理的突变电阻，都有可能让迭代器失败。我常用的几个办法：一是设置初始条件，让仿真从预想的稳态附近开始，用UIC模式跳过初始直流工作点分析；二是给难收敛的节点加一个小电阻到地，比如10MΩ量级，帮助收敛；三是限制最大仿真步长，强制软件在开关动作附近细化时间步；四是换积分算法，比如把默认算法换成Gear或者Trap。

还有一个容易被忽略的坑：仿真时间太短。很多人一开始只跑几十微秒，结果还没达到稳态，看起来像振荡其实是启动过程。我一般会让仿真跑几个毫秒，至少覆盖几个完整的负载阶跃周期，再判断波形是否进入稳定。如果波形一直在缓慢漂移，先检查是否有非常大的时间常数，比如大容量输出电容和极高阻抗反馈网络造成的慢启动。仿真报错不是绕不过去的坎，绝大多数情况都是模型设置问题，耐心按上面几步走就行。

4.3 仿真结果和实测对不上，先怀疑这些地方

仿真和实测完全一致是不可能的，但如果偏差大到离谱，多半不是仿真没意义，而是你忽略了某些关键环节。我总结过最常见的几个偏差来源。第一个是探头和测量方法，比如用普通示波器探头直接测量开关节点，探头寄生电容会把振铃波形“测”得更吓人；第二个是器件模型不准确，特别是电感饱和曲线和电容ESR随频率的变化；第三个是温度特性，仿真里MOSFET和二极管结温是固定的，实际板子跑热后导通压降和开关损耗都会变；第四个是控制IC的固有延时和驱动能力，很多芯片模型不包含内部死区时间或最小导通时间，这在轻载和突发模式下表现特别明显。

遇到对不上的情况，别急着怀疑仿真工具，先逐一排查上述因素。我个人的经验是：波形形态对得上，幅值有偏差，大概率是测量方法或寄生参数问题；如果波形形态都对不上，说明模型结构或者控制逻辑有本质差异，这时候一定要回头检查电路连接和模型版本。用这种思路做排查，一次比一次准。

5. 进阶方向：数字电源、四开关Buck-Boost与FPGA电源仿真

5.1 数字电源怎么“模拟”

现在很多DC/DC电源已经从模拟控制转向数字控制，比如基于STM32的四开关Buck-Boost双向升降压数字电源。数字电源的仿真比模拟电源多了一层麻烦：除了功率级电路，还要把ADC采样、数字补偿器、PWM更新延时放进去。很多人一开始在模拟域里把环路调得很完美，一上数字代码就表现不对，就是因为没有仿真采样延时和量化误差。

我建议的模拟方法是：先用PLECS或者Simulink搭一个功率级和控制算法的系统级模型，把ADC分辨率、采样频率、PWM占空比更新时刻都离散化建模。然后做两件事：一件是看模式切换，也就是升降压切换瞬间电感电流有没有突变；另一件是看数字补偿器在低采样率下的相位损失，通常需要把穿越频率压低，避免稳定性问题。这样仿真做完，再往STM32平台移植代码，会比直接调硬件快得多。数字电源的痛点往往不在稳态，而在边界切换和异常输入电压，所以仿真里要专门构造这些边界场景。

5.2 四开关Buck-Boost的仿真要点

四开关Buck-Boost拓扑是中间一个电感、前后各两个开关管组成的半桥结构，既能把电压升高也能降低。仿真时最值得注意的是模式切换逻辑和死区设置。它在Buck模式和Boost模式之间切换时，如果策略不够平滑，电感电流可能在一瞬间冲高，甚至损坏开关管。我做过几次这个拓扑的仿真，前期用的是理想开关模型，先验证控制模式：什么时候全桥Buck，什么时候全桥Boost，什么时候做Buck-Boost过渡。等逻辑跑通，再换成真实MOSFET模型，把死区时间和体二极管反向恢复影响加进去。

还有一个很实际的点：在双向工作场合，比如电池充放电，电感电流会反向，这时候半桥的同步整流必须正确工作。仿真时要专门检查反向电流路径，看看低端管和高端管的开关时序有没有冲突。很多数字电源故障，根源就在模式切换瞬间的占空比突变，而不是稳态参数。仿真里可以刻意在轻载到重载、降压到升压等场景下加阶跃，看系统是否稳定，这是最值得花时间的地方。等你把四开关Buck-Boost的仿真跑顺了，再去看其他复杂拓扑，基本都能举一反三。

5.3 FPGA电源解决方案中的仿真应用

FPGA这类器件对电源要求很挑剔，核心电压往往只有0.8V到1.2V，电流却可能达到几十安，还需要多路上电时序配合。用DC/DC模拟技术来做FPGA供电设计，我觉得最有用的部分是电源树阻抗分析和上电时序验证。电源树的原理是：从DC/DC输出端到FPGA引脚之间有PCB走线和去耦电容，它们会形成一个网络阻抗。FPGA负载瞬态变化时，这个网络阻抗必须低于目标阻抗，否则核心电压就会跌出容限。

仿真里可以建立包括磁珠、去耦电容、PCB过孔电感和负载电流频谱的模型，做AC分析看PDN阻抗曲线。如果发现在某个频率出现阻抗尖峰，就在对应位置调整去耦电容容值和数量。这个流程很多工程师靠经验估算，但用仿真能更精确。另外，多路电源的上电时序，比如先给VCCINT上电、再给VCCAUX上电，也可以用仿真验证。加一个简单的电压比较逻辑，看时序窗口是否符合FPGA手册要求。把这些都跑完再画板，出问题的概率会小很多。

我看着这几年DC/DC电源模拟工具越来越成熟，但真正拉开差距的，往往不是软件多高级，而是建模思路和对原理的理解。我个人的习惯是：先仿真把控制策略和关键波形跑通，再进入原理图和版图设计；遇到仿真和实测对不上的情况，先怀疑探头测量方式，再怀疑模型参数，最后才怀疑软件本身。最后再分享一个小技巧：在仿真文件里给每一个节点命名都用“人话”，比如VIN、SW、VOUT、GND，不要图省事用默认编号。等你调试复杂电路时，会发现自己救了自己一命。