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一、什么是时序优化？为什么需要它？

✅定义：
时序优化是指通过各种方法（代码风格、约束、工具设置、资源使用等），让设计在更高频率下稳定工作，同时满足 Setup / Hold 时序要求。

💡核心价值：

• 提高最大工作频率（Fmax）
• 解决时序违例（WNS < 0）
• 降低功耗和资源占用
• 加快设计迭代收敛

📌一句话总结：
代码写完只是开始，时序优化才是让 FPGA 真正“跑起来”的核心战斗。

二、时序违例常见原因 + 诊断方法

最常见的违例类型：