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1. 项目概述：DPAA架构下的SEC数据处理核心机制

在嵌入式网络处理器和高端通信SoC的设计中，如何高效、安全地处理海量数据包，同时将CPU从繁重的加解密、协议封装等任务中解放出来，是一个永恒的挑战。NXP的QorIQ系列处理器给出的答案是DPAA（Data Path Acceleration Architecture，数据路径加速架构）。这套架构的精髓，在于它构建了一套标准化的“数据高速公路”和“交通规则”，让数据包能够像集装箱一样，在硬件加速器之间快速、有序地流转。而SEC（Security Engine，安全引擎）就是这条高速公路上一个至关重要的“海关”或“加工厂”，专门负责数据的安全处理。

要理解SEC如何工作，就必须深入其与DPAA框架交互的基石：帧队列（Frame Queues, FQs）、帧描述符（Frame Descriptors, FDs）和缓冲区管理器（Buffer Manager, BMan）。这听起来像是一堆晦涩的硬件术语，但我们可以用一个物流仓库的模型来类比：帧队列是待处理包裹的传送带，帧描述符是贴在每个包裹上的运单（上面写着包裹内容、目的地、处理要求），而缓冲区管理器则是自动化立体仓库，负责按需提供空箱子（缓冲区）和回收用完的箱子。

SEC并不直接去仓库里翻找包裹，它有一个专门的“前台”——队列接口（Queue Interface, QI）。QI的工作就是从传送带（帧队列）上取下运单（帧描述符），根据运单上的特殊备注（预头部，Preheader），向仓库（BMan）申请合适大小的空箱子来装处理后的货物，或者决定是否要保留原来的包装箱。最后，它将处理完的包裹贴上新的运单，放回指定的出货传送带。

这套机制的价值巨大：它实现了计算与数据管理的解耦。SEC可以心无旁骛地执行AES、SHA等复杂的数学运算，而繁琐的内存分配、数据搬运、队列调度则交给专精于此的QMan和BMan。这不仅带来了极高的吞吐量和极低的延迟，还天然支持多用户、多任务场景下的资源隔离与公平调度——每个用户或服务可以拥有自己专属的传送带和运单格式，互不干扰。

本文将以NXP LS1046A的SEC模块为蓝本，结合手册内容与实际驱动开发经验，为你彻底拆解帧队列、帧描述符与缓冲区管理的运作细节、设计考量与实战避坑指南。

2. 核心组件深度解析：QMan、BMan与SEC QI的角色与协作

在深入帧描述符的细节之前，我们必须先厘清DPAA中几个核心“部门”的职责与协作关系。很多开发者一开始容易混淆这些概念，导致在配置和调试时走弯路。

2.1 队列管理器（QMan）：数据流的交通枢纽

QMan是DPAA架构的“中央调度器”。你可以把它想象成一个高度智能的交叉路口，连接着多个CPU核心、硬件加速器（如SEC、PME）和网络接口。

• 核心功能：管理数百万个帧队列（FQs）。每个FQ都有一个唯一的ID，并关联一个帧队列描述符（FQD），存储在特定的内存区域（如帧队列描述符区域，FQDR）。FQD中不仅包含了队列的状态（如空、满、拥塞），还携带了两个至关重要的上下文参数：Context_A和Context_B。
• 与SEC的交互：SEC通过其QI模块，向QMan的特定“服务窗口”（称为Portal）发起“出队（Dequeue）”请求。QMan会从指定的FQ中取出一个或多个帧描述符（FD），连同该FQ的FQD中的Context_A/B信息，一并返回给SEC QI。处理完成后，SEC QI再发起“入队（Enqueue）”请求，将结果FD送回QMan，由QMan根据Context_B指定的FQ ID，将结果FD放入对应的响应队列。
• 设计优势：这种设计使得任务提交变得极其灵活。应用程序或内核驱动只需将FD放入自己的FQ，SEC就能自动获取并处理，处理完再放回应用程序指定的响应FQ。软件无需关心SEC内部有多少个处理单元（DECO），也无需进行复杂的锁同步，实现了高效的“生产者-消费者”模型。

2.2 缓冲区管理器（BMan）：内存资源的自动化仓库

BMan是专为数据包处理优化的动态内存分配器。传统的内存分配（如malloc）在高速数据面中开销太大，且容易产生碎片。

• 核心概念——缓冲区池（Buffer Pool）：BMan管理着多个缓冲区池。每个池有一系列固定大小的缓冲区（如256B, 2KB, 4KB）。这些缓冲区在系统初始化时由软件预先分配并注入（“贡献”）给BMan管理。
• “托管缓冲区”：BMan管理的缓冲区被称为“托管缓冲区”。SEC（通过QI）需要输出缓冲区时，不是调用malloc，而是向BMan申请指定池ID的缓冲区。用完后，再通过QI或软件指令将其释放回池中。
• 与SEC的交互：当SEC QI需要为输出数据分配空间时，它会根据预头部的POOLID和POOL_BUFFER_SIZE字段，向BMan申请一个或多个缓冲区。如果申请失败（如池耗尽），QI会终止作业并返回错误。这种集中式、池化的管理方式，极大地提高了内存分配的效率和确定性，是低延迟、高吞吐系统的关键。

2.3 SEC队列接口（QI）：关键的翻译官与协调员

SEC QI是连接DPAA“外部世界”与SEC“内部计算核心”的桥梁。它的工作远不止是传递数据。

• 核心职责：
  1. FD到JD的转换：将接收到的标准DPAA帧描述符（FD），结合预头部信息，翻译成SEC内部执行单元（DECO）能够理解的作业描述符（Job Descriptor, JD）。这个JD包含了指向输入/输出数据的指针、长度、以及指向共享描述符（Shared Descriptor, SD）的指针（如果存在）。
  2. 缓冲区管理：根据预头部的指令（ABS,ADDBUF,FSGT等），判断是否需要以及如何为输出数据分配缓冲区，并与BMan交互完成申请与释放。
  3. 错误处理：处理BMan池耗尽、内存访问错误、描述符格式错误等情况，并在返回的FD中设置相应的错误状态码。
  4. 结果回传：构建输出FD（可能是新的简单帧FD，也可能是复合帧FD），并通过QMan将其入队到指定的响应FQ。
• 重要性：正是QI的存在，使得SEC内部的处理核心（Job Ring Controller, DECO）可以完全“无视”DPAA的复杂数据结构，只需专注于执行描述符定义的计算任务。这实现了良好的硬件模块化设计。

实操心得：理解“门户”（Portal）QMan Portal是CPU或加速器访问QMan服务的硬件接口。每个Portal就像银行的一个柜台。SEC通常有专用的QI Portal。在软件驱动中，你需要为SEC配置并初始化这个Portal，包括设置其缓存、中断等。多核系统中，不同核可能通过不同Portal访问QMan，需要注意缓存一致性配置（如qman_cci配置），否则会出现数据看不见的诡异问题。

3. 帧描述符（FD）与预头部（Preheader）：数据处理的蓝图

帧描述符是DPAA中数据包的“身份证”和“托运单”。它本身不包含用户数据，而是描述了数据在哪里、有多长、以及如何处理。

3.1 帧描述符的两种核心格式

FD主要有两种格式，决定了SEC处理数据的模式：

1. 简单帧（Simple Frame）FD：

   • 描述单个数据帧，可以是输入，也可以是输出。
   • 内部又分为短格式（20位长度+9位偏移）和长格式（29位长度，无偏移）。偏移字段用于指定数据在缓冲区起始地址之后的偏移量，常用于协议头处理。
   • 数据可以存放在单个连续缓冲区，也可以通过散列表（Scatter/Gather Table, SGT）指向多个非连续缓冲区。SGT本身也是一个缓冲区，其每个条目记录了子缓冲区的地址和长度。

2. 复合帧（Compound Frame）FD：

   • 同时描述两个帧：一个输入帧和一个输出帧。它指向一个两入口的SGT，第一个入口描述输出帧，第二个入口描述输入帧。
   • 核心价值：保留输入帧。在简单帧模式下，SEC处理完后默认会通过BMan释放输入缓冲区。而在复合帧模式下，输入缓冲区不会被自动释放。这对于需要组播（Multicast）或重传（Retransmission）的场景至关重要。例如，一个原始数据包需要被加密后发送给多个目的地，或者需要保留原始包以备重传，就必须使用复合帧。

格式选择决策树：

• 是否需要保留原始输入数据？是 -> 使用复合帧。
• 输出数据大小是否确定且已知？是，且希望提供输出缓冲区 -> 可在复合帧中指定输出帧地址。
• 输出数据大小动态或未知？-> 使用简单帧，让SEC QI根据预头部配置动态分配。
• 追求极致性能与低开销？-> 简单帧通常软件开销更小。

3.2 预头部（Preheader）：SEC QI的“配置手册”

预头部是帧队列描述符（FQD）中Context_A字段所指向的一块内存数据。它是帧队列级别的配置，意味着所有通过这个FQ提交的作业，都共享同一份预头部配置。这避免了在每个FD中重复携带配置信息，提高了效率。

预头部格式复杂，但我们可以将其核心字段分为几类来理解：

表1：预头部核心字段功能分类

预头部工作流程解析： 当SEC QI从某个FQ出队一个FD时，QMan会将该FQ对应的FQD中的Context_A（即预头部地址）传给QI。QI随后会去读取这块内存，获取上述配置。接下来，QI就像一个“自动装配机器人”：

1. 判断输出需求：检查ABS和ADDBUF。如果{ABS, ADDBUF}为10b，则不申请输出缓冲区（适用于仅验证签名等无输出的操作）。否则，进入分配流程。
2. 计算缓冲区数量：
   • 若ABS=0（相对模式）：计算ceil(输入数据长度 / POOL_BUFFER_SIZE) + ADDBUF。
   • 若ABS=1（绝对模式）：缓冲区数量 =ADDBUF(0或1)。
3. 判断SGT需求：如果步骤2计算的缓冲区数量>1，或者FSGT被强制置1，则需要构建SGT。QI会从TBPID池（若TBPSIZ非零）或POOLID池申请一个缓冲区来存放SGT。
4. 申请缓冲区：QI根据POOLID和计算出的数量，向BMan申请数据缓冲区。如果DIFREL=1，则还需要从TBPID或POOLID池申请一个缓冲区，用于构建包含输入和输出帧的复合SGT。
5. 构建输出FD：根据LONG、OFFSET等字段，构建最终输出帧的FD格式。

避坑指南：预头部配置的常见陷阱

• POOL_BUFFER_SIZE对齐：该字段的LSB被视为0，即只支持偶数字节大小（2,4,8...）。配置为奇数会导致未定义行为。
• OFFSET与缓冲区大小：软件必须确保输出帧有足够空间容纳偏移量。同时，偏移量必须至少比POOL_BUFFER_SIZE小1字节。例如，缓冲区大小为256字节，最大有效偏移为255字节。
• LONG格式与偏移：当LONG=1时，OFFSET字段被忽略。长格式FD没有偏移字段，所有29位都用于表示长度。如果你需要偏移，就不能使用长格式。
• 复合帧下的忽略字段：当使用复合帧且提供了输出帧时，FSGT、LONG、OFFSET、ABS、ADDBUF、POOLID、POOL_BUFFER_SIZE这些字段都会被QI忽略。因为输出帧的属性已由复合SGT中的条目完全定义。

4. SEC QI的作业处理全流程与内部转换

理解了FD和预头部，我们来看SEC QI如何处理一个完整的作业请求。这个过程清晰地展示了数据从DPAA标准格式到SEC内部格式的转换。

4.1 从FD到JD：描述符的“编译”过程

QI的核心任务之一是将一个FD“编译”成SEC DECO可执行的作业描述符（JD）。这个内部JD是一系列DECO命令的序列。

内部生成的JD基本结构如下（以48位地址为例，无LOAD命令）：

1. HEADER命令：包含描述符总长度、共享描述符指针偏移等信息。
2. 共享描述符指针（Shared Descriptor Pointer）：指向共享描述符（SD）的地址。SD包含了具体的加密、哈希等操作序列。
3. SEQ OUT PTR命令 + 输出长度：指向输出数据的地址和长度。
4. SEQ IN PTR命令 + 输入长度：指向输入数据的地址和长度。
5. 可选的LOAD Immediate命令：用于加载FD中的CMD字段到DPOVRD寄存器，以覆盖协议默认参数。

这个内部JD的长度是动态的：取决于地址宽度（32位还是48/64位）以及是否包含LOAD命令。一个关键的约束是：内部JD与SD的总字数不能超过64个（256字节）。因此，如果你的SD很复杂，就需要留意这个限制。手册建议，与QI配合使用的SD最好限制在51字以内，以保安全。

4.2 FD STATUS/CMD字段的妙用：逐帧控制

FD中的STATUS/CMD字段（通常占用高几位）为软件提供了在队列流控基础上，对单个帧进行精细控制的能力。

表2：FD CMD字段（高3位）控制功能

• 追加LOAD命令（CMD[31]=1）：QI会在内部JD末尾追加一个LOAD命令，将完整的32位STATUS/CMD字段值加载到DECO Protocol Override Register (DPOVRD)。这允许软件在每帧基础上覆盖特定协议参数（如AES的IV生成模式）。
• 设置ICID相等（CMD[30]=1）：这会强制将本作业的Non-Seq ICID设置为与Seq ICID相同。ICID（Isolation Context ID）用于在硬件级别隔离不同用户或进程的数据访问。此功能用于某些需要统一ICID的场景。
• 替换作业描述符（CMD[29]=1）：这是高级功能。QI会设置SEQ IN PTR命令中的RJD位，指示DECO丢弃QI内部生成的JD，转而从输入帧的起始处读取一个“替换作业描述符（Replacement Job Descriptor, RJD）”来执行。这给了软件极大的灵活性，可以完全自定义JD。但要注意：如果还需要协议覆盖，必须在RJD内部包含LOAD命令；且RJD+SD的总长也不能超过64字。

4.3 简单帧与复合帧的处理规则对比

QI根据FD格式（简单/复合）和预头部配置，遵循不同的处理规则。理解这些规则是正确配置的关键。

简单帧处理规则摘要：

1. 输出帧构建：除非{ABS, ADDBUF} = 10b（不请求缓冲区），否则QI都会构建输出帧。
2. 输入帧释放：如果DIFREL=0，处理完成后QI会通过BMan释放输入帧缓冲区。如果DIFREL=1，则QI会构建一个复合帧FD，将输入帧和输出帧一起放入一个两入口的SGT中返回，从而保留输入帧。
3. 缓冲区申请逻辑：完全由ABS和ADDBUF控制，见前文。
4. SGT强制创建：即使只需一个缓冲区，若FSGT=1，QI也会多申请一个缓冲区来创建SGT。

复合帧处理规则摘要：

1. 输入帧永不自动释放：SEC永远不会释放复合帧中的输入帧缓冲区。释放工作必须由软件在收到结果后，根据复合SGT中的输入帧信息手动完成。
2. 输出帧的三种可能：
   • 输出帧地址 != 输入帧地址：这是典型用法，输出写入独立的缓冲区。
   • 输出帧地址 == 输入帧地址：输出覆盖输入缓冲区。这是危险操作！软件必须确保SEC在读取完输入数据之前，不会覆盖它。通常可以通过设置输入帧的offset大于输出帧的offset来实现交错。
   • 输出帧地址未指定（SGT入口全0）：SEC将根据预头部配置，从BMan申请缓冲区来构建输出帧。此时，QI会限制输出帧的长度和偏移，以符合简单帧FD的格式限制（长格式29位长度，短格式20位长度+9位偏移）。

实战经验：选择简单帧还是复合帧？

• 性能优先：大多数情况下，使用简单帧并让QI自动分配输出缓冲区是最高效的。软件只需管理输入缓冲区和释放结果缓冲区。
• 零拷贝需求：如果需要原地处理（in-place operation），即输出覆盖输入，必须使用复合帧，并确保地址相同且做好读写顺序保护。
• 数据保留需求：如果需要保留原始数据用于重传或组播，必须使用复合帧，并设置DIFREL=1（对于简单帧）或直接使用复合帧FD。
• 缓冲区预分配：如果应用程序能预知输出大小（如加密后大小固定），可以使用复合帧并预先提供输出缓冲区，避免QI动态分配的开销和不确定性。

5. 错误处理与调试：当事情出错时

在高速数据处理中，稳健的错误处理机制与清晰的调试信息同样重要。SEC QI和DECO会检测多种错误，并通过FD的STATUS/CMD字段返回。

5.1 常见的错误来源

1. BMan缓冲区池耗尽：这是最常见的运行时错误。当QI向BMan申请缓冲区失败时，会导致作业终止。

   • 单缓冲区申请失败：QI直接返回输入帧，并在FD状态字段中设置“缓冲区池耗尽”错误。
   • 多缓冲区或SGT申请失败：情况更复杂。如果是在任何SGT条目写入内存之前失败，则释放所有已申请的缓冲区，返回输入帧及错误。如果部分SGT条目已写入，则QI会保留这部分已构建的（可能是空的）输出帧，将最后一个有效SGT条目的F（Final）位置1，并将这个不完整的帧返回给用户，长度设为0，并携带错误状态。这为调试提供了线索，但软件必须将这些缓冲区视为可疑并妥善清理。

2. 内存访问错误：QI在读取预头部、SGT或数据缓冲区时发生错误（如非法地址）。

3. 描述符格式错误：例如，预头部SDLEN=0但输入帧开头没有内联描述符。

4. 协议或计算错误：在DECO执行过程中发生的错误，如密钥错误、数据对齐错误等。

5.2 QI的早期错误检测与DNR位

QI在准备作业时就能发现一些错误（如上述1、2、3）。此时，QI会在它构建的内部JD的HEADER命令中设置“Do Not Run (DNR)”位。

当DECO拿到这个设置了DNR位的JD时，它只会执行最基本的清理工作（例如，如果SEQ IN PTR命令中设置了释放缓冲区位RBS，则释放输入缓冲区），然后就会跳过共享描述符命令的执行（如果PD位被设置，DECO可能会更新共享描述符中的DNR位），直接让QI报告错误。这防止了无效作业占用宝贵的DECO计算资源。

5.3 调试建议与排查清单

当SEC作业失败时，可以按照以下步骤排查：

1. 检查FD状态字段：首先读取返回FD的STATUS/CMD字段，确认错误码。这是最直接的线索。
2. 确认缓冲区池状态：
   • 使用BMan调试工具或寄存器，检查POOLID和TBPID对应的缓冲区池是否已耗尽或配置错误（如缓冲区大小不符）。
   • 确保软件及时释放不再使用的缓冲区回池中。
3. 审查预头部配置：
   • 确认POOL_BUFFER_SIZE与BMan池的实际缓冲区大小匹配。
   • 检查OFFSET设置是否超过POOL_BUFFER_SIZE - 1。
   • 确认ABS/ADDBUF逻辑符合预期。
   • 对于复合帧，确认输出帧缓冲区大小是否足够容纳输出数据。
4. 检查内存与对齐：
   • 确保预头部、SGT、数据缓冲区的地址是缓存行对齐的（通常64字节）。
   • 确认所有指针地址都是有效的，并且软件有访问权限（正确的ICID配置）。
5. 验证描述符：
   • 如果使用内联描述符（SDLEN=0），确认输入帧开头是正确的JD。
   • 如果使用共享描述符，确认其地址正确，且与内部JD总长不超过64字。
   • 如果使用RJD（替换描述符），确保其格式正确且包含了必要的命令。

深度避坑：缓存一致性与ICIDDPAA硬件通常不自动维护缓存一致性。你必须确保在将描述符或数据放入内存、并通知硬件（如入队）之前，正确地将相关缓存行写回（Write-Back）到内存。同样，在硬件处理完成后、软件读取结果之前，需要无效化（Invalidate）相应的缓存行。ICID与内存隔离域（Memory Isolation Domain）关联，错误的ICID配置会导致硬件访问内存时触发错误。务必在软件层面（如Linux的caam驱动中）正确配置每个帧队列和作业流的ICID。

6. 性能优化与高级配置指南

理解了基本原理后，我们可以探讨一些提升SEC处理性能和安全性的高级主题。

6.1 利用共享描述符（SD）与流共享

共享描述符封装了具体的加密、认证等操作序列。它的一个强大特性是支持流共享（Sharing Flows）。

• 原理：多个连续的、使用相同SD的作业可以形成一个“流”。SEC硬件可以缓存该SD，并为流中的后续作业复用，避免了重复从内存读取SD的开销。
• 模式：分为“等待（Wait）”和“串行（Serial）”共享。在等待共享中，后续作业会等待前一个作业完成对SD的更新（如更新计数器）；在串行共享中，作业按顺序严格执行。
• 关键要求：如果流中任何一个作业需要写回更新协议数据块（Protocol Data Block, PDB，例如AES的计数器），那么流中的所有作业都必须配置为写回PDB，即使某些作业的PDB实际上没有变化。这确保了硬件能正确序列化对共享内存的更新。

6.2 预取（Prefetch）机制

SEC的作业队列控制器（Job Queue Controller）具有积极的预取机制以提升性能：

1. 当从帧队列出队一个作业时，控制器会预取JD（最多到突发边界）。
2. 如果存在SD，并且它不在缓存中，控制器会预取整个SD。
3. 对于QI提交的作业，如果输入帧是单缓冲区，控制器会预取输入帧的前128字节（不超过帧长）。如果是SGT，则会预取SGT的前4个条目。如果输出帧也是SGT，也会预取其前4个条目。

优化启示：确保SD、输入帧数据的前部以及SGT的前几个条目位于缓存友好的内存位置，能有效利用这一预取机制，减少DECO执行时的等待时间。

6.3 关键资源ID（CRID）用于流控

预头部中的CRID字段（Critical Resource ID）是一个高级流控特性。你可以为某些关键硬件资源（如特定的密码算法引擎）分配一个ID。

• 当QI准备将一个作业送入DECO时，如果该作业的CRID非零，且该CRID标识的所有资源实例都被其他作业流占用，那么此作业流的调度优先级会被降低。
• 这可以防止某个高优先级队列独占稀缺资源，导致其他队列饿死，从而实现更公平的调度。

6.4 帧队列与作业环（Job Ring）的对比

手册中提到了SEC除了QI，还可以通过传统的作业环（Job Ring）提交作业。两者对比鲜明：

• 作业环：是SEC本地的、受限的硬件资源。一个环通常只能由一个“所有者”（如一个CPU核或一个驱动实例）高效使用。多用户需要通过软件（如操作系统驱动）在环级别进行协调和仲裁，或者动态地重新配置环的归属和内存访问权限。这带来了复杂的软件开销。
• 帧队列（通过QI）：QI可以从数百万个帧队列中接收FD和队列特定的用户资源访问权限。控制软件只需在初始化时为每个用户配置好其专属的队列和访问权限。之后，当用户的FD被出队处理时，SEC自动获得了处理该作业所需的权限。这实现了天然的、硬件辅助的多用户隔离和公平性，极大地简化了软件架构。

因此，在现代DPAA驱动设计中，优先使用QI+帧队列的模式，除非有极特殊的低层级、独占访问需求。

7. 总结与核心要点回顾

DPAA框架下SEC的帧队列、描述符与缓冲区管理机制，是一套为高性能、可扩展数据面处理而生的精妙设计。其核心思想是标准化、解耦与硬件托管。

• 标准化：通过帧描述符（FD）这一统一数据结构，抽象了所有数据包，使得它们可以在QMan管理的任意队列间流通，并被SEC等加速器无缝处理。
• 解耦：SEC专注于计算，QMan专注于调度，BMan专注于内存管理。QI作为适配层，负责协议转换。这种分工带来了极高的效率和可维护性。
• 硬件托管：缓冲区的申请、释放、队列的入队出队，全部由硬件自动完成，软件仅负责提供策略（通过预头部）和接收通知，将CPU从繁重的数据搬运中解放出来。

在实际开发中，牢牢把握以下几点：

1. 明确数据生命周期：你的输入数据是否需要保留？这决定了使用简单帧（DIFREL）还是复合帧。
2. 精确计算缓冲区需求：根据输出数据大小、POOL_BUFFER_SIZE、ABS/ADDBUF，准确预判QI会申请多少缓冲区。错误配置会导致池耗尽或内存浪费。
3. 善用预头部队列级配置：将通用的处理参数（如输出缓冲区池、是否强制SGT）放在预头部，而不是每个FD里，提升效率。
4. 理解错误处理语义：特别是多缓冲区申请部分失败时，QI可能返回一个部分构建的帧，软件需要能安全地清理这种状态。
5. 重视缓存与一致性：在涉及硬件加速器的系统中，缓存一致性必须由软件显式管理，这是许多隐性Bug的根源。

这套机制初看复杂，但一旦掌握，就能让你在嵌入式网络和安全处理领域，设计出既高效又稳健的系统。它不仅是NXP芯片的特性，更代表了一种处理高速数据流的经典架构思想。